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快速入门git指令--极简介绍 Git 常用语法1 ： git clone2 : git pull3 : git branch4 : git checkout5 : git reset6 : git diff7 : git add8 : git commit9 : git push10 : git fetch11 : git init12 : git log13 : git merge14 : git rm15 : git status16 : git taggit revertgit remotegit mvgit config快速上手
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FPGA面试 --- 2 1 设计一个占空比为 50 % 的五分频时钟设计5分频时钟时，由于属于奇数分频，故需要添加两种计数器和时钟进行逻辑组合操作。首先设计时钟上升沿有效的计数器进行计数，计数到 5 (要进行分频的个数)置零。时钟 clk1 是上升沿有效，初始为 高，计数到 大于 5/2 (奇数计数的一半)时拉低，计数器为0时在拉高。另一个计数器设置时钟下降沿有效，同理计数到 5 置零 。时钟 clk2 为下降沿有效，逻辑同时钟 clk1 。此处 时钟 clk1 和 clk2 占空
FPGA面试题 面试题摘自尤老师FPGA 。12TPLH：脉冲由低电平变成高电平的延迟时间TPHL: 脉冲由高电平变成低电平的延迟时间本题采用假设法，假设开始输入信号为高电平，经过两次非门是一个时钟周期 (TPHL+TPLH = 0.2 ns) ,震荡周期意思为下次到达起始位置时的电平信号与第一次到达起始位置的电平信号相同时所花的时间。所以跑完一轮是2.5个时钟周期，此时回到起始位置为低电平，与第一次开始的高电平不等，故还要经过一轮；总共经过两轮也就是五个时钟周期才满足一个震荡周期。所以震荡周期为 0.2
ZYNQ 7 Processing system IP 核基本配置 Zynq 板卡型号为 7100 ，具体如下图 ：一 ：ZYNQ 中的 IO 规则要想配置 Zynq 的 IO 资源，就必须先了解 其 IO 的使用规则 。该部分中有的知识点摘录自 :被王大锤砸的核桃传送门GPIOGPIO （General-Purpose IO),即通用 IO 接口，是 ZYNQ 所有 IO 的统称，它包括 MIO,EMIO,AXI GPIO 和 AXI Lite 自定义的 GPIO 。它们的区别如下 :MIOM7100FA 属于 Zynq7000 系列，故有
Vivado中DDR4的使用 最近在使用 Xilinx 的 VU9P 板卡做一些基于FPGA的神经网络加速部署，其中就用到了 DDR 进行数据的存储。板卡具体型号如下图所示 :资源分布量如下图所示 :注意如果板卡型号属于 7系列 Xilinx 板卡型号，那么其 DDR 类型为 DDR3 资源。 如果板卡型号属于 Ultra 系列，那么 DDR 的类型就属于 DDR4 资源。由于我所使用的板卡为 Ultra 系列，故使用的为 DDR4 类型。DDR4-MIG核配置...
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