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fpga
weixin_43065256
这个作者很懒,什么都没留下…
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vivado2015.4 sdk利用串口输出Hello World(下)
1.打开SDK之后,我们可以发现系统给我们自动生成了一些文件2.点击左上角的file,new 一个application project3.发现左侧多了两个文件夹打开helloworld.c就可以看见里面的程序4.最后选择xilinx toos 里的Program FPGA,下载程序5. 选择Window > Show view > Terminal. 打开以下界面设置串口6.选择debug的小虫子,点击debug as->launch on h原创 2020-07-23 13:08:17 · 1344 阅读 · 0 评论 -
vivado2015.4 sdk利用串口输出Hello World(上)
1.New Project选择对应的芯片型号Parts 还有板Boards2.选择左侧 Creat Block Design3.这时候会有Block Design的界面,点击左侧Add IP 输入zynq,选择我红色圈住的那个4.因为我们只需要用到UART 口,所以只需要勾上UART,其他可以忽略.Expand I/O peripherals if necessary, and deselect all the I/O peripherals except UART 1. i原创 2020-07-23 12:51:01 · 1290 阅读 · 0 评论 -
VIVADO小技巧
debug时防止信号在综合时被综合掉 ,在前面加(keep= “TRUE”)如 (keep= “TRUE”) reg [7:0]SDOF;原创 2020-06-27 16:44:29 · 477 阅读 · 0 评论 -
matlab生成正弦波并量化存入txt
close;clc;clear;N=128;f0=1e6;fs=10e6;n=1:N;y=sin(2*pi*f0.*n/fs);Y=fft(y);y1=y';q=quantizer([14 12]);y2=num2bin(q,y1);fid1=fopen('C:\ME\ME_matlab\y1.txt','wt');for i=1:N fwrite(fid1,y2...原创 2020-03-28 11:02:54 · 4138 阅读 · 0 评论 -
ERROR: [Vivado 12-4041] Failed to create directory. Please check directory permissions: '.cxl.ip'
vivado版本:2018.3modelsim:10.6dcompile出现下面的错误:ERROR: [Vivado 12-4041] Failed to create directory. Please check directory permissions: '.cxl.ip'其实这里把下面的language 改成all就可以了(因为编译的库里面有verilog也有VHD,所以要选a...原创 2020-03-01 16:35:39 · 3323 阅读 · 2 评论