计算机专业复试问题自用笔记,408各科重要知识点总结。
1、冯诺依曼体系结构
五大组成:运算器,存储器,控制器,输入设备,输出设备。
特点:
(1)指令和数据以二进制码表示;
(2)指令由操作码和地址码组成;
(3)指令在存储器中顺序存放;
(4)运算器为中心。
2、MAR和MDR
MAR:存储地址寄存器,保存需要访问的存储单元地址。反映存储单元的个数。
MDR:存储数据寄存器,缓存读出/写入存储单元的数据。反映存储字长。
存储器的最大容量由MAR寄存器的位数和MDR寄存器的位数共同决定。
3、中断
中断是指 CPU 对系统发生某事件时的一种响应:CPU 暂停正在执行的程序,在保留现场后自动地转去执行该事件的中断处理程序;执行完后,再返回到原程序的断点处继续执行。
中断处理程序的具体处理过程:
(1)中断源产生中断请求,关中断,防止错误的中断嵌套;
(2)CPU对现场进行保存,存储断点程序地址并将当前数据压入栈中;
(3)PC 指向对应的中断入口,转入执行中断向量指向的中断服务程序;
(4)完成中断响应后,恢复现场,程序回到断点处,将栈中的数据重新读出,继续执行原程序;
(5)重新开中断。
(看是否支持中断嵌套决定是否在执行中断服务程序前后开、关中断)
4、在CPU和内存之间引入Cache的原因
(1)避免CPU空等I/O访存;
(2)缓解CPU和主存速度不匹配的问题。
5、Cache写策略
写命中:
(1)全写法(直写法):将数据同时写入Cache和主存,一般使用写缓冲;
(2)写回法 (回写法):先将数据在Cache中修改,等到数据所在块被替换时,通过脏位(为1)写回主存;
写不命中:
(1)非写分配法:写不命中时,不将主存内容调入Cache,直接修改主存内容。搭配全写法使用。
(2)写分配法:写不命中时,把主存中的块调入Cache,在Cache中修改。搭配写回法使用;
6、指令流水线
指令流水线是把指令分解为若干子过程,通过将每个子过程与其他子过程并行执行,来提高计算机的吞吐率的技术。
采用流水线技术只需增加少量硬件就能把计算机的运算速度提高几倍,因此成为计算机中普遍使用的一种并行处理技术,解决传统串行执行方式的效率低下问题。
7、影响流水线性能的因素
结构相关是当多条指令同一时刻争用同一资源形成冲突。
数据相关是指令在流水线中重叠执行时,当后继指令需要用到前面指令的执行结果时发生的。
控制相关是当流水线遇到分支指令和其他改变PC值的指令时引起的。
8、I/O控制方式
程序查询方式:CPU会不断轮询I/O设备和数据是否准备就绪,如果准备好就读取数据到CPU中,然后将数据从CPU转移到内存中。
程序中断方式:在IO的时候,CPU可以处理其他工作,当IO完成后会向CPU发出一个中断信号,CPU会保存当前进程的运行状态,转去执行中断处理程序。这样就使得CPU与IO设备能够并行工作。
DMA方式:DMA方式则是以数据块为单位传输的,在 DMA 控制器的控制下,采用获取或挪用总线控制权,在主存与 I/O 设备间进行直接的数据传递,而不必让 CPU 干预。CPU只需要在开始的时候发出CPU指令,在结束的时候DMA会发出中断,CPU执行相关的中断程序就行了。
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