千兆以太网通信
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基于fpga的以太网通信开发
帅癌晚期的彦
FPGA修道者
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基于UDP协议的千兆以太网视频显示系统和心率数据传输
xc7a100tfgg484-2、VITESSE VSC8601以太网基础https://gitcode.csdn.net/65e6ef3d1a836825ed788b02.html?dp_token=eyJ0eXAiOiJKV1QiLCJhbGciOiJIUzI1NiJ9.eyJpZCI6ODE5MjYzLCJleHAiOjE3MTAzMjExMDYsImlhdCI6MTcwOTcxNjMwNiwidXNlcm5hbWUiOiJ3ZWl4aW5fNDUyODQ4NzEifQ.QyyEsiEGoJplLK原创 2024-03-26 21:44:46 · 701 阅读 · 0 评论 -
基于mig核的ddr控制器
首先由于mig核控制器给到用户的命令端口是时分复用的,我写了个mig核的仲裁模块,当读写请求同时来的时候,写的优先级更高,所以就有了个问题。比如极端的情况,你传一个很长的视频,你一直对ddr写,那仲裁模块是否一直处于写状态,导致ddr读请求不被响应。PCIe下发视频给ddr,一直在写ddr,仲裁模块一直处于hdmi的向ddr要数据,读请求一直挂着,向ddr请求不了数据。(就是说pcie +HDMI超过DDR的带宽)原创 2024-03-26 21:23:47 · 683 阅读 · 1 评论 -
心跳包的发送模块设计
发送模块的工作时钟也为125MHz,组帧的数据流如下:首先产生没有校验位数据的帧,将其缓存到一个buffer,一边缓存一边算它的ip和udp校验和,算完了在把数据读出来,读到响应的位置就填计算结果进去,然后在添加crc的帧尾发送出去。原创 2024-03-26 21:15:37 · 794 阅读 · 0 评论 -
千兆以太网的接收和crc校验
解析该以太网帧,包括统计该以太网帧长度+过滤功能(端口号对不对,是否为udp协议)+CRC校验,将解析结果存入状态fifo,一旦状态fifo开始有数,就开始开启读过程,读过程开始时,首先读状态fifo,根据从状态fifo里面读出的以太网帧长度,来读数据fifo(这样能够防止跨帧读),然后在根据状态fifo里面读出的crc校验正确标志和过滤标志,来确定是否将数据fifo读出来的数据送给下一个模块。改掉之后在抓一下,可以看到抓出来的数据完全正确,从最后开始看,除去4个crc校验的尾巴,数据是到255结束的。原创 2024-03-26 21:08:38 · 1291 阅读 · 0 评论 -
# RGMII 接口和 IDDR 原语的使用 和phy芯片
属于IOB资源中的挨着接口的ILOGIC,即输入信号处理逻辑iddr有3种工作模式,使用SAME_EDGE_PIPELINED,一个时钟上升沿下降沿采出的数据q1和q2是对齐的。这里给到fpga的线有4根数据线,1根控制线,所以对于每个phy芯片传递过来的时钟,要例化5个iddr原语来采样4根数据线和1根控制使能。数据线 0bit 和 4bit 为一组, 1bit 和 5bit 为一组,2bit 和 6bit 为一组, 3bit 和 7bit 为一组。代码如下:generate。原创 2024-03-20 16:08:40 · 763 阅读 · 1 评论