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RSS订阅原创 Bat文件无法在windows操作系统运行
1、查找相关解决方法，有的帖子提到：修改环境变量中path添加C:\Windows\system32。此种方法先将上述方法的.bat运行后（bat文件也可以为cmd文件），然后删除多余内容，重新与运行。bat无法在电脑上运行。1、试验方法1无法解决。2、bat文件能够运行。
2023-10-23 22:38:57
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转载 Ultrascale及zynq系列
Ultrascale引入新的布线技术，3D和3D IC , 借助ASIC的时钟管理思想。Ultrascale+支持1T+ bps网络速率，引入FinFET技术，面对更高带宽，能集成更高内存，支持预警系统和雷达系统的应用。
2023-10-04 09:15:26
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原创 makefile入门2
makefile包含显示规则，隐含规则，变量定义，指示符和注释。makefile可以引用文件，分为提示错误和不影响完成目标不提示include FILENAME …-include FILENAME…makefile和Makefile可以作为命名，当include命令搜索不到时将搜索/usr/gnu/include,/usr/local/include, /usr/include注释使用#，\在一行结尾时下一行也是注释make -f 表示读取文件include a. mk b.mk c. m
2023-10-04 07:43:34
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原创 task与function
表示带符号的类型，使用了这个关键字，使得寄存器数据类型、网格数据类型、端口以及函数都可以定义；(2) 函数定义不能包含任何时间控制语句，即任何使用#、@或wait来标识的语句。（3）至少有一个输入变量，至少有一个返回值，没有输出值；（1）在模块内部声明，模块中间调用；（4）函数不能调用任务（task）。（1）任务可以有自己的仿真时间。与主模块共用一个仿真时间单位；（2）而任务能够启动函数；其中signed语句。
2023-10-04 07:37:04
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原创 关于记忆、记忆减退和回忆的猜想
但当反复接收某些领域的信息或知识时（或反复接收某种刺激），记忆会加深，神经元之间可能会聚集，当所有的知识、信息经过迭代的整合后形成了某些知识体系或突破了某些思维的局限后，这个神经元之间开始链接，逐渐形成网络。失去记忆，就是神经元之间一直无法建立链接，有可能是距离太远（信息之间相关性不强），或者是收到环境的影响接收到了无关的信息，抑或是记忆的网络太复杂(每天都在储存或创作着不同的信息)，造成了某种拥堵，阻断了本身看似简单的链接。而网络越大，信息之间的关联性就越强。在不断的接收相关信息的过程中，记忆便产生了。
2023-04-17 23:23:13
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原创 平衡的艺术——速度和面积平衡
流水线的处理会增加设计速度，去除流水线会增加面积，这中间还有个延时，如何平衡取决于设计也取决于需求，嘿嘿????
2021-12-23 09:19:45
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原创 makefile入门4
make执行过程1.读取makefiles的文件列表2.读取makefile文件和所包含文件include3.重建规则4.初始化变量5.建立依赖关系链表6.实现终极目标，更新目标文件。
2021-10-04 09:57:48
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原创 makefile入门3
make如何解析makefile呢？分为两个阶段，读取和更新第一阶段读取：读取makefile，内建变量和规则，建立依赖关系结构链表；第二阶段更新：根据链表决定哪些需要目标更新和重建。命令： -f 读取文件；-t （touch）更新选项；-n 打印选项；make -f file1 -n file2读取file1并重建，IMMEDIATE立即执行，DEFERRED稍后延迟执行。...
2021-10-04 09:42:30
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原创 makefile入门1
makefile是告诉make如何编译原代码和执行程序的。make–help 查询make命令cc 编译原程序目标：命令规则.PHONY表示生成一个伪目标，该伪目标执行make时无效，需要配合make使用.如 .PHONY:cleanclean:rm edit $(object)书写建议：单目标多依赖。...
2021-10-02 00:04:06
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原创 浅谈FPGA设计及选型
一、 FPGA外围电路选择 1、FPGA外围设计最基础的单元为时钟电路，配置电路，电源电路。 2、其余根据应用的不同选择不同的外围接口电路；（接口和存储） 3、需要有更好的呈现时选择显示电路。 二、FPGA内部模块设计和划分 接口设计模块、存储设计模块和时钟、复位和总线电路； 三、FPGA的选型 根据资源和接口形式进行选择；...
2021-04-17 23:07:02
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空空如也
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