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RSS订阅原创 数字电路设计之奇数分频
奇数分频几乎是初学逻辑电路设计时，必然会遇到的一个问题。假如对时钟的占空比没有要求，相信任何一个初学者都可以立马写出分频的RTL代码。难点就在于对50%占空比的处理，其核心思想就在于利用寄存器的不同捕获边沿。假设奇数分频的值为2N+1，同时进行2路分频，第1路在上升沿完成...
2020-08-11 22:22:22
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原创 数字电路设计——异步复位同步释放
在数字逻辑电路中，复位信号的设计是首要解决的基本问题。在进行复位信号设计之前，需要明确的是，复位信号只对时序电路有效，因为时序电路属于双稳态电路，在上电后需要保证电路处于已知的初始态，才能保证正常运行。而对于组合逻辑电路来说，组合逻辑本身不具有存储的功能，因此不需要复位信号。复位信号可以分为同步复位和异步复位两大类。同步复位指的是当复位信号发生变化时，并不立即生效，而是等到有效时钟沿采集到复位信号的变化后，才会对寄存器进行复位操作。从同步复位的描述中，就可发现同步复位的过程是依赖于时钟信号的，所以称之为
2020-08-02 18:37:03
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原创 数字电路设计中的单bit脉冲信号跨时钟域处理
跨时钟域处理一直是数字IC，FPGA等数字电路设计中最常见的问题，英文说法是***Clock Domain Conversion***。之所以需要进行数字信号的跨时钟域处理，主要是因为当信号进入异步时钟域时，如果信号进行跳变的时刻处于异步时钟域中触发器的建立时间和保持时间内，触发器无法确定采集到的信号究竟是高还是低，所以输出端会出现不稳定的状态，也就是亚稳态。如下图所示：对于数字信号的跨时钟域问题，有很多已经非常成熟的处理方式，例如寄存器打两拍，DMUX，结绳信号法，异步FIFO等。本篇文章主要介绍的方
2020-07-30 17:30:23
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原创 我为什么选择KiCad？
开篇说到PCB设计软件，不知道大家率先映入脑海的是什么呢？Altium Designer，Cadence Allegero，还是Eagle？我想，以上这几个名字应该是占据比重最大的。关于PCB设计，博主在之前基本没有接触过，本科时期也不过就是简单地在电工实习里照葫芦画瓢，迷迷糊糊地用过一次AD。而到了硕士阶段，由于所学专业不是直接与硬件电路设计相关的，所以到目前为止，我还一直没有PCB电路板绘...
2020-03-13 23:16:45
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原创 Zynq的启动与配置过程详解
Zynq的JTAG配置过程初学 Zynq 的时候，我相信大家应该和我一样，都是按照惯例打开 Vivado 软件，然后实现 Zynq 可编程逻辑硬件部分PL的设置后，把硬件部署导出，再打开 SDK 进行 ARM 核的软件部分 PS 编程设计，最后再将硬件比特流文件（.bit）和软件的可执行链接文件（.elf）下载到 Zynq 开发板中，这样就可以对自己的软硬件设计进行调试和验证。这种设计方式可以用...
2020-03-12 19:08:59
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原创 嵌入式开发平台Zynq芯片介绍
本文主要对嵌入式开发平台Zynq芯片的发展历史、基础架构和应用等方面的知识进行了介绍，其中有博主自己的**理解与认识**，不是千篇一律的datasheet翻译。感兴趣的小伙伴可以点进来看看！
2020-03-11 16:06:07
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原创 初识——雷达通信一体化技术
开篇为什么我会在自己的个人技术博客里发表一些有关雷达通信一体化技术的文章？因为博主本人是东南大学在读研究生，导师确定下来的研究课题方向就是雷达通信一体化，所以希望能够将自己平时看到的有关雷达通信一体化技术的知识，通过博客的形式向大家展现出来。一方面是为了记录总结自己科研生活的过程，另一方面也是想让更多的人通过我的文章了解到这一领域的发展状态。雷达通信一体化概述雷达通信一体化，顾名思义就...
2020-03-09 23:35:07
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原创 我的第一篇CSDN
创建个人博客的缘起2020年初对于我们来说可能是一个比较特殊的时段，自武汉爆发的肺炎疫情以超乎2003年非典的严重态势蔓延到了全国范围，甚至世界。面对这不知是该称为天灾还是人祸的疫难，无论是像我一样的学生，抑或是身处职场的工作者，大家都被困在了以家庭为中心的方寸之地。而在1月26日这一天，已经退役的篮球运动员科比也葬身于洛杉矶西部的直升机空难之中。科比的身故真的可以称之为巨星的陨落，在NB...
2020-03-09 18:06:01
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空空如也
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