数电实验
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CUMT矿大----电路与数字系统实验四 计数、译码、显示的HDL设计
软件:Quartus II 9.0 (64-Bit) AHDL语言看完觉得不错的点个赞呗╰(*°▽°*)╯一、60进制计数器(静态显示)分频模块(输入时钟40MHZ)subdesign fp( inclk:input; outputf:output;)variable fp[24..0]:dff; f:dff;begin fp[].clk=inclk; f.clk=inclk; if fp[]==19999999 then fp[]=0; f..原创 2021-12-13 20:09:26 · 11370 阅读 · 20 评论 -
CUMT矿大----电路与数字系统实验三 简单逻辑电路设计与仿真
软件:Quartus II 9.0 (64-Bit)看完觉得不错的点个赞呗╰(*°▽°*)╯不要白嫖啊·图形化设计2/4译码器模块· 图形化设计1位全加器模块·模块串联成4位全减器原创 2021-12-13 19:34:05 · 2901 阅读 · 3 评论 -
CUMT矿大----电路与数字系统实验二 计数、译码显示电路设计
软件:Proteus 8 Professional看完觉得不错的点个赞呗╰(*°▽°*)╯不要白嫖啊·利用74LS160设计60进制计数器·利用74LS160设计24进制计数器·利用74LS160设计12归1想要工程文件可以直接私信原创 2021-12-13 13:46:47 · 7195 阅读 · 5 评论 -
CUMT矿大----电路与数字系统实验一 一位全减器
软件:Proteus 8 Professional看完觉得不错的点个赞呗╰(*°▽°*)╯不要白嫖啊·用异或门和与非门设计一位全减器用了两异或门和四与非门·用译码器74LS138设计一位全减器·用数据选择器74LS153设计一位全减器想要工程文件可以直接私信...原创 2021-12-13 13:28:43 · 18718 阅读 · 7 评论