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RSS订阅原创 学习笔记（四）：基于FPGA的颜色识别
|之后将中心点的颜色寄存下来，寄存条件为首先要有运动目标，即有钞票出现在中心区域，理由if判断条件，若有钞票出现在中心区域，此时将valid信号拉高，表明此时的信号有效，与此同时，将中心点的色调寄存下来，根据色调来判断面额。一、首先摄像头采集到的是RGB的格式，所以要将RGB色散空间转变为HSV色散空间，首先要完成将H分量提取出来的功能，提取H分量后就可以对H分量 进行一个角度判断，H值在0到360度之间不同的角度代表不同的颜色，我们只需要将人民币的H值提取出来之后皆可以判断它的颜色。
2023-08-18 19:27:28
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原创 学习笔记（三）：MOS管、卡诺图
S极：源极，不论是P沟道还是N沟道，两根相交的就是。D级：漏级，不论是沟道还是沟道，是单独引线的那边。3.MOS管用作开关时在电路中的连接方法。PMOS：S极接输入，D极接输出。NMOS：D极接输入，S极接输出。2.N沟道与P沟道判别。箭头指向G极的是N沟道。箭头背向G极的是P沟道。
2023-08-18 13:39:54
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原创 学习笔记（二）
设计规划：首先对项目需求有所了解，根据项目需求进行系统结构设计，进而进行系统层次的划分，也就是子功能模块的划分。波形绘制：具体了解各个子模块的模块功能，绘制出各个子模块的模块框图，搞清楚如何通过输入信号和内部声明的诸多变量得到输出信号来实现子功能，进而绘制出功能实现的波形图。波形对比：将仿真的波形与绘制波形图进行对比，若是绘制波形图问题则进行修改。绑定管脚：将工程中的输入输出信号与芯片的I/O管脚进行绑定，这一步可以通过引脚勾选和编写引脚约束来实现。代码编写：参考绘制的波形图，很快完成代码编写、
2023-08-16 23:13:21
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原创 学习笔记：初识verilog
parameter和parameter都可以进行参数的定义，如果使用参数是parameter，可以在顶层文件中通过实例化对模块参数进行修改，localparam只能在模块内部使用，不能进行实例化。verilog简介：Verilog HDL 是一种硬件描述语言，以文本的形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式还可以表示数字逻辑系统所完成的逻辑功能。
2023-08-16 11:58:30
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空空如也
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