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ADC模块是一个逐次逼近(SAR)型ADC，分辨率可选择为16位或12位。ADC由内核和封装器组成。核心由模拟电路组成，包括通道选择MUX、采样保持(S/H) 电路、逐次近电路、基准电压源电路和其他模拟支持电路。封装器由配置和控制模数转换器的数字电路组成。这些电路包括用于可编程转换的逻辑、结果寄存器、到模拟电路的接口、到外围总线的接口、后处理电路以及到其他片上模块的接口。每个ADC模块由单个采样保持 (S/H) 电路组成。ADC模块设计为在同一芯片上重复多次，允许同时采样或独立操作多个ADC。

①周期触发：当周期错误联防事件发生时，TZCTL 寄存器中的动作立刻输出到 ePWMxA 和 ePWMxB 引脚上，另外，周期错误联防事件标志位（TZFLG[CBC]）被置位，同时当 TZEINT 寄存器和 PIE 模块的中断使能时，ePWMx_TZINT 中断就会产生。①如果中断被使能，ETSEL[INTEN]=1 并且中断标志清零，ETFLG[INT]=0，则产生中断脉冲且中断标志位置位，ETFLG[INT]=1，事件计数器清零，ETPS[INTCNT]=0，再重新对事件计数。代码中没有用到，屏蔽了。

一个有效的 PWM 外设能够占用最少的 CPU 资源和中断，但可以产生灵活配置的脉冲波形，并且可以方便被理解与使用。单周期的 PWM 波形很简单，主要就是控制脉冲的周期，脉冲的宽度，脉冲起落的时间，一个周期内的脉冲个数，F28377中每个 ePWM 模块由两路 ePWM 输出组成，分别为 ePWMxA 和 ePWMxB，这一对 PWM输出，可以配置成两路独立的单边沿 PWM 输出，或者两路独立的但互相相对称的双边沿 PWM 输出，或者一对双边沿非对称的 PWM 输出，共有12对这样的 ePWM。

段又可分为两大类：已初始化的段和未初始化的段。未初始化的段只是保留变量的地址空间，未初始化的段并不具有真实的内容，在程序运行过程中才向变量内写数据进去，存放于数据存储空间。1、MEMORY的page0为程序存储，其中为各个存储器映射的地址与空间大小，page1为数据存储，其中为各个存储器映射的地址与空间大小。为使用大寄存器模式时的全局变量和静态变量预留的空间，在程序上电时，cinit空间中的数据复制出来并存储在.ebss中，与.ebss不同的是.bss分配范围被限制在低64K 16位数据区。

CLA 是一款独立的 32 位浮点处理器，运行速度与主CPU 相同。该 CLA 对外设触发器作出响应，并与主 C28x CPU 同时执行代码。这种并行处理功能可以有效地将实时控制系统的计算性能提高一倍。通过利用 CLA 为时间关键型功能提供服务，主 C28x CPU 可以自由地执行其他任务，如通信和诊断。

DSP28377的定时器中断配置详情过程

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