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书签参考

1. spyglass CDC

2. 跨时钟域方法

3. 时钟（门控、分频等）

4. 中断异常

5. AXI总线协议

6. verilog中的循环语法

7. Linux, gvim, vivado, verdi等工具的使用

8. 约束

9. CPU/DSP cache相关

10. DC综合

11. 静态时序分析

12. 后仿、延迟反标

13. ECO

14. 内存顺序模型

15. ECC校验，通信接口协议

16. DFT相关

17. 异步FIFO

18. 低功耗

19. 乒乓操作与流水线

20. CXL协议

21. 码分多址CDMA

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Spyglass检查之CDC（1） - 灰信网（软件开发博客聚合）

IC君：IC面试中常被问到：跨时钟域信号处理——握手协议(handshake)

跨时钟域处理方法总结--最终详尽版 - love小酒窝 - 博客园

门控时钟-概述_进击的芯片的博客-CSDN博客_门控时钟

通常有两种不同的时钟门控实现技术-电子发烧友网

5.3 Verilog 时钟分频

SOC时钟--时钟的属性（时钟偏斜skew、时钟抖动jitter、时钟延迟Latency、时钟转换时间transition等）_摆渡沧桑的博客-CSDN博客_时钟transition

中断、异常、trap 的区别_bjzhaoxiao的博客-CSDN博客_芯片trap

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ARM 之FIQ(快速中断) IRQ（中断）【转】

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深入AXI4总线-[三]传输事务结构_空白MAX的博客-CSDN博客

AXI3和AXI4区别--端口篇_outlier001的博客-CSDN博客_axi4转axi3

AXI协议中的模棱两可的含义的解释_CrazyUncle的博客-CSDN博客_axi interleave

万物皆可卷积：（AXI使用学习）AXI Interconnect简明使用方法记录

且听老秦继续扒AXI（三）_传输

Verilog：generate、for、always 语句用法与电路结构对比

＜RTL coding的艺术＞verilog中for循环中循环变量int/genvar区别讲解

正则表达式 - 语法 | 菜鸟教程

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vi中如何在多行行首或行尾插入删除指定字符串_百度知道

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李锐博恩：TCL中关于Pins的一些使用方法？

关于set_output_delay与set_input_delay概念与用法 - 矮油~ - 博客园

深入讲解set_multicycle_path多周期约束---理论篇 - whoisliang的个人空间 - OSCHINA - 中文开源技术交流社区

https://www.intel.cn/content/www/cn/zh/docs/programmable/683068/18-1/timing-constraint-precedence.html

DSP 缓存机制_桑迪亚哥的博客-CSDN博客_cache dsp

Cache写机制 - huststephen - 博客园

cache 写回策略___DARK__的博客-CSDN博客_写回策略

Cache的基本原理以及简单操作_简单同学的博客-CSDN博客_cache操作

请教CPU的cache中关于line,block,index等的理解？

计组之存储系统：8、Cache写策略(全写法、写回法、写分配法、非写分配法、多级Cache)_千寻瀑༄的博客-CSDN博客_写分配法

关于DMA，TCM（ITCM和DTCM）和Cache_默默进步---一鸣惊人的博客-CSDN博客_dtcm itcm

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逻辑综合重点解析（Design Compiler篇）

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Design Compiler （八）--DC的逻辑综合与优化

DC、DCT与DCG

骑猪兜风：静态时序分析圣经翻译计划——汇总篇

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输入延时（Input Delay）与输出延时（Output Delay）

FPGA静态时序分析--IO口时序（Input Delay /output Delay）

西门电工：IMPL8. 常见的时序Special Check分析(false path/Max_Min Delay/Multicycle Path)

如何理解negative timing check

3.5 Verilog 延迟反标注

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龚黎明：IC科普文：ECO的那些事

linux内存管理 (二) 4.2 硬件 SMP-Consistency之内存顺序模型1

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DFT - 对芯片测试的理解（二） 详解

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乒乓操作（Ping-Pong）的理解：为什么是另一种pipeline？_weixin_43701504的博客-CSDN博客_乒乓操作

虫子君：FPGA 设计之 跨时钟域（七 - 弹性Buffer）

进步进步在进步：CXL 协议（1.1版本）学习笔记（一）

芯工阿文：CXL学习记录

CXL：为缓存一致性而生的新一代总线 - 墨天轮

码分多址(CDMA)的本质-正交之美_dog250的博客-CSDN博客_cdma