FPGA实现0.96 oled驱动

最新推荐文章于 2023-05-22 17:36:41 发布
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分类专栏： FPGA 文章标签： oled fpga
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版权 
module OledDriver 
( 
input [27:0]data,
input clk_in,  //clk_in = 25mhz
input rst_n_in,  //rst_n_in, active low
output reg run_flag,
output reg oled_rst_n_out,  //nokia5110 reset, active low
output reg oled_cs_n_out,  //nokia5110 chip select, active low
output reg oled_dc_out,  //nokia5110 data or command control
output oled_clk_out,  //nokia5110 clock
output reg oled_data_out  //nokia5110 data
);

parameter CLK_DIV_PERIOD=20; //related with clk_div's frequency
parameter DELAY_PERIOD=25000;  //related with delay time and refresh frequency

parameter CLK_L=2'd0;
parameter CLK_H=2'd1;
parameter CLK_RISING_DEGE=2'd2;
parameter CLK_FALLING_DEGE=2'd3;

parameter IDLE=3'd0;
parameter SHIFT=3'd1;
parameter CLEAR=3'd2;
parameter SETXY=3'd3;
parameter DISPLAY=3'd4;
parameter DELAY=3'd5;

parameter LOW =1'b0;
parameter HIGH =1'b1;
parameter CMD =1'b0;
parameter DATA =1'b1;

//assign oled_rst_n_out = 1;  //active low level, set 1 for normal
//assign oled_dc_out = 1;


//initial for memory register
reg [47:0] cmd_r [9:0];
initial
	begin
		cmd_r[0]= {8'hae, 8'h00, 8'h10, 8'h00, 8'hb0, 8'h81};   // command for initial
		cmd_r[1]= {8'hff, 8'ha1, 8'ha6, 8'ha8, 8'h1f, 8'hc8};   // command for initial
		cmd_r[2]= {8'hd3, 8'h00, 8'hd5, 8'h80, 8'hd9, 8'h1f};   // command for initial
		cmd_r[3]= {8'hda, 8'h00, 8'hdb, 8'h40, 8'h8d, 8'h14};   // command for initial
		cmd_r[4]= {8'haf, 8'he3, 8'he3, 8'he3, 8'he3, 8'he3};   // command for initial
		cmd_r[5]= {8'hb0, 8'h01, 8'h12, 8'hE3, 8'he3, 8'he3};   // command for set row1
		cmd_r[6]= {8'hb1, 8'h01, 8'h12, 8'hE3, 8'he3, 8'he3};   // command for set row2
		cmd_r[7]= {8'hb2, 8'h01, 8'h12, 8'hE3, 8'he3, 8'he3};   // command for set row3
		cmd_r[8]= {8'hb3, 8'h01, 8'h12, 8'hE3, 8'he3, 8'he3};   // command for set row4
		cmd_r[9]= {8'hb4, 8'h01, 8'h12, 8'hE3, 8'he3, 8'he3};   // command for set row1
		cmd_r[10]= {8'hb5, 8'h01, 8'h12, 8'hE3, 8'he3, 8'he3};   // command for set row2
		cmd_r[11]= {8'hb6, 8'h01, 8'h12, 8'hE3, 8'he3, 8'he3};   // command for set row3
		cmd_r[12]= {8'hb7, 8'h01, 8'h12, 8'hE3, 8'he3, 8'he3};   // command for set row4
	end

//initial for memory register
reg [63:0] mem [21:0];
reg [63:0] temp;
initial
	begin
		mem[0]= {8'h00, 8'h00, 8'h00, 8'h00, 8'h00, 8'h00, 8'h00, 8'h00};   // 0  sp 
		mem[1]= {8'h00, 8'h00, 8'h3E, 8'h51, 8'h49, 8'h45, 8'h3E, 8'h00};   // 16 0
		mem[2]= {8'h00, 8'h00, 8'h00, 8'h42, 8'h7F, 8'h40, 8'h00, 8'h00};   // 17 1
		mem[3]= {8'h00, 8'h00, 8'h42, 8'h61, 8'h51, 8'h49, 8'h46, 8'h00};   // 18 2
		mem[4]= {8'h00, 8'h00, 8'h21, 8'h41, 8'h45, 8'h4B, 8'h31, 8'h00};   // 19 3
		mem[5]= {8'h00, 8'h00, 8'h18, 8'h14, 8'h12, 8'h7F, 8'h10, 8'h00};   // 20 4
		mem[6]= {8'h00, 8'h00, 8'h27, 8'h45, 8'h45, 8'h45, 8'h39, 8'h00};   // 21 5
		mem[7]= {8'h00, 8'h00, 8'h3C, 8'h4A, 8'h49, 8'h49, 8'h30, 8'h00};   // 22 6
		mem[8]= {8'h00, 8'h00, 8'h01, 8'h71, 8'h09, 8'h05, 8'h03, 8'h00};   // 23 7
		mem[9]= {8'h00, 8'h00, 8'h36, 8'h49, 8'h49, 8'h49, 8'h36, 8'h00};   // 24 8
		mem[10]= {8'h00, 8'h00, 8'h06, 8'h49, 8'h49, 8'h29, 8'h1E, 8'h00};   // 25 9
		mem[11]= {8'h00, 8'h00, 8'h00, 8'h36, 8'h36, 8'h00, 8'h00, 8'h00};   // 26 :
		mem[12]= {8'h00, 8'h00, 8'h7C, 8'h12, 8'h11, 8'h12, 8'h7C, 8'h00};   // 33 A
		mem[13]= {8'h00, 8'h00, 8'h7F, 8'h49, 8'h49, 8'h49, 8'h36, 8'h00};   // 34 B
		mem[14]= {8'h00, 8'h00, 8'h7F, 8'h41, 8'h41, 8'h22, 8'h1C, 8'h00};   // 36 D
		mem[15]= {8'h00, 8'h00, 8'h7F, 8'h09, 8'h09, 8'h09, 8'h01, 8'h00};   // 38 F
		mem[16]= {8'h00, 8'h00, 8'h7F, 8'h08, 8'h14, 8'h22, 8'h41, 8'h00};   // 43 K
		mem[17]= {8'h00, 8'h00, 8'h7F, 8'h02, 8'h0C, 8'h02, 8'h7F, 8'h00};   // 45 M
		mem[18]= {8'h00, 8'h00, 8'h7F, 8'h09, 8'h09, 8'h09, 8'h06, 8'h00};   // 48 P
		mem[19]= {8'h00, 8'h00, 8'h46, 8'h49, 8'h49, 8'h49, 8'h31, 8'h00};   // 51 S
		mem[20]= {8'h00, 8'h00, 8'h01, 8'h01, 8'h7F, 8'h01, 8'h01, 8'h00};   // 52 T
		mem[21]= {8'h00, 8'h00, 8'h3F, 8'h40, 8'h38, 8'h40, 8'h3F, 8'h00};   // 55 W
	end
	
//clk_div = clk_in/CLK_DIV_PERIOD, 50% is high voltage



reg clk_div; 
reg[15:0] clk_cnt=0;
always@(posedge clk_in or negedge rst_n_in)
begin
	if(!rst_n_in) clk_cnt<=0;
	else begin
		clk_cnt<=clk_cnt+1;  
		if(clk_cnt==(CLK_DIV_PERIOD-1)) clk_cnt<=0;
		if(clk_cnt<(CLK_DIV_PERIOD/2)) clk_div<=0;
		else clk_div<=1;
	end
end

//divide clk_div 4 state, RISING and FALLING state is keeped one cycle of clk_in, like a pulse.
reg[1:0] clk_div_state=CLK_L;  
always@(posedge clk_in or negedge rst_n_in)
begin
	if(!rst_n_in) clk_div_state<=CLK_L;
    else 
		case(clk_div_state)
			CLK_L: begin
					if (clk_div) clk_div_state<=CLK_RISING_DEGE;  
					else clk_div_state<=CLK_L;
				end
			CLK_RISING_DEGE :clk_div_state<=CLK_H;  
			CLK_H:begin                 
					if (!clk_div) clk_div_state<=CLK_FALLING_DEGE;
					else clk_div_state<=CLK_H;
				end 
			CLK_FALLING_DEGE:clk_div_state<=CLK_L;  
			default;
		endcase
end

reg shift_flag = 0;
reg[6:0] x_reg;
reg[2:0] y_reg;   
reg[7:0] char_reg;
reg[8:0] temp_cnt;
reg[7:0] data_reg; 
reg[2:0] data_state=IDLE; 
reg[2:0] data_state_back; 
reg[7:0] data_state_cnt=0;  
reg[3:0] shift_cnt=0; 
reg[25:0] delay_cnt=0;  
//Finite State Machine, 
always@(posedge clk_in or negedge rst_n_in)      
begin
	if(!rst_n_in) 
		begin 
			data_state<=IDLE;
			run_flag <= 1;
			data_state_cnt<=0;
			shift_flag <= 0;
			oled_cs_n_out<=HIGH;
		end
    else begin
		case (data_state)
			IDLE: begin
					oled_cs_n_out<=HIGH;
					data_state_cnt<=data_state_cnt+1;
					case(data_state_cnt)
						0: oled_rst_n_out <= 0;
						1: data_state<=DELAY;
						2: oled_rst_n_out <= 1;
						3: data_state<=DELAY;
						//display initial
						4: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=0; end
						5: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=1; end
						6: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=2; end
						7: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=3; end
						8: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=4; end
						//clear display
						9: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=5; end
						10: begin data_state<=CLEAR;data_state_back<=CLEAR; end
						11: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=6; end
						12: begin data_state<=CLEAR;data_state_back<=CLEAR; end
						13: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=7; end
						14: begin data_state<=CLEAR;data_state_back<=CLEAR; end
						15: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=8; end
						16: begin data_state<=CLEAR;data_state_back<=CLEAR; end
						17: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=9; end
						18: begin data_state<=CLEAR;data_state_back<=CLEAR; end
						19: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=10; end
						20: begin data_state<=CLEAR;data_state_back<=CLEAR; end
						21: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=11; end
						22: begin data_state<=CLEAR;data_state_back<=CLEAR; end
						23: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=12; end
						24: begin data_state<=CLEAR;data_state_back<=CLEAR; end
						//set start point
						25: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=5; end
						//wite the word
						26: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=21; end
						27: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=11; end
						 28: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;
								if(data[9:8]==2'b00) char_reg <= 19; //正弦波
								else if(data[9:8]==2'b01) char_reg <= 20;//三角波
								else if(data[9:8]==2'b11) char_reg <= 15;//方波
								else if(data[9:8]==2'b10) char_reg<=14;//锯齿波
							  end  //波形选择
						29: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=0; end
						30: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=0; end
						31: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=0; end//空格
						32: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=15; end
						33: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=11; end
						34: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;
								
								  char_reg <= data[27:24]+1;
							 end
						35: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;
								
							       char_reg <= data[23:20]+1;							
							 end
						36: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;
								 char_reg <= data[19:16]+ 1;
								
								data_state_cnt <= data_state_cnt + 1;
							 end                                        //频率数值显示
						37: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;
								if(data[7:6]==2'b10) char_reg <= 17;
								else if(data[7:6]==2'b01)  char_reg <= 16;
                                else  char_reg<=0;//频率单位显示
							end
							
						//set start point
						38: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=6; end
						//wite the word
						39: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;if(data[9:8]==2'b11)char_reg<=14;else char_reg<=0; end
						40: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;if(data[9:8]==2'b11)char_reg<=11; else char_reg<=0;end
						41: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;if(data[9:8]==2'b11)char_reg<=data[13:10]+1; else char_reg<=0;end
						42: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;if(data[9:8]==2'b11)char_reg<=1;else char_reg<=0; end
						43: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=0; end
						44: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=0; end //方波占空比

						45: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=18; end 
						46: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=11; end 
						47: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;
							      case(data[15:14])
									  2'b00: char_reg<=0; 
									  2'b01:char_reg<=1;
								      2'b10:char_reg<=2;
                                      2'b11:char_reg<=3;
                                   endcase									  
									  end 
						48: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;
							        case(data[15:14])
									  2'b00: char_reg<=0; 
									  2'b01:char_reg<=10;
								      2'b10:char_reg<=9;
                                      2'b11:char_reg<=8;
                                    endcase
                                       end 
						49: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=1; end  //相位控制
						//set start point
						50: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=CMD;char_reg<=7; end
						//wite the word	
						51: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=12; end 
						52: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=11; end 
						53: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=0; end 
						54: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=data[5:3]+1; end //增益
						55: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=0; end 
						56: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=0; end 
						57: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=13; end 
						58: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=11; end 
						59: begin data_state<=DISPLAY;data_state_back<=DISPLAY;oled_dc_out<=DATA;char_reg<=data[2:0]+1; end //直流偏置
							
						
						60: begin data_state_cnt<=17;run_flag <= ~run_flag; end
						default;
					endcase
				end
				
			SHIFT: begin
					if(!shift_flag)
						begin
							if (clk_div_state==CLK_FALLING_DEGE)  
								begin
									if (shift_cnt==8)  
										begin
											shift_cnt<=0;
											data_state<=data_state_back;
										end
									else begin
											oled_cs_n_out<=LOW;
											oled_data_out<=data_reg[7];   
											shift_flag <= 1;
										end
								end
						end
					else
						begin
							if (clk_div_state==CLK_RISING_DEGE)   
								begin  
									data_reg<={data_reg[6:0], data_reg[7]};  
									shift_cnt<=shift_cnt+1;
									shift_flag <= 0;
								end
						end
				end

			DISPLAY: begin
						temp_cnt<=temp_cnt+1;
						oled_cs_n_out<=HIGH;
						if (temp_cnt==6) 
							begin
								data_state<=IDLE;
								temp_cnt<=0; 
							end
						else 
							begin
								temp = (oled_dc_out==CMD)? cmd_r[char_reg]:mem[char_reg];
								case (temp_cnt)
									0 :  data_reg<=temp[47:40];
									1 :  data_reg<=temp[39:32];
									2 :  data_reg<=temp[31:24];
									3 :  data_reg<=temp[23:16];
									4 :  data_reg<=temp[15:8];
									5 :  data_reg<=temp[7:0];
									default;
								endcase
								data_state<=SHIFT;
							end
					end
			
			CLEAR: begin            
					data_reg<=8'h00;
					temp_cnt<=temp_cnt+1;
					oled_cs_n_out<=HIGH;
					oled_dc_out<=DATA;
					if (temp_cnt>=128) 
						begin
							temp_cnt<=0;
							data_state<=IDLE;
						end
					else data_state<=SHIFT;
				end
			
			DELAY: begin
					if(delay_cnt==DELAY_PERIOD)
						begin
							data_state<=IDLE; 
							delay_cnt<=0;
						end
					else delay_cnt<=delay_cnt+1;
				end
					   
			default;
		endcase
	end
end
assign oled_clk_out = oled_cs_n_out?0:clk_div;
endmodule

 

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专栏目录
FPGA驱动OLED动态显示（Verilog代码）,源工程
10-22
1、采用altera的芯片，使用7针4线SPI接口OLED模块，利用纯Verilog语言控制OLED实现实时动态数据显示。根据工程中的引脚约束正确连接好接线，可以直接使用工程。 2、开发平台是友晶的DEO-nano板，软件版本：quartusII 13.0 SPI Web Edition， FPGA芯片型号：EP4CE22F17C6N
FPGA驱动OLED
12-15
最近比较火的OLED，以其更加出众的色彩效果和低功耗特色深受广大用户喜欢，买了一块128*32的OLED显示屏，网上查阅资料全部都是使用单片机驱动，找不到FPGA驱动OLED的资料，就自己动手写了一个，给大家分享下。
FPGA之旅设计99例之第九例-----驱动0.96寸OLED屏
weixin_44678052的博客
09-03 2521
这是FPGA之旅设计的第九例啦！！！本例将介绍如何使用FPGA驱动OLED屏幕，并在接下来的几例中，配合其它模块，进行一些有趣的综合实验。由于使用的OLED屏是IIC接口的，对IIC接口不是很清楚的，可以参考第五例的设计，同时使用第五例写好的IIC模块，驱动OLED屏。这里就只介绍最常用的0.96寸屏，其它的一样。OLED共支持8080并口、SPI和IIC三种接口，同样也只介绍IIC接口的用法。0.96寸OLED屏幕的分辨率为128×64，内部有一块GRAM用来存储显示的数据。
FPGA驱动OLED动态显示（Verilog代码）——向OLED写数据（关键）——Part5
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1、代码太长贴到了‘代码笔记’里，链接：向OLED写数据write_data.v 2、部分释义： 2.1、 reg [27:0] cnt; reg [15:0] num; always @(posedge clk_1m or negedge rst_n) begin if(!rst_n) begin cnt num end else if(cnt == 28'h4C
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weixin_42224577的博客
05-22 3685
本文采用的是4针的0.96寸OLED显示进行讲解，采用的是SPI协议，速度会比采用I2C协议的更快，但这两者的显示驱动都一样，本质上没有太大差别。屏幕整体分辨率为128*64，有黄蓝、白、蓝三种颜色可选，驱动芯片为SSD13060.96寸OLED（SSD1306）屏幕显示（一）——基础功能介绍。
3行代码实现单片机的PWM功能
用 Lua 语言开发物联网 IoT 硬件
11-20 1205
前言 shineblink core 开发板（简称Core）的库函数支持PWM通信功能，所以只需要调用两三个API，即可实现PWM功能。 PS：Core 仅用五、六行代码即可实现Wifi/Ble/NB/Lora/ThreadMesh/RFID/Eth/Usb/RS485/RS232通信、以及30多种传感器/10多种硬件外设/10多种Mcu内设功能，并且这些功能最多可以 5 种随机组合同时运行。更多关于Core的内容可以在 shineblink.com 上了解。 一、实现功能 Core提供的PWM提供两
0.96寸OLED屏幕verilog驱动代码FPGA硬件驱动开发
Wuyo_7的博客
07-12 2932
之前毕业设计写过的用在FPGA上的0.96寸OLED屏幕verilog驱动代码，有什么问题欢迎留言。 // ******************************************************************** // >>>>>>>>>>>>>>>>>>>>>>>>> COPYRIGHT NOTICE <<<
FPGA控制OLED显示屏
06-20
FPGA控制OLED液晶显示，实际上板子测试好用，开发平台quarterII13.0，硬件平台为EP4CE6E22C8。
基于FPGA的OLED真彩色显示设计方案
01-19
摘要利用FPGA 控制模块，设计了OLED 真彩色动态图像驱动控制电路。介绍采用FPGA 实现OLED 外围控制电路和256 级灰度的方法，并分析电路中模块的作用及整个电路的工作过程。电路系统采用基于Altera 公司的FPGA技术进行设计，以Verilog HDL 为描述语言，Modelsim 仿真结果表明，该方案能够实现预定目标，实现480 × RGB ×640 彩色OLED 屏256 级灰度显示。 　　作为第3 代显示器，有机电致发光器件（ OrganicLight Emitting Diode,OLED） 由于其主动发光、响应快、高亮度、全视角、直流低压驱动、全固态以及不易受环境影响
FPGA：0.96寸oled字符显示（可直接运行）
04-22
工程是用国产京微齐力的HMEP1P060板子做的，可以做移植，只需要在quartus或者vivdo建立工程，把代码放进去综合即可。（除了源码工程，还有字符提取软件） 工程讲解：https://blog.csdn.net/weixin_46423500/article/details/124349430 FPGA模块： 顶层模块：JWQL_oled_v2_top 屏幕清除模块：Oled_Clear IIC驱动模块：I2C_Master 屏幕全亮模块：Oled_On 显示控制模块：Oled_Show_control 信息缓存区模块：font_data
0.96寸OLED显示屏IIC驱动程序（IIC.c/IIC.h/IIC-font.h）+Pctolcd2002
05-30
内含IIC驱动程序、温湿度数据显示示例程序、Pctolcd2002取模工具
贪吃蛇，DE2-115，FPGA，0.96OLED
04-09
这个作业没花多长时间，把每个格子看作状态机，所以代码比较冗长，一开始就是抱着试一试的态度，最后马马虎虎能用了 https://www.bilibili.com/video/BV1hF411i7LY?spm_id_from=333.999.0.0
基于FPGA的OLED液晶显示
05-09
本资源提供OLED液晶显示驱动FPGA解决方案，利用Verilog HDL硬件描述语言实现OLED SPI驱动数字电路。
FPGA实现AD9850驱动
最新发布
03-15
FPGA实现AD9850驱动
FPGA驱动Oled--IIC
weixin_44678052的博客
02-06 1584
ps: 前几天写了oled的IIC驱动，仿真时序没有什么问题，但就不知道为什么驱动不了，无奈只要在网上下载了iic的驱动。 先看看效果 OLED初始化 同样也是通过阅读c语言代码，确定初始化流程，以及初始化所需要的数据。 可以清楚的知道将一下数据通过iic依次写入即可 OLED全亮 通过C语言可以知道，只需要将8个page里面的数字全部写入1即可 OLED全暗 通过C语言可以知道，只需要将8个page里面的数字全部写入0即可 原理什么的就不过多讲了，具体的寄存器有什么作用，具体需要用到的时
fpga驱动oled iic显示代码_苏企成功研发世界上最小OLED显示屏驱动芯片
weixin_39831170的博客
11-02 138
来源：苏州新闻 【时政专稿 文/《苏州新闻》陈一玮 金学东】日前，苏州一家企业成功研发出世界上最小的OLED显示屏驱动芯片。记者手中的这款看起来非常小的芯片，就是昇显微电子最新研发的OLED显示屏驱动芯片，它也是目前世界上同类型的芯片中尺寸最小的一款。走进公司实验室，在各色线路中间，记者看到了他们自主研发的芯片驱动的显示屏。只见显示屏上的蓝天、大象、彩色凳子栩栩如生，色彩饱和度非常高。苏...
FPGA驱动OLED动态显示（Verilog代码）——OLED初始化——Part4
王纯配的博客
10-23 3799
/*--------------------------------------------------------------*\ Filename : initial_control.v Author : Cwang Description : Revision History : 2017-10-16 Revision 1.0 Email : wangcp@hi
FPGA驱动OLED动态显示（Verilog代码）——工程文件之间关系——Part2
王纯配的博客
10-23 2766
源代码：https://blog.csdn.net/aqwtyyh/article/details/97250142
fpga实现spi驱动oled屏 Verilog
05-25
以下是一个简单的Verilog代码，用于在FPGA上实现SPI驱动OLED屏幕： ```verilog module spi_oled( input wire clk, //时钟信号 input wire rst, //复位信号 output wire cs, //片选信号 output wire dc, //数据/命令选择信号 output wire sda, //数据信号 output wire sck //时钟信号 ); //定义寄存器 reg [7:0] command_reg; reg [7:0] data_reg; //状态机 reg [2:0] state; parameter [2:0] IDLE = 3'b000; parameter [2:0] COMMAND = 3'b001; parameter [2:0] DATA = 3'b010; //时钟分频计数器 reg [7:0] cnt; parameter [7:0] CLK_DIV = 8'hFF; //时钟分频器 parameter [7:0] CMD_DELAY = 8'h0F; //命令延迟 parameter [7:0] DATA_DELAY = 8'h0F; //数据延迟 //初始化状态和计数器 initial begin state = IDLE; cnt = 0; end //状态机逻辑 always @(posedge clk) begin if (rst) begin state <= IDLE; cnt <= 0; end else begin case (state) IDLE: begin cs <= 1'b1; dc <= 1'b0; sda <= 1'b1; sck <= 1'b1; if (cnt == CLK_DIV) begin //进入命令状态 state <= COMMAND; cnt <= 0; end else begin cnt <= cnt + 1; end end COMMAND: begin cs <= 1'b0; dc <= 1'b0; sda <= command_reg[7]; command_reg <= {command_reg[6:0], 1'b0}; sck <= 1'b0; if (cnt == CMD_DELAY) begin //进入数据状态 state <= DATA; cnt <= 0; end else begin cnt <= cnt + 1; end end DATA: begin cs <= 1'b0; dc <= 1'b1; sda <= data_reg[7]; data_reg <= {data_reg[6:0], 1'b0}; sck <= 1'b0; if (cnt == DATA_DELAY) begin //返回空闲状态 state <= IDLE; cnt <= 0; end else begin cnt <= cnt + 1; end end endcase end end endmodule ``` 这个代码中的状态机逻辑控制SPI通信以向OLED屏幕发送命令和数据。您需要根据OLED屏幕的规格和数据手册定制代码，以确保正确配置SPI通信和正确发送命令和数据。

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