Makefile将某一部分文件不编译

重构过程中,先重构部分代码,所以需要不编译某些文集

然后使用Makefile的$(filter-out)不编译一部分代码,但是发现并没有剔除

##modules sdk
SDKFILES += $(wildcard IDMSdk/*.cc)
CXXSRCS += $(filter-out IDMSdk/idm_uwb*.cc, $(SDKFILES))

经分析,有可能是需要在$(filter-out)后的所有剔除的文件都需要空格,上面的匹配可能无法作为一个空格隔开的列表呈现(表达不是很好),所以用$(wildcard)先给过滤出来,再剔除

Makefile
##modules sdk
SDKFILES += $(wildcard IDMSdk/*.cc)
FILTEROUT += $(wildcard IDMSdk/idm_uwb*.cc)
CXXSRCS += $(filter-out $(FILTEROUT), $(SDKFILES))

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本程序的Makefile分为3类: 1. 顶层目录Makefile 2. 顶层目录Makefile.build 3. 各级子目录Makefile 一、各级子目录Makefile: 它最简单,形式如下: EXTRA_CFLAGS := CFLAGS_file.o := obj-y += file.o obj-y += subdir/ "obj-y += file.o" 表示把当前目录下的file.c编进程序里, "obj-y += subdir/" 表示要进入subdir这个子目录下去寻找文件来编进程序里,是哪些文件由subdir目录下的Makefile决定。 "EXTRA_CFLAGS", 它给当前目录下的所有文件(不含其下的子目录)设置额外的编译选项, 可以不设置 "CFLAGS_xxx.o", 它给当前目录下的xxx.c设置它自己的编译选项, 可以不设置 注意: 1. "subdir/"中的斜杠"/"不可省略 2. 顶层Makefile中的CFLAGS在编译任意一个.c文件时都会使用 3. CFLAGS EXTRA_CFLAGS CFLAGS_xxx.o 三者组成xxx.c的编译选项 二、顶层目录Makefile: 它除了定义obj-y来指定根目录下要编进程序去的文件、子目录外, 主要是定义工具链前缀CROSS_COMPILE, 定义编译参数CFLAGS, 定义链接参数LDFLAGS, 这些参数就是文件中用export导出的各变量。 三、顶层目录Makefile.build: 这是最复杂的部分,它的功能就是把某个目录及它的所有子目录中、需要编进程序去的文件编译出来,打包为built-in.o 详细的讲解请看视频。 四、怎么使用这套Makefile: 1.把顶层Makefile, Makefile.build放入程序的顶层目录 在各自子目录创建一个空白的Makefile 2.确定编译哪些源文件 修改顶层目录和各自子目录Makefile的obj-y : obj-y += xxx.o obj-y += yyy/ 这表示要编译当前目录下的xxx.c, 要编译当前目录下的yyy子目录 3. 确定编译选项、链接选项 修改顶层目录Makefile的CFLAGS,这是编译所有.c文件时都要用的编译选项; 修改顶层目录Makefile的LDFLAGS,这是链接最后的应用程序时的链接选项; 修改各自子目录下的Makefile: "EXTRA_CFLAGS", 它给当前目录下的所有文件(不含其下的子目录)设置额外的编译选项, 可以不设置 "CFLAGS_xxx.o", 它给当前目录下的xxx.c设置它自己的编译选项, 可以不设置 4. 使用哪个编译器? 修改顶层目录Makefile的CROSS_COMPILE, 用来指定工具链的前缀(比如arm-linux-) 5. 确定应用程序的名字: 修改顶层目录Makefile的TARGET, 这是用来指定编译出来的程序的名字 6. 执行"make"来编译,执行"make clean"来清除,执行"make distclean"来彻底清除
文件编译是指将一个大的程序分成多个小的模块,每个模块独立完成一部分功能,然后再将它们合并起来。在 C++ 中,每个模块通常对应一个 .cpp 文件,其中包含了该模块的实现代码,以及一个 .h 文件,其中包含了该模块的声明和定义。 makefile 是一种用来自动化编译程序的工具,可以根据源代码的依赖关系,自动地编译出可执行程序。下面是一个简单的 makefile 示例,假设我们有两个源代码文件 main.cpp 和 func.cpp,分别对应主函数和某个函数的实现。 ```makefile CC = g++ CFLAGS = -Wall -g OBJS = main.o func.o all: program program: $(OBJS) $(CC) $(CFLAGS) -o program $(OBJS) main.o: main.cpp func.h $(CC) $(CFLAGS) -c main.cpp func.o: func.cpp func.h $(CC) $(CFLAGS) -c func.cpp clean: rm -f program *.o ``` 上面的 makefile 分为三个部分: - 变量定义:定义了编译器和编译选项,以及目标文件的名字。 - 目标声明:声明了要生成的目标文件 program,以及它依赖的源代码文件。 - 规则定义:定义了每个源代码文件编译规则,以及如何生成目标文件。 其中,变量定义部分可以根据实际情况进行修改。目标声明部分需要根据实际的源代码文件进行修改。规则定义部分则是最关键的部分,它定义了如何将源代码文件编译成目标文件,以及如何将多个目标文件链接成可执行程序。 在上面的示例中,我们使用了变量 $(CC) 和 $(CFLAGS),它们分别表示编译器和编译选项。变量 $(OBJS) 则表示所有的目标文件,即 main.o 和 func.o。目标声明部分定义了一个名为 program 的目标文件,它依赖于 main.o 和 func.o 两个源代码文件。规则定义部分则使用了两个模式规则,分别定义了如何将 main.cpp 和 func.cpp 编译成目标文件。 最后,在命令行中执行 make 命令即可自动编译生成可执行程序。如果需要清除生成的文件,可以执行 make clean 命令。

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