chapter1--Verilog HDL之第一天---二选一选择器

本文介绍了使用Verilog HDL设计2选1复用器的过程,包括新建工程、编写代码、编译及分配引脚。在DE2-115开发板上,通过设置不同输入和输出引脚实现代码烧录。文章详细阐述了JTAG和AS模式的程序下载方法,以及如何在FPGA断电后保持代码。在AS模式下,需要使用.pof文件并通过EPCS64配置芯片进行烧录,而JTAG模式则需要转换为.jic文件进行烧录。
摘要由CSDN通过智能技术生成

DE2-115,芯片:Cyclone IV EP4CE115F29C7(主芯片)

1 新建工程导向文件 

new-new project wizard 



创建工程后,创建Verilog源文件,命名与等层文件名相同,并存于scr源文件文件夹中

写入代码

//*******************************FILE HEAD**************************************

//**

评论
添加红包

请填写红包祝福语或标题

红包个数最小为10个

红包金额最低5元

当前余额3.43前往充值 >
需支付:10.00
成就一亿技术人!
领取后你会自动成为博主和红包主的粉丝 规则
hope_wisdom
发出的红包
实付
使用余额支付
点击重新获取
扫码支付
钱包余额 0

抵扣说明:

1.余额是钱包充值的虚拟货币,按照1:1的比例进行支付金额的抵扣。
2.余额无法直接购买下载,可以购买VIP、付费专栏及课程。

余额充值