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原创 解决问题:Jupyter中无法导入scikit-learn

解决Jupyter中无法导入scikit-learn的问题

2024-03-06 14:22:10 709

原创 【Chisel硬件源源语】

通过之前的学习,读者应当已经掌握Chisel的基本数据类型和操作符的知识,并且了解如何构建小型电路。而在实际大型电路工程中,常用的硬件模块无需重复编写,Chisel提供了丰富的硬件原语,帮助工程师构建大型电路工程。更多内容可以查看Chisel其他官方资料以扩展学习。

2023-06-12 10:01:13 895

原创 【Chisel模块设计相关】

本章将继续讲解Chisel硬件设计内容,前期已经讲解了Chisel的基本语言和数据类型,以及操作符号,对基本知识不了解的读者可以查看前序文章。本章讲述Chisel定义模块相关内容。

2023-06-06 13:38:47 492 1

原创 【Chisel入门——数据类型与操作符号】

前面的部分简单介绍了Chisel——新型敏捷硬件开发语言,也简单说明了开发环境部署以及示例项目的运行。接下来学习Chisel入门,数据类型与操作符号。对于操作系统要求较低,IDEA适用于多个平台,但在验证阶段会根据不同的操作系统适配不同的EDA工具。操作系统:Linux、mac OS、Windows 10开发工具:IDEA、CLion、Verilator、GTKWave。

2023-06-01 13:59:56 603

原创 【新型敏捷硬件开发语言——Chisel】

初步学习Scala与Chisel,了解HDL发展历史,同时也熟悉了项目的部署过程。

2023-05-25 12:55:47 1407 2

原创 【计算机硬件系统设计(华科)——现代时序 CPU(Logisim 实现)】

本章为《计算机硬件系统设计》的最后部分——现代时序CPU的设计与实现。

2022-12-25 19:07:03 2554

原创 【计算机硬件系统设计(华科)——三级时序 CPU「包含中断处理」(Logisim 实现)】

华中科技大学-计算机硬件系统设计-三级时序CPU-中断处理机制

2022-06-04 12:38:47 4430

原创 【计算机硬件系统设计(华科)——单周期MIPS CPU(Logisim 实现)】

本章继续讲述计算机硬件系统设计的内容,之前已经大概说明了 ALU 和存储系统的设计,本文讲述CPU的设计。对应的有单周期、多周期 CPU 设计,以及流水线设计,中断处理会在后文中详细说明,本文不进行讲述。

2022-04-12 22:23:37 19628 5

原创 【计算机硬件系统设计(华科)——存储器设计(Logisim 实现)】

本章将继续介绍《计算机硬件系统设计》的关于存储器设计的内容。内容不尽完善,如有疑问欢迎评论留言,共同探讨学习。

2022-04-07 18:33:53 25955 3

原创 【计算机硬件系统设计(华科)——运算器设计(Logisim 实现)】

计算机硬件系统设计(华科)——运算器设计(Logisim实现)运算器的设计与实现。主要介绍运算器功能的设计与实现过程,结合实验设计思路讲解设计细想。

2022-03-06 12:24:38 11325

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