SPI--原理

挽天技术

于 2024-09-17 12:42:32 发布

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分类专栏： STM32单片机文章标签：单片机

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SPI–原理

前言:

若对 SPI 通讯协议不了解，可先阅读《SPI 总线协议介绍》文档的内容学习。

关于 FLASH 存储器，请参考“常用存储器介绍”章节，实验中 FLASH 芯片的具体参数，请参考
其规格书《W25Q64》来了解。

大纲

SPI协议
STM32 的 SPI 特性及架构
通讯过程
SPI 初始化结构体详解

具体案例

SPI协议

物理层

我们主要使用这个来进行高速通讯，下面从物理层和协议层来进行介绍
在这里插入图片描述
SPI 通讯使用 3 条总线及片选线，3 条总线分别为 SCK、MOSI、MISO，片选线为 SS，它们的作
用介绍如下：

) SS ( Slave Select)：从设备选择信号线，常称为片选信号线，也称为 NSS、CS，以下用 NSS 表示。当有多个 SPI 从设备与 SPI 主机相连时，设备的三条总线 SCK、MOSI 及 MISO 同时并联到相同的 SPI 总线上，即所有设备都共用这 3 条总线；而每个从设备都有独立的这一条 NSS 信号线，本信号线独占主机的一个引脚，即有多少个从设备，就有多少条片选信号线。I2C 协议中通过设备地址来寻址、选中总线上的某个设备并与其进行通讯；而 SPI 协议中没有设备地址，它使用 NSS 信号线来寻址，当主机要选择从设备时，把该从设备的 NSS 信号线设置为低电平，该从设备即被选中，即片选有效，接着主机开始与被选中的从设备进行 SPI 通讯。所以 SPI 通讯以 NSS 线置低电平为开始信号，以 NSS 线被拉高作为结束信号，如上图所示
SCK (Serial Clock)：时钟信号线，用于通讯数据同步。它由通讯主机产生，决定了通讯的速率，
不同的设备支持的最高时钟频率不一样，如 STM32 的 SPI 时钟频率最大为 fpclk/2，两个设备之间
通讯时，通讯速率受限于低速设备
MOSI (Master Output，Slave Input)：主设备输出/从设备输入引脚。主机的数据从这条信号线输
出，从机由这条信号线读入主机发送的数据，即这条线上数据的方向为主机到从机
MISO (Master Input,，Slave Output)：主设备输入/从设备输出引脚。主机从这条信号线读入数
据，从机的数据由这条信号线输出到主机，即在这条线上数据的方向为从机到主机

协议层

SPI 协议定义了通讯的起始和停止信号、数据有效性、时钟同步等环节
在这里插入图片描述这是一个主机的通讯时序。NSS、SCK、MOSI 信号都由主机控制产生，而 MISO 的信号由从机产生，主机通过该信号线读取从机的数据。MOSI 与 MISO 的信号只在 NSS 为低电平的时候才有效，在 SCK 的每个时钟周期 MOSI 和 MISO 传输一位数据。
以上通讯流程中包含的各个信号分解如下：

通讯的起始和停止信号

在图 SPI 通讯时序中的标号处(上图1,6标号)，NSS 信号线由高变低，是 SPI 通讯的起始信号。NSS 是每个从机各自独占的信号线，当从机在自己的 NSS 线检测到起始信号后，就知道自己被主机选中了，开始准备与主机通讯。在图中的标号处，NSS 信号由低变高，是 SPI 通讯的停止信号，表示本次通讯结束，从机的选中状态被取消

数据有效性

SPI 使用 MOSI 及 MISO 信号线来传输数据，使用 SCK 信号线进行数据同步。MOSI 及 MISO 数据线在 SCK 的每个时钟周期传输一位数据，且数据输入输出是同时进行的。数据传输时，MSB先行或 LSB 先行并没有作硬性规定，但要保证两个 SPI 通讯设备之间使用同样的协定，一般都会采用图 SPI 通讯时序中的 MSB 先行模式

观察图中的标号处，MOSI 及 MISO 的数据在 SCK 的上升沿期间变化输出，在 SCK 的下降沿时被采样。即在 SCK 的下降沿时刻，MOSI 及 MISO 的数据有效，高电平时表示数据“1”，为低电平时表示数据“0”。在其它时刻，数据无效，MOSI 及 MISO 为下一次表示数据做准备

SPI 每次数据传输可以 8 位或 16 位为单位，每次传输的单位数不受限制

CPOL/CPHA 及通讯模式

上图的采样和触发的时序只是 SPI 中的其中一种通讯模式，SPI 一共有四种通讯模式，它们的主要区别是总线空闲时 SCK 的时钟状态以及数据采样时刻。为方便说明，在此引入“时钟极性 CPOL”和“时钟相位 CPHA”的概念，

时钟极性 CPOL 是指 SPI 通讯设备处于空闲状态时，SCK 信号线的电平信号 (即 SPI 通讯开始前、NSS 线为高电平时 SCK 的状态)。CPOL=0 时，SCK 在空闲状态时为低电平，CPOL=1 时，则相反

时钟相位 CPHA 是指数据的采样的时刻，当 CPHA=0 时，MOSI 或 MISO 数据线上的信号将会在
SCK 时钟线的“奇数边沿”被采样。当 CPHA=1 时，数据线在 SCK 的“偶数边沿”采样

下面是四种模式的流程图
分别对应在不同的时钟极性和时钟相位
在这里插入图片描述

下面是四种模式对应的图，我们平常主要使用模式0和模式3

在这里插入图片描述

STM32 的 SPI 特性及架构

框架

在这里插入图片描述

通讯引脚

SPI 的所有硬件架构都从图 SPI 架构图中左侧 MOSI、MISO、SCK 及 NSS 线展开的。STM32 芯片有多个 SPI 外设，它们的 SPI 通讯信号引出到不同的 GPIO 引脚上，使用时必须配置到这些指定的引脚，见表 STM32F10x 的 SPI 引脚。关于 GPIO 引脚的复用功能，可查阅《STM32F10x 规格书》，以它为准

中 SPI1 是 APB2 上的设备，最高通信速率达 36Mbtis/s，SPI2、SPI3 是 APB1 上的设备，最高通信速率为 18Mbits/s。除了通讯速率，在其它功能上没有差异。其中 SPI3 用到了下载接口的引脚，这几个引脚默认功能是下载，第二功能才是 IO 口，如果想使用 SPI3 接口，则程序上必须先禁用掉这几个 IO 口的下载功能。一般在资源不是十分紧张的情况下，这几个 IO 口是专门用于下载和调试程序，不会复用为 SPI3

时钟控制逻辑

SCK 线的时钟信号，由波特率发生器根据“控制寄存器 CR1”中的 BR[0:2] 位控制，该位是对 fpclk时钟的分频因子，对 fpclk 的分频结果就是 SCK 引脚的输出时钟频率，计算方法见表 BR 位对 fpclk的分频

在这里插入图片描述
其中的 fpclk 频率是指 SPI 所在的 APB 总线频率，APB1 为 fpclk1，APB2 为 fpckl2

下面是对应的寄存器
在这里插入图片描述
控制波特率和时钟极性和时钟相位和主从机

数据控制逻辑

SPI 的 MOSI 及 MISO 都连接到数据移位寄存器上，数据移位寄存器的数据来源及目标接收、发送缓冲区以及 MISO、MOSI 线。当向外发送数据的时候，数据移位寄存器以“发送缓冲区”为数据源，把数据一位一位地通过数据线发送出去；当从外部接收数据的时候，数据移位寄存器把数据线采样到的数据一位一位地存储到“接收缓冲区”中。通过写 SPI 的“数据寄存器 DR”把数据填充到发送缓冲区中，通讯读“数据寄存器 DR”，可以获取接收缓冲区中的内容。其中数据帧长度可以通过“控制寄存器 CR1”的“DFF 位”配置成 8 位及 16 位模式；配置“LSBFIRST 位”可选择 MSB 先行还是 LSB 先行
在这里插入图片描述

整体控制逻辑

整体控制逻辑负责协调整个 SPI 外设，控制逻辑的工作模式根据我们配置的“控制寄存器(CR1/CR2)”的参数而改变，基本的控制参数包括前面提到的 SPI 模式、波特率、LSB 先行、主从模式、单双向模式等等。在外设工作时，控制逻辑会根据外设的工作状态修改“状态寄存器(SR)”，我们只要读取状态寄存器相关的寄存器位，就可以了解 SPI 的工作状态了。除此之外，控制逻辑还根据要求，负责控制产生 SPI 中断信号、DMA 请求及控制 NSS 信号线

通讯过程

在这里插入图片描述
主模式收发流程及事件说明如下：
(1) 控制 NSS 信号线，产生起始信号 (图中没有画出)；

(2) 把要发送的数据写入到“数据寄存器 DR”中，该数据会被存储到发送缓冲区；

(3) 通讯开始，SCK 时钟开始运行。MOSI 把发送缓冲区中的数据一位一位地传输出去；MISO 则把数据一位一位地存储进接收缓冲区中；

(4) 当发送完一帧数据的时候，“状态寄存器 SR”中的“TXE 标志位”会被置 1，表示传输完一帧，发送缓冲区已空；类似地，当接收完一帧数据的时候，“RXNE 标志位”会被置 1，表示传输完一帧，接收缓冲区非空；

(5) 等待到“TXE 标志位”为 1 时，若还要继续发送数据，则再次往“数据寄存器 DR”写入数据即可；等待到“RXNE 标志位”为 1 时，通过读取“数据寄存器 DR”可以获取接收缓冲区中的内容

假如我们使能了 TXE 或 RXNE 中断，TXE 或 RXNE 置 1 时会产生 SPI 中断信号，进入同一个中断服务函数，到 SPI 中断服务程序后，可通过检查寄存器位来了解是哪一个事件，再分别进行处理。也可以使用 DMA 方式来收发“数据寄存器 DR”中的数据

这里对标志位再进行说明，当我们的发送缓冲区为空时，此时TXE为1，我们可以往里写入数据，而当我们写入数据之后，TXE立马会置为0，因为SPI是同步发送的，所以当RXNE为1时，代表接收缓冲区不为空，也代表着发送完毕

SPI 初始化结构体详解

typedef struct
 {
 uint16_t SPI_Direction; /* 设置 SPI 的单双向模式 */
 uint16_t SPI_Mode; /* 设置 SPI 的主/从机端模式 */
 uint16_t SPI_DataSize; /* 设置 SPI 的数据帧长度，可选 8/16 位 */
 uint16_t SPI_CPOL; /* 设置时钟极性 CPOL，可选高/低电平 */
 uint16_t SPI_CPHA; /* 设置时钟相位，可选奇/偶数边沿采样 */
 uint16_t SPI_NSS; /* 设置 NSS 引脚由 SPI 硬件控制还是软件控制
*/
 uint16_t SPI_BaudRatePrescaler; /* 设置时钟分频因子，fpclk/分频数 =fSCK */
 uint16_t SPI_FirstBit; /* 设置 MSB/LSB 先行 */
 uint16_t SPI_CRCPolynomial; /* 设置 CRC 校验的表达式 */
 } SPI_InitTypeDef;

这些结构体成员说明如下，其中括号内的文字是对应参数在 STM32 标准库中定义的宏：

(1) SPI_Direction
本成员设置 SPI 的通讯方向，可设置为双线全双工(SPI_Direction_2Lines_FullDuplex)，双线只接收 (SPI_Direction_2Lines_RxOnly)，单线只接收 (SPI_Direction_1Line_Rx)、单线只发送模式(SPI_Direction_1Line_Tx)

(2) SPI_Mode
本成员设置 SPI 工作在主机模式 (SPI_Mode_Master) 或从机模式 (SPI_Mode_Slave )，这两个模式的最大区别为 SPI 的 SCK 信号线的时序，SCK 的时序是由通讯中的主机产生的。若被配置为从机模式，STM32 的 SPI 外设将接受外来的 SCK 信号

(3) SPI_DataSize
本成员可以选择 SPI 通讯的数据帧大小是为 8 位 (SPI_DataSize_8b) 还是 16 位 (SPI_DataSize_16b)

(4) SPI_CPOL 和 SPI_CPHA
这两个成员配置 SPI 的时钟极性 CPOL 和时钟相位 CPHA，这两个配置影响到 SPI 的通讯模式，关于 CPOL 和 CPHA 的说明参考前面“通讯模式”小节。时钟极性 CPOL 成员，可设置为高电平 (SPI_CPOL_High) 或低电平 (SPI_CPOL_Low )。时钟相位 CPHA 则可以设置为 SPI_CPHA_1Edge(在 SCK 的奇数边沿采集数据) 或
SPI_CPHA_2Edge(在 SCK 的偶数边沿采集数据)

(5) SPI_NSS
本成员配置 NSS 引脚的使用模式，可以选择为硬件模式 (SPI_NSS_Hard ) 与软件模式(SPI_NSS_Soft )，在硬件模式中的 SPI 片选信号由 SPI 硬件自动产生，而软件模式则需要我们亲自把相应的 GPIO 端口拉高或置低产生非片选和片选信号。实际中软件模式应用比较多

(6) SPI_BaudRatePrescaler
本成员设置波特率分频因子，分频后的时钟即为 SPI 的 SCK 信号线的时钟频率。这个成员参数可设置为 fpclk 的 2、4、6、8、16、32、64、128、256 分频

(7) SPI_FirstBit
所有串行的通讯协议都会有 MSB 先行 (高位数据在前) 还是 LSB 先行 (低位数据在前) 的问题，而STM32 的 SPI 模块可以通过这个结构体成员，对这个特性编程控制

(8) SPI_CRCPolynomial
这是 SPI 的 CRC 校验中的多项式，若我们使用 CRC 校验时，就使用这个成员的参数 (多项式)，来计算 CRC 的值

当我们配置好结构体里面的成员，调用SPI_Init函数来进行初始化，然后还要调用SPI_Cmd来使能SPI