嵌入式实验之FPGA设计入门

最新推荐文章于 2021-04-26 18:43:11 发布
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分类专栏： 嵌入式
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本文介绍了基于quartusII 13.0的FPGA设计入门，通过半加器和全加器的设计与仿真，详细阐述了从创建工程、设计电路图到实现硬件烧录的完整过程，包括半加器的原理图输入、全加器的构建以及仿真验证。
摘要由CSDN通过智能技术生成

嵌入式实验之FPGA设计入门


本次实验，我将基于Quartus-II软件完成一个一位全加器的设计

目的：

  • 原理图输入
  • Verilog编程
  • 软件基于quartusII 13.0版本，开发板基于Intel DE2-115

1 半加器设计

已知一个一位全加器可以由两个半加器及一个或门连接而成， 因此需要先完成半加器的设计

1.1 创建工程

首先仍是打开quartus，新建一个工程，本次使用的设备为EP4CE115F29C7
在这里插入图片描述
完成设备创建
在这里插入图片描述
点击File->New->Block block diagram/schematic File
在这里插入图片描述

1.2 创建电路图

去网上找了一下半加器的RTL图，大概如下

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