FPGA+DSP的高速AD采集处理开发详解

一、案例说明

1. Kintex-7 FPGA使用SRIO IP核作为Initiator，通过AD9613模块采集AD数据。AD9613采样率为250MSPS，双通道12bit，12bit按照16bit发送，因此数据量为16bit * 2 * 250M = 8Gbps；
2. AD数据通过SRIO由Kintex-7发送到C6678 DSP(Target)的0x0C3F0000~0x0C3F7FFF的地址空间，数据量为32KByte，使用SWRITE方式，期间每传16KByte数据后就发送一个DOORBELL信息，让C6678做乒乓处理。Kintex-7通过SRIO与C6678连接，共4个lane，每个lane的通信速率为5Gbps，数据有效带宽为20Gbps * 80% = 16Gbps；
3. 采集到的AD数据可分别通过Xilinx Vivado和TI CCS软件查看波形，并在C6678做FFT处理。

此开发案例基于创龙Kintex-7+C6678评估板TL6678F-EasyEVM进行。

二、案例框图

三、案例演示

硬件连接：

• 将创龙AD9613高速AD模块TL9613/9706F（此模块集成高速DA，DA芯片为AD9706）通过FMC接口与评估板连接。

• 信号发生器设置成两路正弦波输出，幅度设置：1.5Vpp以及无直流偏置，频率设置：1MHz。
• 信号发生器的两路输出分别连接到模块的ADC_CHA、ADC_CHB。

1. FPGA端

参考TL6678F-EasyEVM评估板光盘用户手册《基于下载器的程序固化与加载》文档中“Vivado下bit文件加载步骤”章节，将tl_fmc_ad9613_srio_tl6678f_xc7k325t.bit文件烧录到FPGA。烧写bit文件时，指定调试文件tl_fmc_ad9613_srio_tl6678f_xc7k325t.ltx，可以观察到ILA调试信号，查看ADC采样波形。

ADC两路信号tl_fmc_ad9613_srio_bd_i/xlslice_l_Dout[11:0]

和tl_fmc_ad9613_srio_bd_i/xlslice_l_Dout[11:0]在ILA内嵌逻辑分析仪中均设置为有符号数、模拟波形显示，如下图所示：

ILA触发抓取两路ADC采样波形，如下图所示（两路正弦波形）:

 2. DSP端

参考TL6678F-EasyEVM评估板光盘用户手册《CCS工程的生成与