C语言makefile文件简单介绍以及使用

目录

一、makefile的介绍

二、makefile的编写

 三、make命令

四、makefile文件中的变量

举个例子

作者有话要说


一、makefile的介绍

  1. 在linux和unix中,有一个强大的实用程序,叫 make ,可以用它来管理多模块程序的编译和链接,直至生成可执行文件
  2. make程序需要一个编译规则说明文件,称为 makefile ,makefile文件中描述了整个软件工程的编译规则和各个文件之间的依赖关系。
  3. makefile就像是一个shell脚本一样,其中可以执行操作系统的命令,它带来的好处就是我们能够实现“自动化编译”,一旦写好,只要一个make命令,整个软件功能就完全自动编译,提高了软件开发的效率
  4. make是一个命令工具,是一个解释makefile中指令的命令工具,一般来说大多数编译器都有这个命令,使用make可以是重新编译的次数达到最小化

二、makefile的编写

makefile文件的规则可以非常复杂,比C程序还要复杂,初学先了解它的简单用法

vim makefile创建文件 

文件名:makefile,内容如下:

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当在VSCode中编写一个多文件C语言项目,并使用Makefile进行编译和构建时,可以按照以下步骤进行操作: 1. 创建项目文件夹:在任意位置创建一个文件夹作为项目的根目录。 2. 在项目根目录下创建源文件:可以使用VSCode的文件资源管理器在项目根目录下创建多个源文件(以`.c`为扩展名)和头文件(以`.h`为扩展名)。 3. 创建Makefile:在项目根目录下创建一个名为`Makefile`(注意首字母大写)的文件,并在其中编写构建规则。 4. 编写构建规则:在Makefile中,你可以定义编译器、编译选项、链接选项以及构建目标等。以下是一个简单的示例: ```makefile CC = gcc CFLAGS = -Wall -Wextra LDFLAGS = SRCDIR = src OBJDIR = obj SOURCES = $(wildcard $(SRCDIR)/*.c) OBJECTS = $(patsubst $(SRCDIR)/%.c, $(OBJDIR)/%.o, $(SOURCES)) TARGET = myproject $(TARGET): $(OBJECTS) $(CC) $(LDFLAGS) $^ -o $@ $(OBJDIR)/%.o: $(SRCDIR)/%.c $(CC) $(CFLAGS) -c $< -o $@ .PHONY: clean clean: rm -rf $(OBJDIR)/*.o $(TARGET) ``` 在这个示例中,我们假设源文件存放在名为`src`的文件夹中,目标文件存放在名为`obj`的文件夹中。`CC`变量指定了编译器,`CFLAGS`变量指定了编译选项,`LDFLAGS`变量指定了链接选项。`$(SOURCES)`变量使用通配符获取所有的源文件,`$(OBJECTS)`变量使用模式替换获取所有的目标文件。`$(TARGET)`是最终的可执行文件名。 构建规则中的第一个目标`$(TARGET)`表示最终的可执行文件,它依赖于所有的目标文件。第二个目标`$(OBJDIR)/%.o`表示每个源文件对应的目标文件,它依赖于对应的源文件。规则中使用了变量展开和自动变量,这样可以根据实际情况进行构建。 最后,使用`make`命令在项目根目录下执行Makefile,并构建项目。如果一切顺利,将会在项目根目录下生成可执行文件。 希望这个简单的示例可以帮助你开始编写多文件C语言项目,并使用Makefile进行构建。如果你有其他问题,请随时提问!

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