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RSS订阅原创 使用的vscode插件
Bracket Pair Colorization Toggler括号按颜色配对 change-case变量按驼峰起名，使用方法：ctrl+shift+p，输入change case CodeGeeX: AI Code AutoComplete，自动补全代码，用tab键完成。 Code Runner运行各种电脑代码 Cortex-Debug，stm32仿真插件。 Embedded IDE可以直接导入stm32cubemx生成的keil工程。 Embedded Tools/RTOS Viewsvs
2024-02-28 15:01:16
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原创 freertos+systemview移植
2.配置修改（1）在main.c 中添加头文件#include "SEGGER_SYSVIEW.h"；（2）在main函数开始处添加：SEGGER_SYSVIEW_Conf()，初始化SystemView；（3）在FreeRTOS.h中添加头文件#include "SEGGER_SYSVIEW_FreeRTOS.h"；
2024-02-28 09:49:25
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原创 freertos+tracealyzer
在硬件初始化之后，任务开始之前加上vTraceEnable(TRC_START_AWAIT_HOST);FreeRTOSConfig.h中一定要在。用AC5编译下载到stm32。tracealyzer设置。
2024-02-27 13:09:22
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原创 Cannot link object __xxx.o as its attributes are incompatible with the image attributes.
vscode中报错，stm32编译AC5，Cannot link object __xxx.o as its attributes are incompatible with the image attributes.c_cpp_properties文件中添加"cStandard": "c99","cppStandard": "c++11",因为如果不这样写，vscode自动把c99变成c17。
2024-02-26 10:18:18
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原创 altium designer 关键问题
PCB规则（rules）可以支持编程过滤的。就是根据条件不同规则不同。 tented表示蒙上帐篷，就是是否开窗。 relief表示热连接。 禁止铺铜，布线：画一个形状并选中，tools->convert->create seleted primitives to keepouts 像小锁链的图标表示连接2个属性，连接上就是改变一个，其他的跟着一起改变；没有连接上，就是改变一个，其他的不变。这是连接上，这是没有连接上。
2024-02-23 09:30:50
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原创 vscode 快捷键
Ctrl + X：剪切行（如果没有选中行，默认剪切当前光标所在行）Ctrl + C：复制行（如果没有选中行，默认复制当前光标所在行）Ctrl + V：粘贴行（在光标所在行的后面）Ctrl + Z：撤销Ctrl + Y：重做Ctrl + Shift + Z：重做（针对某些系统）Ctrl + Shift + K：删除整行Ctrl + Enter：在当前行下插入一行Ctrl + Shift + Enter：在当前行上插入一行Alt + ↑ 或 Alt + ↓：将当前行上移或下移。
2024-02-22 14:10:04
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原创 vscode中调试c++不能再内置终端显示调试结果
2、也可以在launch.json中加入："externalConsole": false,
2024-02-06 11:37:24
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原创 ad快捷键
3.转出Gerber Files ：文件--制造输出--Gerber Files-- General设置（默认）--layer设置：用于生成Gerber文件的层面（如下步骤操作）--Drill Drawing（默认）--Apertures（光圈）和Advanced（默认）--确定--进行第一次输出（生成的*.Cam可不用保存）使用Altium Designer17版本，使用快捷键Ctrl+M测量尺寸之后，黄色的尺寸字体删不掉的处理办法：可以删掉某一条边界线，然后字体就消失了，随后在后退一下，即可。
2024-02-02 17:26:09
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原创 指定intel fpga PLL位置
会在qsf文件中产生如下语句：set_location_assignment PLL_1 -to "pll_ip:pll_ip_inst"
2024-01-26 11:10:00
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原创 ad使用方法
画封装要批量且等增量更改一串引脚的designator号，把要更改的引脚全部选上，在properties的designator中点击...，在fomula中输入！+1这是pascal语言。
2024-01-19 14:31:25
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原创 intel fpga需要的flash容量评估
下面是解释：EPCS是串行存贮器，FPGA不能直接从EPCS中执行程序，它实际上是执行EPCS控制器的片内ROM的代码（即bootloader），把EPCS中程序的搬到RAM中执行。FPGA的配置数据从EPCS偏移为0的地址开始存放，紧挨着配置数据后面是一个32位的整数，指示程序段的长度，接着是一个32位的地址，指示程序执行时该程序段的地址，我们把这个长度和地址一起称为"程序记录"，"程序记录"随后就是程序段映象。1.使用的fpga是EP4CE15。这就是最后的压缩过的容量，epcs4没有问题了。
2024-01-16 17:18:40
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原创 teroshdl使用（verilog）
在teroshdl中，sources中在需要的文件上打对勾，设置top-level。在runs中按箭头调出来modelsim仿真。1、语法检查：使用modelsim。a.把medelsim的环境变量设置好。
2024-01-11 16:05:12
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原创 verilog之testbench
信号名 这种的方式引用例化模块内部的信号。估计可以继续向下延时，比如：例化名。可以用force命令强制一个信号为某个特定值。信号名 这种方式。猜出来的结果，还不错。
2024-01-10 14:21:15
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原创 vscode tasks.json的存放位置
通常情况下，vscode会优先运行roaming文件夹中的tasks.json文件，如果没有找到该文件，才会尝试运行工作区中的tasks.json文件。
2023-12-26 22:01:02
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原创 vscode eide从空项目建立stm32的armclang编译的项目
一般eide使用MDK的项目，是从cubemx中生成MDK项目，然后用eide打开就行了。 现在是从空的eide项目中建立编译环境。 从cubemx中，分别生成mdk和makefile项目。安装makefile文件添加各种空的eide项目配置。编译器可以选则AC6。 注意，从makefile生成的启动(.s)文件是不完全的，缺少reset位置的设置。所以要从生成的mdk方式中把那个启动(.s)文件拷贝出来，替换工作目录中的启动文件。sct文件也可以从MDK方式生成中指定。省的自己去找了。 用ei
2023-12-25 12:10:28
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原创 vscode increment selection使用
原文链接：https://blog.csdn.net/weixin_48785875/article/details/123825164。版权声明：本文为CSDN博主「是小丸子呀」的原创文章，遵循CC 4.0 BY-SA版权协议，转载请附上原文出处链接及本声明。2.3 递减数字同理，区别在于从下往上选中（光标定位第10行，shift+alt+鼠标左键–选中第一行即可递减）shift+alt+鼠标左键–选中多行。shift+alt+鼠标左键–选中多行。输入任意数字，shift+→键选中数字。
2023-12-22 15:26:45
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原创 stm32使用jlink烧录仿真，freertos不能用complier6编译，cortex-debug仿真中xrtos使用，使用embedded tools
3、cubemx中找到库的位置。把\Middlewares\Third_Party\FreeRTOS\Source\portable\RVDS\RVDS\ARM_CM4F中的文件用，\GCC\ARM_CM4FError: L6406E: No space in execution regions with .ANY selector matching中的文件替换。
2023-12-18 09:51:43
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原创 stm32中HAL_UART_Transmit_DMA，串口只能发送一次。
1、HAL_UART_Transmit_DMA中调用HAL_DMA_Start_IT，在HAL_DMA_Start_IT中虽然开启了三个中断：hdma->Instance->CR |= DMA_IT_TC | DMA_IT_TE | DMA_IT_DME，但是没有开DMA总中断，所以这3个不起作用；如果开启DMA总中断，完成DMA后会调用下图的UART_DMATransmitCplt函数。为此，如果不想亲自设置，要想在使用串口+DMA发送，应该在cubemx中开启串口和DMA中断。
2023-12-15 14:57:56
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原创 stm32cubemx+freertos消息队列传数组
在这里有一个sizeof(type)，这里的type就是cubemx中Item Size中需要填写的内容。开始不知道怎样传数组，在cubemx中item size只能写类型名，实际上是可以写要传的数组名的。这个地方规定了队列项的大小。
2023-12-15 11:02:34
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勇敢的芯伴你玩转Altera FPGA-吴厚航
2019-02-13
勇敢的芯伴你玩转Altera FPGA 吴厚航 这是这本书的第二部分
2019-02-13
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