ddr3
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Xilinx32bit位宽DDR3读写控制模块编写(2)——仿真文件的调用
用下面的方法将ddr3例化至仿真文件,因为使用的是两片ddr3所以需要例化两个模型,类似于真正绑定IO口的感觉。感兴趣的可以看一下上面两个文件,就可以知道为什么必须例化两个,我写程序时仿真后ddr3一直初始化不成功就是因为没有认识到ddr3_modle.sv的真正含义。2、弹出下框,路径为创建工程路径不用改,若是之前创建过仿真工程文件现在又做了修改则勾选覆盖之前工程。5、这里不用运行仿真,只需要取两个我们需要的文件加入我们自己的工程目录。仿真文件的调用介绍完毕,后面是MIGip核app接口的使用。原创 2023-04-08 20:27:15 · 594 阅读 · 0 评论 -
Xilinx32bit位宽DDR3读写控制模块编写(3)——MIGip核app接口的使用
用户端接口可以分为五部分:①输出给控制函数用的时钟、复位、初始化完成信号;②读写复用的地址、读写控制、使能信号;③5个写数据专用信号;④4个读数据专用信号;⑤ip核使用的时钟、复位信号。下图是官方文档的接口示意图。ddr3开头的都是要接到ddr3上的只需要按照电路设置IO口即可,我们只需要控制左侧接口。1、打开官方文件,官方已经给出接口和例化方式。每个接口的详细介绍可以去看官方文档。下面是我对每个接口的简单理解。原创 2023-04-08 21:09:11 · 1021 阅读 · 0 评论 -
Xilinx32bit位宽DDR3读写控制模块编写(1)——MIGip核的设置
vivado创建ddr3ip核,适用于32bit位宽的核心板原创 2023-04-08 11:14:24 · 925 阅读 · 0 评论