linux系统 ubuntu 使用GWE图形用户界面调整显卡风扇转速曲线

最新推荐文章于 2023-11-01 09:29:37 发布
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分类专栏： linux ubuntu 显卡风扇 文章标签： ubuntu linux nvidia
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linux系统 ubuntu 使用GWE图形用户界面调整显卡风扇转速曲线

原址链接: How to control Nvidia graphics card Fan Speed Automatically in Linux.

“在boot中使用Green With Envy(GWE) GUI自动控制风扇速度”

  • linux中有一个很好的图形用户界面可以适当地控制Nvidia显卡，称为Green With Envy或GWE。
  • 它无法在Ubuntu官方商店获取，但可以在flatpak上获取。使用这个链接https://flatpak.org/setup/安装flatpak。安装好flatpak后，使用以下指令安装GWE：
flatpak install flathub com.leinardi.gwe
  • 安装好后，你可以通过以下指令运行它：
flatpak run com.leinardi.gwe

在这里插入图片描述

  • 使用GUI非常简单明了，不需要解释。

  • 将程序启动指令添加到~/.xprofile中，就可以使其开机自启动。具体输入以下指令：

echo 'flatpak run com.leinardi.gwe --hide-window &' >> ~/.xprofile
  • 默认情况下，此程序无法将自身添加到启动中，但上述操作可以解决此问题。
jyzzzzzzz
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一、环境 1.Nvidia显卡，且已经安装了nvidia驱动（即可执行nvidia-smi与nvcc -V指令，如果没安装要先百度安装nvidia显卡驱动） 2.Linux系统。本次是在ubuntu上。 3.警告：该步骤操作是修改系统文件，具有无法显示内容/无法进入系统的风险，请知悉。 二、单显卡步骤 1.启动xorg.conf配置文件。在指令中输入： sudo nvidia-xconfig 此时会提示已经生成/etc/X11/xorg.conf文件 2.修改/etc/X11/xorg.c
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子燕若水的博客
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罗思哲的博客
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// $Header: /devl/xcs/repo/env/Databases/CAEInterfaces/verunilibs/data/glbl.v,v 1.15 2011/08/25 22:54:30 fphillip Exp $ `timescale 1 ps / 1 ps module glbl (); parameter ROC_WIDTH = 100000; parameter TOC_WIDTH = 0; //-------- STARTUP Globals -------------- wire GSR; wire GTS; wire GWE; wire PRLD; tri1 p_up_tmp; tri (weak1, strong0) PLL_LOCKG = p_up_tmp; wire PROGB_GLBL; wire CCLKO_GLBL; reg GSR_int; reg GTS_int; reg PRLD_int; //-------- JTAG Globals -------------- wire JTAG_TDO_GLBL; wire JTAG_TCK_GLBL; wire JTAG_TDI_GLBL; wire JTAG_TMS_GLBL; wire JTAG_TRST_GLBL; reg JTAG_CAPTURE_GLBL; reg JTAG_RESET_GLBL; reg JTAG_SHIFT_GLBL; reg JTAG_UPDATE_GLBL; reg JTAG_RUNTEST_GLBL; reg JTAG_SEL1_GLBL = 0; reg JTAG_SEL2_GLBL = 0 ; reg JTAG_SEL3_GLBL = 0; reg JTAG_SEL4_GLBL = 0; reg JTAG_USER_TDO1_GLBL = 1'bz; reg JTAG_USER_TDO2_GLBL = 1'bz; reg JTAG_USER_TDO3_GLBL = 1'bz; reg JTAG_USER_TDO4_GLBL = 1'bz; assign (weak1, weak0) GSR = GSR_int; assign (weak1, weak0) GTS = GTS_int; assign (weak1, weak0) PRLD = PRLD_int; initial begin GSR_int = 1'b1; PRLD_int = 1'b1; #(ROC_WIDTH) GSR_int = 1'b0; PRLD_int = 1'b0; end initial begin GTS_int = 1'b1; #(TOC_WIDTH) GTS_int = 1'b0; end endmodule 这段代码是什么意思，并且给出每一行代码的注释
05-30
这段代码是一个 Verilog 语言的模块定义，定义了一个名为 glbl 的模块。下面是每一行代码的注释： ``` // $Header: /devl/xcs/repo/env/Databases/CAEInterfaces/verunilibs/data/glbl.v,v 1.15 2011/08/25 22:54:30 fphillip Exp $ ``` 注释：版本信息。 ``` `timescale 1 ps / 1 ps ``` 注释：定义模块的时钟时间单位为 1ps。 ``` module glbl (); ``` 注释：定义一个名为 glbl 的模块，没有输入和输出信号。 ``` parameter ROC_WIDTH = 100000; parameter TOC_WIDTH = 0; ``` 注释：定义两个模块参数，ROC_WIDTH 表示全局异步复位信号的持续时间，TOC_WIDTH 表示全局时钟使能信号的延迟时间。 ``` wire GSR; wire GTS; wire GWE; wire PRLD; ``` 注释：定义四个输入信号，分别是全局异步复位信号 GSR、全局时钟使能信号 GTS、全局写使能信号 GWE 和并行加载信号 PRLD。 ``` tri1 p_up_tmp; tri (weak1, strong0) PLL_LOCKG = p_up_tmp; ``` 注释：定义一个有向三态缓冲器，用于控制锁相环锁定状态信号的输出。 ``` wire PROGB_GLBL; wire CCLKO_GLBL; ``` 注释：定义两个输出信号，分别是编程管脚信号 PROGB_GLBL 和 CCLKO_GLBL。 ``` reg GSR_int; reg GTS_int; reg PRLD_int; ``` 注释：定义三个寄存器，用于存储全局异步复位信号 GSR、全局时钟使能信号 GTS 和并行加载信号 PRLD 的值。 ``` wire JTAG_TDO_GLBL; wire JTAG_TCK_GLBL; wire JTAG_TDI_GLBL; wire JTAG_TMS_GLBL; wire JTAG_TRST_GLBL; ``` 注释：定义五个输入信号，分别是 JTAG 测试数据输出信号、JTAG 测试时钟信号、JTAG 测试数据输入信号、JTAG 测试模式选择信号和 JTAG 测试复位信号。 ``` reg JTAG_CAPTURE_GLBL; reg JTAG_RESET_GLBL; reg JTAG_SHIFT_GLBL; reg JTAG_UPDATE_GLBL; reg JTAG_RUNTEST_GLBL; ``` 注释：定义五个寄存器，分别用于存储 JTAG 测试模式下的状态转移控制信号。 ``` reg JTAG_SEL1_GLBL = 0; reg JTAG_SEL2_GLBL = 0 ; reg JTAG_SEL3_GLBL = 0; reg JTAG_SEL4_GLBL = 0; ``` 注释：定义四个寄存器，用于存储 JTAG 测试模式下的选择信号。 ``` reg JTAG_USER_TDO1_GLBL = 1'bz; reg JTAG_USER_TDO2_GLBL = 1'bz; reg JTAG_USER_TDO3_GLBL = 1'bz; reg JTAG_USER_TDO4_GLBL = 1'bz; ``` 注释：定义四个寄存器，用于存储 JTAG 测试模式下的用户自定义数据输出信号。 ``` assign (weak1, weak0) GSR = GSR_int; assign (weak1, weak0) GTS = GTS_int; assign (weak1, weak0) PRLD = PRLD_int; ``` 注释：使用 assign 语句将全局异步复位信号 GSR、全局时钟使能信号 GTS 和并行加载信号 PRLD 的值通过三态缓冲器输出。 ``` initial begin GSR_int = 1'b1; PRLD_int = 1'b1; #(ROC_WIDTH) GSR_int = 1'b0; #(TOC_WIDTH) GTS_int = 1'b0; end ``` 注释：在模块初始化时，将全局异步复位信号 GSR 和并行加载信号 PRLD 置为高电平，持续时间为 ROC_WIDTH 个时钟周期；将全局时钟使能信号 GTS 置为高电平，延迟时间为 TOC_WIDTH 个时钟周期。 ``` initial begin GTS_int = 1'b1; #(TOC_WIDTH) GTS_int = 1'b0; end ``` 注释：在模块初始化时，将全局时钟使能信号 GTS 置为高电平，延迟时间为 TOC_WIDTH 个时钟周期。 ``` endmodule ``` 注释：模块定义结束。

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