软考-主存和cache的映射问题

文章详细介绍了Cache的三种映射方式——全相联映射、组相联映射和直接映射,以及在不同映射方式下如何计算和确定标记(Tag)、组号、块内地址的位数。通过两个示例具体展示了地址转换的过程,涉及Cache容量、块大小、组数和主存地址结构等概念。

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  • 全相联映射:主存物理地址 =标记块内地址

  • 组相联映射:主存物理地址 =标记+组号+块内地址

  • 直接映射: 主存物理地址 =标记+cache+块内地址

主物理地址: 块号+块内地址

二.例题

【例1】有效容量为128KB的Cache,每块16字节,采用8路组相联,字节地址为1234567H的单元调入该Cache,则其Tag(标签)应为______

128KB的Cache,每块16B(默认字节编制,1B对应1个地址,可表示16个地址)

那么总共有128KB/16B=2^13块,采用8路组相联,于是可划分为 2^13/8=2^10组,需要10位来寻址;每块16B(24),字块内地址为4位。

再根据字节地址1234567H,16进制数用4个2进制表示,所以一共是28个二进制数(主存物理地址),对应二进制为 0001 0010 0011 0100 0101 0110 0111

除去低位的Cache字块组号和字块内地址,可知高14位为主存字块标记 0001 0010 0011 01,对应十 六进制为 048DH

组相联映射:主存物理地址(28位) =标记+组号(10组)+块内地址(4)


【例2】某32位总线处理器的Cache直接映射方式如下图所示,若Cache大小为16KB,每个Cache块为16字节,则Offset,Index和Tag所占的位数分别是

直接映射的方式为:主存储器中一块只能映像到Cache的一个特定的块中。主存与缓存分成相同大小的数据块。主存空间按缓存容量分成区,每一区的块数与缓存的总块数相等。

offset:块内偏移量,长度由cache块的大小决定

index: 块所在的组号,长度由Cache中组的数量决定;

tag:主存地址剩余部分,长度由主存地址的总长度减去offset与index决定

如果每个Cache块的字节数是16B,则Cache块内索引的位数为4位(2^4=16);如果Cache的大小为16KB,16KB/16B=1024块,所以需要Index索引的位数为10位(2^10=1024),映射到内存的地址位数为32-4-10=18。

这样块内地址占4位,块号10位。主存分区号:18位。

直接映射: 主存物理地址 =标记(TAG)+cache+块内地址


【例2】某32位计算机的Cache容量为16KB,Cache块的大小为16B,若主存与Cache地址映像采用直接映像方式,则主存地址为0x1234E8F8的单元装入Cache的地址是______。

主存地址共32位,主存一个数据块调入Cache时使用直接映像方式,把主存按Cache容量分为若干区,主存某一数据块只能放在与Cache块号相同的数据块中,这样地址转换比较方便。

由于Cache与主存的数据块大小是16B,块内地址需(2^4=16)4位

Cache容量为16KB,故Cache可分为(16KB/16B=1024)1024块,块地址需(2^10 =16)10位,除去这14位低位地址,主存地址高位共18位,即主存分区号,

作为字块标志也需要写入Cache数据块中。因此,装入Cache的地址编号为低14位数据即10100011111000B

在现代计算机系统中,Cache主存的地址映射是通过硬件机制自动完成的,这一过程涉及到内存管理的关键技术。地址映射的目的是让CPU能够更快地访问数据,提高整体性能。Cache分为不同的层次,比如L1、L2L3,每一层缓存都具有不同的访问速度大小,它们负责存储CPU经常访问的数据。 参资源链接:[国家网络工程师历年真题解析](https://wenku.csdn.net/doc/30fp537c27?spm=1055.2569.3001.10343) 地址映射的工作原理主要依靠映射策略来实现,常见的映射策略包括直接映射、全相联映射组相联映射直接映射Cache最简单,每个主存只能映射Cache的一个特定置;全相联映射则允许一个主存映射到任意一个Cache置;组相联映射是一种折中方案,将Cache分为若干组,每个主存可以映射到同一组内的任何一个Cache置。 当CPU请求数据时,硬件会根据地址映射策略快速在Cache中查找是否存在所需数据。如果在Cache中找到,即发生缓存命中(Cache hit),CPU可以直接读取数据,这是一个高速且高效的过程。如果Cache未命中(Cache miss),CPU则必须访问较慢的主存来获取数据,随后可能会将数据加载到Cache中以备后续访问。 缓存的存在显著减少了CPU与主存之间访问的延迟,因为Cache的速度远高于DRAM主存。然而,设计良好的地址映射策略对于减少缓存缺失,以及维护数据一致性更新效率至关重要。这直接影响到整个计算机系统的性能,尤其是在处理大量数据执行复杂计算时。 为了深入理解这一过程,建议参《国家网络工程师历年真题解析》中关于内存管理硬件架构的章节。这些资料将帮助你更好地掌握地址映射Cache工作的细节,以及它们在现代计算机系统中的重要性。 参资源链接:[国家网络工程师历年真题解析](https://wenku.csdn.net/doc/30fp537c27?spm=1055.2569.3001.10343)
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