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原创 Modelsim仿真实现Verilog HDL 4位二进制计数器
由4个D触发器连接在一起形成的4位二进制计数器,包含了Verilog代码和仿真结果
2024-08-03 23:00:05
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原创 PSIM仿真实现C语言SVPWM逆变器调制
本文详细讲解了两电平变流器SVPWM在仿真软件Altair PSIM中的实现方法,并给出了详细代码和仿真架构图、仿真波形。
2024-08-02 15:53:26
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原创 Modelsim仿真实现Verilog HDL投票表决器
假设共有7个人投票,只能投赞成或反对票,只要有4人或4人以上的赞成票,就视为通过,否则视为不通过。
2024-07-23 15:48:05
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原创 Modelsim仿真实现Verilog HDL冒泡排序
在待排序的一组数中,将相邻的两个数进行比较,若前面的数比后面的数大就交换两数,否则不交换。详细代码与仿真结果。
2024-07-22 23:00:24
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空空如也
这个电路实现的是什么功能
2024-05-22
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