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原创 《大话处理器》Cache章节阅读笔记

在我们实际使用处理器时,程序的并行性优先,不能将处理器的资源全部利用,内存速度远远跟不上处理器的速度。程序和数据都在内存中,程序和数据迟迟进不了处理器。为了弥补内存速度低下的问题,处理器内部会放置一些SRAM做Cache,以提高处理器访问程序和数据的速度。

2023-09-28 09:50:06 69

原创 你的TestBench与随机环境大杂烩一锅熟,怎么定位呢

其次,我发现很多公司的验证环境,倾向于将随机事件加入到TestBench中,比如随机产生100个包的数据,而后灌输到DUT上。这里便是可预测性的问题了,书里写的有。第一种,在TestBench中借用sequence,再结合automatic for循环和fork join_none,便能够并发执行产生100个包的进程,因为各包产生完成时间没有约束,所以发包顺序是随机的。第二种,构建随机环境,按顺序发、倒序发、穿插着发,每条用例发送模式先固定,待DUT调试稳定后,再进入全随机发送调试阶段。

2023-09-15 10:47:03 83

翻译 深恶痛绝IEEE Standard for SystemVerilog 1800-2017

IEEE Standard SystemVerilog学习

2023-08-28 12:45:12 725

原创 Python报错:AttributeError: ‘xml.etree.ElementTree.Element‘ object has no attribute ‘strip‘

不得不说,这里我搜索到的问题现象,简直与自己遇到的问题真的一毛一样,美滋滋乐开怀,我硬着头皮在各英文单词之间寻找可以拿来即用的解决办法。根据首行报错信息,我们在Google浏览器中搜索,发现别人也遇到了同样的报错,一毛一样,顿时心里乐开了花,这意味着我们很有可能只要依葫芦画瓢,便可以解决了当下的问题。这里我们根据错误提示信息,层层递进能够发现,最终在xml这块报错,而xml是一个python库,在使用之前需要安装。待安装成功后,再运行原脚本,不再报错,问题解决,工作完成,又是充实的一天。

2023-08-26 14:05:40 939 2

原创 我明明啥也没改啊,咋就不对了呢

方式B根据地址直接写,地址这个形参完整地是64bit,无符号数,而我在给这个形参传参时,用了个int型变量加上一个16进制常量,芭比球了,经过计算给高32位扩展成了全F,也就是你原本预期写的地址是32'hFADCBBBB,变成了64'hFFFFFFFF_FADCBBBB,这个地址不在可配置区间啊。后来为了减少由于多个寄存器总线配置造成的时延,方式A是按照位域写,也就是32比特的区域可能会出现多次配置的情况。用例调试中,突然用例比对失败,我明明啥也没有修改啊,或者我只改了这个地方啊,这个不可能出错啊。

2023-03-31 23:07:17 90

原创 这个错误波形好像在哪见过

用例场景较多时,我们会出现“咦这个错误波形咋看着有些眼熟呢”的疑问,可是自己又发现不了问题的根源,迫于项目进度只好拉设计同学一起看,设计同学看到波形后立马来了句这不是跟那啥一样一样的嘛。不可否认有时记录的不够细致,导致出问题时还得去不停的翻查表格,这里是关键字没有认真写的原因。其次,表格里放波形截图也的确有缺点,它只能按照顺序排放。我以前也记录出问题的现象,包括错误点、波形、错误原因和解决办法,就在excel中记录。后来看同事用onenote记录,标题加波形就是一页,很醒目,容易查找,确实值得学习。

2023-03-31 22:55:40 39

原创 定位问题注意灯下黑

A寄存器配置不符合预期,我们一下子便钻进了它为啥配置不对的胡同。可没曾想,跟A寄存器同属于一条用例或者一轮用例中的B寄存器却工作正常,那么此时这里是否更加不符合情况?定位问题时,请注意办公场所灯光亮度与电脑屏幕亮度、眼镜散光调整度是否匹配,是否挪动办公椅往屏幕后方退了一步,毕竟退一步海阔天空。这个点挺难把握的,你以为出问题的地方,退后一步看的时候会发现,咦这里为啥又是正常的呢?你是不是有很多的问号❔。遇到问题时,我们可能习惯性的聚焦在了出问题的地方,而环境恰恰喜欢出其不意攻其不备,你是不是也总是误入歧途?

2023-03-31 22:45:42 55

原创 关于验证场景较多时避免遗漏的工作建议

部门模块较为复杂,IT验证时验证特性、验证场景较多,在漫长的各种典型场景调试过程中,由于追赶进度和频繁的定位问题,我们可能会出现场景遗漏的情况。那么,我们可以尝试利用思维导图文件将各验证场景列举划分出来,然后在调试过程中逐个覆盖,以确保覆盖完全。这样的一种方式不仅能够确保验证完备,同时也能够帮助我们知道目前的工作进度,哪些工作还需要完成。同时对验证场景的划分,虽然在场景规划里已经有规划,但是利用关键字在思维导图中陈列的方式,能够对验证对象总结再提升。

2023-03-31 22:28:38 102

原创 scramble模块验证特性梳理

数字芯片验证特性梳理示例

2022-06-26 17:24:33 763 1

翻译 数字芯片验证之验证特性

验证特性

2022-06-12 20:06:46 482 2

原创 scramble模块代码端口

在验证特性开发时,我们验证人员的入手文档,一般包括协议、总体方案。其中协议内容包含较多,可以理解为基础文本学习,其涵盖的内容较多,描述详细,可以帮助我们对待验证对象的内容、功能有一个全面的认知。在协议学习阶段,我们验证人员应遵循由粗到细的步骤,循序渐进,吃透待验证对象的内容。这将极大地帮助我们理解算法代码RM、开发验证特性、开发测试点、规划用例、制定随机变量范围等前期准备工作。对于验证人员而言,验证特性、测试用例以及随机环境开发的工作应全面而具体,掌握细节。这些前期准备工作的完善将极大地提高验证

2022-05-12 22:44:16 245

原创 PCIE2.0 DATA SCRAMBLING协议内容

手里有一份PCIE2.0 Verilog代码,拟计划以加扰模块为待验证对象,开展验证特性分解、测试点开发、验证用例设计、UVM验证平台搭建等内容。先发布PCIE2.0标准文档中关于加扰scramble的协议内容,后续先讲述验证特性相关知识,以及如何分解特性等知识,最后以scramble模块为例,进行验证特性分解。...

2022-05-12 22:19:23 867

原创 数字芯片验证工程师立贴

本人2020年毕业,现从事数字芯片验证工作。由于部门为了提高业务水平,方便新员工快速上手业务,所以验证平台集成度较高。希望在此记录工作中遇到的问题、工作内容总结以及可能私下自己玩弄的验证或者C++相关实验,以提供个人能力。初入门,谢谢大家。...

2022-05-12 22:04:32 229

空空如也

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