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原创 教你快速使用Python读写文件

读文件:file = open(“filename.txt”) while 1: line=file.readline()#按行读文件 if not line:#判断是否读到最后一行,是的话直接跳出while break pass## you can do something here,可以在这里添加处理的代码...

2018-06-29 21:37:38 2080

原创 FPGA按键消抖(附带程序)

这里介绍一种基于延时判断的按键消抖程序。首先,程序会一直检测按键是否按下,如果按下了就延迟一段是间再去判断,如果此时按键的状态没有改变,那么就认定这次按键的触发是人为触发的。否则,认为是误触发。直接把代码贴出来吧。(也可以到我的资源页面进行下载按键消抖)-------------------------------------------------------------------------...

2018-06-29 11:07:27 8181

原创 如何优雅地在Vivado中使用Sublime Text3编辑器

第一步:安装好Sublime Text3 编辑器,不会安装的请移步这里安装Sublime Text3第二步 : 打开Vivado,Tools——>Settings 打开如下图一界面。在左侧选择Text Editor,然后Current Editor 下拉框选择先自定义编辑器 Custom Editor。这将打开图二所示页面,在图二的方框中填入你自己编辑器的安装路径即可,比如我的就是:D:\S...

2018-06-27 17:21:36 4734 2

原创 如何优雅的安装与使用Sublime Text 3

本教程按照:软件安装——>破解——>插件安装 流程来说明软件安装第一步:到官网下载相应版本的Sublime Text 3.官网地址 。打开官网后如图一所示。然后下载相应版本的软件。(因为我的电脑是Windows 7 64位的,所以我下载的是图中红色方框框起来的版本)图一第二步:安装Sublime Text 3.这步安装就是傻瓜式的安装。选好安装路径后就一直Next就好。到此已经安装结束...

2018-06-27 11:04:39 2218

原创 使用xilinx时钟向导生成时钟有多重要?

在做一个项目的时候遇到了个问题,经排查是由于时钟不稳定导致。因此果断改用xilinx的时钟向导生成所需的时钟,重新生成比特流,下载验证,成功。...

2018-06-24 21:45:40 609

原创 使用vivado生成.MCS文件

其实生成.mcs文件非常简单,但是只是对有经验的设计者而言。对于新手,生成一个.MCS文件可能就会遇到各种各样的问题。下面就简单的介绍一下如何生成.MCS文件。这里介绍两种种方法。第一种是使用GUI,也就是用鼠标点来点去就可以。另外一种就是用tcl命令。第一种。第一步:首先生成比特流文件。假设生成的比特文件名字是 led.bit。第二步:选择工具栏的“Tools"—>"Generate  M...

2018-06-21 17:47:14 24337 6

原创 FPGA——上电自复位方式(非常简单)

       上电自复位对FPGA的稳定性及其重要,因为对于某些设计,上电之后需要进行一些状态寄存器的初始化,或者系统自己初始化都需要一个复位信号。在这里我就介绍一个比较好用的方法,大家一起学习一下。library IEEE;use IEEE.STD_LOGIC_1164.ALL;use IEEE.STD_LOGIC_UNSIGNED.ALL;use IEEE.numeric_std.all;li...

2018-06-20 11:49:26 11726 8

原创 奇异值分解在图像压缩中的应用(有MATLAB仿真程序)

这篇文章其实也是矩阵分析的一个作业,当时也是矩阵奇异值分解挺有意思的,所以就在网上查找奇异值分解的相关应用。自己对图像处理也很感兴趣,因此就选择了图像压缩这个应用。写博客是个很好的学习方法,坚持写博客也是一个好习惯。下面就直接把论文贴上来。附录1:奇异值分解几何意义程序t=[0:0.01:2*pi]; x=cos(t);y=sin(t);%变换矩阵A = [1 -2;1 2];A = double...

2018-06-16 23:10:17 3850

原创 VHDL 单脉冲的产生

        在做FPGA设计时,中我们经常会遇到需要经一个高电平信号转化成一个带脉冲信号。比如复位信号进来是一个很长的高电平信号,但是复位信号又必须做成一个带脉冲信号,因此掌握将一个高电平信号转化成单周期的脉冲信号很有必要。下面就转化原理进行分析:先上图,看图好说话:信号1是原始输入信号;信号3是信号1经过一个周期的延迟得到的信号;信号2是信号3取反得到的信号;信号4是信号1延迟两个周期得到的...

2018-06-02 00:03:53 4582 2

axi_gpio_phy.rar

https://blog.csdn.net/MaoChuangAn/article/details/90549744 直接操作寄存器控制GPIO,摆脱对SDK库函数的依赖

2019-05-25

axi_gpio.rar

zynq AXI_GPIO 中断 https://blog.csdn.net/MaoChuangAn/article/details/90488018

2019-05-23

PL_PS_intr.rar

zynq中断例程。https://blog.csdn.net/MaoChuangAn/article/details/90485556

2019-05-23

FPGA_SPI多重启动

Xilinx 7系列多重启动教程。欢迎能够下载分享。

2019-05-07

Xilinx MIG 控制器工程

Xilinx MIG 控制器

2018-12-26

ZedBoard的u-boot源码

zynq-7000的u-boot源码包,并有对应的编译u-boot教程。

2018-11-14

ZedBoard 无桌面启动文件

ZedBoard移植不带桌面linux系统启动文件,

2018-09-27

ZedBoard启动文件

ZedBoard启动文件,包含BOOT.BIN、devicetree.dtb、zImage

2018-09-26

FPGA按键消抖程序

基于VHDL的按键消抖程序,已经经过验证,可以放心使用。另外在我的博客《FPGA按键消抖(附带程序)》中也对该程序进行了说明。

2018-06-29

NRF24L01多对一

这是NRF24L01 的无线模块多对一通信

2015-05-09

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