【IC萌新虚拟项目】spt_core模块基于dc的综合环境搭建与面积时序优化

本文介绍了在IC设计中,针对spt_core模块如何搭建基于DC的综合环境,并进行时序检查和优化。内容包括sdc文件的编写,如定义时钟、复位和约束输入输出端口,以及如何通过时序报告(qor.rpt, timing.rpt)分析并解决时序违例问题。在2GHz时钟频率下,发现并解决了由input_delay设置过大导致的非时序问题。" 52159332,5696425,优化算法:洛谷P2671 NOIP2015普及组求和问题,"['算法', '编程竞赛', '数据结构', '效率优化', '数学应用']
摘要由CSDN通过智能技术生成

关于整个虚拟项目,请参考:

【IC萌新虚拟项目】Package Process Unit项目全流程目录_尼德兰的喵的博客-CSDN博客

前言

当验证的同学正在疯狂写测试点,补充测试用例各种找茬找bug时候,设计的同学也要进入到跑综合修时序优化面积的阶段了。

还是老样子,关于芯片综合的知识就不在本文中赘述,项目仍以实践为导向。

综合环境

一般而言成熟的项目组或者芯片团队,综合环境是有同学专门负责搭建的,因此对于这一步大家就不需要担心了。虚拟项目中的综合环境如下:

dc
├── lib
│   └── ...
├── run
│   └── Makefile
├── script
│   ├── gain_rtl_path.py
│   └── run.tcl
└── sdc
    ├── clock.sdc
    ├── define.sdc
    └── io.sdc

lib目录为综合的库文件,script目录为目录解析脚本和tcl配置,sdc目录为模块的sdc配置,run目录进行

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