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RSS订阅原创 UVM笔记
一、UVM基本 概念验证计划功能覆盖率，结构覆盖率模块机/芯片级/系统级白盒/灰盒/黑盒二、构建UVM平台2.1、简化的UVM平台只有master agent1、创建transaction2、创建sequence含义：启动后产生10个事物对象，然后停止仿真。3、创建agent（sequencer，monitor、driver）sequencer：phase：UVM平台中所有的组件具有phase概念，它们按照一定顺序执行的任务或函数产生。driver：4、创
2020-10-04 12:25:35
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原创 数字成像系统笔记
imaging algorithm specialist staff image quality engineercmos sensor
2020-09-11 17:15:21
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原创 HEVC笔记-2
预测编码一副图像内临近像素之间有着较强的空间相关性，相邻图像之间也有很强的时间相关性。因此，视频编码往往采用帧内预测和帧间预测的方式，使用图像内已编码像素预测临近像素，或利用已编码图像预测待编码图像，从而有效去除视频空域和时域的相关性。视频编码后对预测后的残差而不是原始数据进行变化、量化、熵编码，由此大幅提高编码效率。视频编码技术主要分为两大类：1、帧内预测，即利用当前图像内已编码像素生成预测值。2、帧间预测，即利用当前图像之前已编码图像的重建像素生成预测值。帧内预测H265/HEVC亮度分量帧
2020-08-12 18:01:51
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原创 HEVC笔记-1
H265视频标准编码框架1、帧内预测该模块主要用于去除图像的空间相关性。通过边马厚的重构块信息来预测当前像素块以去除空间冗余信息，提高图像的压缩率。与以往的标准相比，H265/HEVC支持更多的帧内预测模式2、帧间预测该模块主要用于去除图像的时间相关性。帧间预测通过降已编码的图像作为当前帧的参考图像，来获取各个块的运动信息，从而去除时间冗余，提高压缩效率。在H265/HEVC中，帧间预测可采用单向和双向的参考图像来进行预测，包括类似H264/AVC中分层B帧的预测结构。3、变换量化改模块通过对.
2020-08-11 17:43:13
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原创 手把手教你设计CPU-1
ISA众生相1、x86架构2、SPARC架构3、MIPS4、Power5、Alpha6、ARM7、ARC8、Andes9、C-Sky出了x86都是RISCRISC-V有2条无条件跳转指令跳转链接 （Jump and Link）指令一一jal 指令可用于进行子程序调用，同时将子程序返回地址存在链接寄存器（ Link Register，由某一个通用整数寄存器担任〉中 。跳转链接寄存器 （Jump and Link-Register ） 指令一jalr 指令能够用于子程序返回指令，通过
2020-08-11 09:53:39
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原创 手把手教你设计CPU-4
实现SoC和FPGA原型蜂鸟E200在Freeedim E310基础上修改。称为HBird-E200-Soc。总线地址分配表•HCLKGEN（High Speed Clock Generation）•CLINT（Core-Local Interrupt Controller）主要实现RISC-V手册中规定的标准计时器和软件中断功能•PLIC（Platform-Level Interrupt Controller）该 PLIC 能够支持多个中断源，并且每个中断可以配置中断优先级，所有中断源经过
2020-08-07 18:40:42
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原创 手把手教你设计CPU-3
调试机制对于处理器的调试功能而言，常用的两种：“交互式调试”、“追踪调试”。交互式调试是指调试器软件（如GDB）能够直接对处理器取得控制权，进而对其以一种交互的方式进行调试，譬如•下载或者启动程序•通过设定各种特定条件来停止程序•查看处理器的运行状态。包括通用寄存器的值、存储器地址的值等•查看程序的状态。包括变量的值、函数的状态等•改变处理器的运行状态。包括通用寄存器的值、存储器地址的值等•改变程序的状态。包括变量的值、函数的状态等交互性调试缺点：对处理器的运行具有打扰性。跟踪调试，即调
2020-08-06 18:27:36
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原创 手把手教你设计CPU-2
中断和异常中断和异常最大区别在于中断往往时一种外因，而异常是由处理器内部事件或程序执行中的事件引起的，譬如本身硬件故障、程序故常。中断和异常是狭义的划分，广义的异常，通常分为同步异常和异步异常。RISC-V中断有机器模式、用户模式、监督模式。蜂鸟R200只实现了机器模式。进入异常时，RISC-V架构规定的硬件行为可以简述如下。（1）停止执行当前程序流，转而从CSR寄存器mtvec定义的PC地址开始执行。（2）进入异常不仅会让处理器跳转到上述的PC地址开始执行，还会让硬件同时更新其他几个CSR寄存
2020-08-06 14:27:20
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原创 A 100-m Range 10-Frame/s 340 96-Pixel Time-of-Flight Depth Sensor in 0.18- m CMOS翻译
摘要本文介绍了一种基于光子时空相关性TOF距离范围的单光子检测技术。实现了一个概念验证原型，以10帧/秒的分辨率实现了高达100米的深度成像，分辨率为340c96像素。在系统的核心部分，采用0.18mcmos制作了32个宏像素的单光子雪崩二极管阵列传感器芯片。该芯片还包括一个32个电路阵列，该阵列能够在相关事件时产生精确的触发器，以及对每个相关事件中涉及的光子数进行采样，以及32个12-b时间数字转换器的阵列。TDC阵列的特性导致微分和积分非线性分别为0.52和0.73 LSB。对TOF传感器在强太阳背景
2020-08-03 18:53:50
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原创 A 0.18um CMOS SOC for a 100-m-Range 10-Frame/s 200x96 pixel time-of-flight Depth Sensor翻译
摘要随着ADAS对高分辨率光检测和距离技术的新兴需求，我们为了TOF传感器来介绍一个soc来执行时间相关单光子计数和完整的数字信号处理。在0.18um CMOS Soc核，我们利用16TOF线性阵列和32仅限强度宏像素基于单光子雪崩二极管这个原始规划概念，因此同时捕获有效的TOF和去除（passive）强图像。SoC包括大量一大批能根据时间相关性时间来生成精确触发器的电路，一个64 12b 十字花时间转换器，一个768Kb SRAM缓存。SoC提供系统级串行低比特率数字接口做以下功能：1）多回波距离；2）
2020-07-29 09:55:22
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原创 异步FIFO
异步FIFO结构module asyn_fifo#( parameter DSIZE = 10, parameter ASIZE = 4)( input wire wclk , input wire wrst_n , input wire winc , input wire [DSIZE-1:0] wdata
2020-06-22 10:03:33
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原创 SD Host——（三）DATA控制
DATA STATE STOP reset state of data fsmDATA_STATE_IDLE determines the data directionDATA_STATE_WAIT_RECEIVE waits for the start bit of data from sd cardDATA_STATE_RECEIVE receives payload data from sd cardDATA_STATE_RECEIVE_
2020-06-19 10:05:21
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原创 SD Host——（二）COMMAND控制
1、配置COMMAND_REGISTER_ADDR寄存器，发送CMD0命令，使能CARD处于IDLE状态。2、配置COMMAND_REGISTER_ADDR寄存器，先发送CMD5命令，在发送ACMD41命令，配置CARD operation condition3、配置COMMAND_REGISTER_ADDR寄存器，发送CMD2命令，获取device unique card identification4、配置COMMAND_REGISTER_ADDR寄存器，发送CMD3命令，获取RCA5、配置CO
2020-06-18 14:40:20
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原创 SD HOST——(一)SD简介
Micro SD有九个引脚；TF卡只要八个，少一个地。|CLK||CMD|双向口，用于发命令和接收response|VDD||GND||GND||D3||D2||D1||D0|D3-D0不一定传输的是数据，读SD内部寄存器状态也可以从D3-30输出。CMD格式SD卡是以512Byte为单位操作的。可连续读数据：可连续写数据：SD卡内部有nand flash controller和FTL管理。...
2020-06-17 16:54:23
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原创 march c+算法
March C+算法是改进后的March C算法，在每个状态中增加了一次读操作，使它能够覆盖Stuck-open故障，在每步增加一次读操作可大大提高对此故障的覆盖率。另外March C+算法同时可检测译码电路、MDR和MAR寄存器的SAF故障、固定故障、转换故障、地址译码故障、耦合故障以及部分NPSF故障，对于存储器RAM的故障覆盖率在95%以上，可见，它是一种很适合检测存储器的算法。1、March C+算法的测试过程March C+算法测试的第一个过程是：首先是初始化，对整个RAM单元写0，操作的地
2020-06-11 10:50:22
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原创 Chapter2 Memory Hierarchy Design
下图展示了多层次存储结构随着Flash和下一代存储技术缩小磁盘每一bit代价的的差距，这种技术更喜欢增加代替磁盘而不是中间存储。因为高速存储比较贵
2020-06-05 14:40:05
263
原创 Chapter1 Fundamentals of Quantitative Design and Analysis
ISA指令集体系结构，ISA的作用相当于区分软件和硬件的界限。操作的是寄存器或存储地点（地址）。从七个方面介绍ISA（1）ISA分类，有两种主流版本一、寄存器-存储器ISA，比如80x86，可以在很多指令中访问存储器二、载入-存储ISA，比如ARMv8和RISC-V，只可以用载入存储指令访问存储器（2）存储地址几乎所有桌面和服务计算机都用字节寻址来访问存储操作数。ARM要求操作对象必须是对齐的。一个大小为s的对象，其地址字节为A，如果A mod s-0，则对这个对象的访问是对齐的。80x86
2020-06-05 14:39:56
335
原创 指令参数反复判断
cshell#!/bin/cshset OPTION1set OPTION2set DEFINEwhile ( "$1" != "") switch ("$1") case "-xxx1" set OPTION1= 1 breaksw case "-define" set DEFINE = ("$DEFINE""+$2") shift breaksw
2020-06-05 14:35:40
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转载 shell判断文件是否存在
文件夹不存在则创建if [ ! -d "/data/" ];then mkdir /dataelse echo "文件夹已经存在"fi文件存在则删除if [ ! -f "/data/filename" ];then echo "文件不存在"else rm -f /data/filenamefi判断文件夹是否存在if [ -d "/data/" ];then echo "文件夹存在"else echo "文件夹不存在"fi判断文件是否存在if [ -f
2020-06-05 12:03:53
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原创 DPI接口调用
在tb.sv中写入（需要使用sv）在这里插入代码片```import "DPI-C" function void counter7 (output bit [6:0] out ,input bit [6:0] in ,input bit reset ,input bit load);tb.c中写入#include <svdpi.h>void counter7 (svBitVecVal *o ,const svBitVecVal *i ,const svBit res
2020-06-02 17:27:26
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转载 处理器访问内存时，CPU核、cache、MMU如何协同工作
CPU访问内存时的硬件操作顺序，各步骤在图中有对应的标号：1：CPU内核(图1中的ARM)发出VA请求读数据，TLB(translation lookaside buffer)接收到该地址，那为什么是TLB先接收到该地址呢？因为TLB是MMU中的一块高速缓存(也是一种cache，是CPU内核和物理内存之间的cache)，它缓存最近查找过的VA对应的页表项，如果TLB里缓存了当前VA的页表项就不必做translation table walk了，否则就去物理内存中读出页表项保存在TLB中，TLB缓存可以减.
2020-05-29 14:53:02
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转载 浅谈cache
今天探究的主题是cache。我们围绕几个问题展开。为什么需要cache？如何判断一个数据在cache中是否命中？cache的种类有哪些，区别是什么？为什么需要cache memory在思考cache是什么之前我们首先先来思考第一个问题：我们的程序是如何运行起来的？我们应该知道程序是运行在 RAM之中，RAM 就是我们常说的DDR（例如 DDR3、DDR4等）。我们称之为main memory（主存）当我们需要运行一个进程的时候，首先会从Flash设备（例如，eMMC、UFS等）中将可执行程序load到m
2020-05-28 17:12:45
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amba_axi3.0_axi4.0_axi5.0_protocol_spec.docx
2020-03-01
amba_5_ahb协议.docx
2020-03-01
Principles of Verifiable RTL Design
2014-07-29
ise_vivado_hls_petalinux_14.6_2013.02_
2013-12-26
空空如也
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