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FPGA
AllenGates
好好编程
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FPGA设计中的流水线 -分割大的计算电路可以更快的处理数据。
FPGA(现场可编程门阵列)设计中的流水线优化是一种提高设计性能的技术,它通过将设计分解为多个阶段或步骤来实现。每个阶段可以并行执行,从而提高整体的吞吐量和效率。原创 2024-07-13 00:28:17 · 1191 阅读 · 0 评论 -
tcl脚本使用实例 - 列表,循环,变量拼接, 文件自动写入
tcl在IC,FPGA领域广泛使用。列表,循环,变量拼接, 文件自动写入set values {"360" "1800" "3600"} #列表foreach value $values { #按列表循环 set solution_name "solution_${value}" #拼接 put $solution_name set headerFile [open "paras.h" "w"] puts $headerFile "#define N $value" #原创 2022-02-16 23:16:48 · 1535 阅读 · 0 评论 -
通过HLS脚本批量建立工程,并测试、综合、导出IP
Vivado HLS 使用脚本批量运行工程额一个方法原创 2022-01-11 01:07:00 · 1171 阅读 · 0 评论 -
Vivado 查看HLS生成IP的资源和最高频率
Vivado的综合往往比HLS的综合准确,这个帖子描述了用Vivado查看 HLS生成IP的更为“”真实“”的频率估计和资源估计原创 2021-12-24 04:23:03 · 7175 阅读 · 1 评论 -
FPGA异步复位同步释放
异步复位,同步释放:always @ (posedge clk, negedge rst_async_n) if (!rst_async_n) begin rst_s1 <= 1'b0; rst_s2 <= 1'b0; end else begin rst_s1 <= 1'b1; rst_s2 <= rst_s1; end assign rst_sync_n = rst_s2;原创 2021-06-30 22:43:17 · 201 阅读 · 0 评论 -
BRAM_PY改善2021-06-25
32bits,之前的代码没有连续赋值 BRAM_PY,Pynq对BRAM的操作1改进此处,现在可以连续赋值了:assign addrb=w_addr + w_addr + w_addr + w_addr;附录:完整ram_test.v如下`timescale 1ns / 1ps//// Company: // Engineer: // // Create Date: 2021/04/25 17:15:36// Design Name: // Module Name: ram_te原创 2021-06-25 22:16:43 · 152 阅读 · 0 评论 -
HLS_固定宽度_fixed int型数据对比-移位和除法比较
上篇:HLS_固定宽度_fixed float和int型数据对比ap_int右移操作和不右移操作对比:右移操作:#include <ap_int.h>void fixed_int_float(ap_int<8> *a, ap_int<8> *b, ap_int<8> *c){#pragma HLS INTERFACE ap_ctrl_none port=return#pragma HLS INTERFACE s_axilite port=a bun原创 2021-04-19 14:51:16 · 493 阅读 · 0 评论 -
HLS_固定宽度_fixed float和int型数据对比
1 简单的比较结论:8位位宽的数据,消耗的资源数是一样的。此处的比较latency也都为两个周期不过,当定点小数采用AP_RND,AP_SAT时所用的资源会稍微增加,latency也增加了:8位int型:#include <ap_int.h>void fixed_int_float(ap_int<8> *a, ap_int<8> *b, ap_int<8> *c){#pragma HLS INTERFACE ap_ctrl_none port=re原创 2021-04-19 14:29:55 · 816 阅读 · 0 评论 -
PS-PL交互DDR_硬件设计
有很多细节,慢慢更新。原创 2021-04-07 21:28:30 · 235 阅读 · 0 评论 -
AXI_GPIO0-AXIGPIO的使用,SDK编程点亮LED
import example,可以看到新的工案例程Programe FPGARun As(可以配置)然后就可以看到灯闪烁。我们把代码做下调整以点亮4个LED灯:原创 2021-03-31 16:17:51 · 195 阅读 · 0 评论 -
AXI_GPIO0-AXIGPIO的使用,接近成功
这是一个AXI-GPIO控制led和key的案例可以打开SDK:原创 2021-03-24 20:24:04 · 276 阅读 · 0 评论 -
BRAM1_我的BRAM进阶之路_不成功报错
原创 2021-03-24 17:39:43 · 183 阅读 · 0 评论 -
BRAM0_第一次使用BRAM有感_参考,不太成功
`timescale 1ns / 1ps//////////////////////////////////////////////////////////////////////////////////// Company: // Engineer: // // Create Date: 2021/03/22 17:48:01// Design Name: // Module Name: ram_test// Project Name: // Target Devices: // To原创 2021-03-24 17:11:55 · 438 阅读 · 0 评论