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原创 关于VIVADO出现“design is empty”
最近写一个UART串口收发的工程,经过功能设计,仿真验证全部都没有,但是在把所有模块整合在一起想进行联合测试和板级调试的时候便遇到这么一个问题:工程综合没有什么问题,但是没有原理图输出,一开始我也没注意到这个问题,综合后便进行实现,结果出现两个报告:一个严重警告说我将单端信号xxx_p和xxx_n约束为了差分信号(实际上不应该出现这错误的,我的设计中这两就是差分信号),第二个便是错误说我的设计是空的
2016-12-05 19:20:59 16016
原创 PCIe to AXI Translation——PCIe 内存空间到AXI内存空间的转换
PCIe to AXI Translation——PCIe 内存空间到AXI内存空间的转换UltraScale系列芯片包含PCIe的Gen3 Integrated Block IP核在内的多种不同功能的IP核都会有一页设置为PCIe:BARs,设置IP核的Base address register 的相关参数,如图1所示: 图1 PCIe:BARs 配置图 一般来说在FPGA中使用PCIe
2016-12-05 19:16:15 10159 1
原创 KCU105开发板的美信电源管理工具的使用
KCU105开发办的电源可以通过在开发板上的zynq相连的串口来进行监控,能够知道板上每个电源芯片的输出电压、输出功率以及当前温度,但是通过串口只能监控,不能控制。想要控制板上电源的输出,必须利用PMBus来进行控制。随着电源的发展,开发板上基本都是使用数字电源管理方案,都是统一的利用PMBus来进行集中管理,所以KCU105也不例外。在使用之前,在电脑上安装好美信的电源管理工具软件以及适配器的
2016-12-05 18:58:01 1044
原创 学习笔记20151211——AXI4 STREAM DATA FIFO
AXI4 STREAM DATA FIFO是输入输出接口均为AXIS接口的数据缓存器,和其他fifo一样是先进先出形式。可以在跨时钟域的应用中用于数据缓冲,避免亚稳态出现。支持数据的分割和数据拼接。
2015-12-11 16:09:16 26868 3
空空如也
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