Onsemi 推出首款 TOLL 封装 650V SiC MOSFET

 

新器件封装尺寸缩小 60%,性能增强,损耗减少

Onsemi 在 PCIM Europe 上宣布了世界上第一个 TO-Leadless (TOLL) 封装的 SiC MOSFET。该晶体管满足了对适用于高功率密度设计的高性能开关器件快速增长的需求。直到最近,SiC 器件一直采用 D2PAK 7 引线封装,这需要更大的空间。

TOLL 封装的占位面积仅为 9.90 mm x 11.68 mm,与 D2PAK 封装相比,PCB 面积可节省 30%。它的外形仅为 2.30 毫米,占用的体积比 D2PAK 封装小 60%。

除了尺寸更小外,TOLL 封装还提供比 D2PAK 7 引线更好的热性能和更低的封装电感 (2 nH)。其开尔文源配置确保更低的栅极噪声和开关损耗 - 与没有开尔文配置的器件相比,包括开启损耗 (EON) 降低 60%,确保在具有挑战性的电源设计中显着提高效率和功率密度作为改进的 EMI 和更容易的 PCB 设计。

Onsemi 高级副总裁兼高级电源部总经理 Asif Jakwani 表示:“在小空间内提供高度可靠的电源设计的能力正在成为许多领域的竞争优势,包括工业、高性能电源和服务器应用。 . “将我们一流的 SiC MOSFET 封装在 TOLL 封装中不仅可以减少空间,还可以提高 EMI 等许多领域的性能并降低损耗。结果是高度可靠和坚固耐用的高性能开关器件,将帮助电源设计人员应对严格的电源设计挑战。”

第一款采用 TOLL 封装的 SiC MOSFET 是 NTBL045N065SC1,适用于要求苛刻的应用,包括开关模式电源 (SMPS)、服务器和电信电源、太阳能逆变器、不间断电源 (UPS) 和储能。该设备适用于需要满足最具挑战性的效率标准的设计,包括 ErP 和 80 PLUS Titanium。

NTBL045N065SC1 的 VDSS 额定值为 650 V,典型 RDS(on) 为 33 mΩ,最大漏极电流 (ID) 为 73 A。基于宽带隙 (WBG) SiC 技术,该器件的最高工作温度为 175 °C 和超低栅极电荷 (QG(tot) = 105 nC),可显着降低开关损耗。此外,TOLL 封装具有 MSL 1(湿度敏感度 1 级)等级 - 并得到保证 - 以确保降低批量生产中的故障率。

永霖光电-UVSIS-发布

ROHM最近推出SiCMOSFET的新系列产品“SCT3xxxxR系列”。SCT3xxxxR系列采用最新的沟槽栅极结构,进一步降低了导通电阻;同时通过采用单独设置栅极驱动器用源极引脚的4引脚封装,改善了开关特性,使开关损耗可以降低35%左右。此次,针对SiCMOSFET采用4引脚封装的原因及其效果等议题,我们采访了ROHM株式会社的应用工程师。关于SiCMOSFET的SCT3xxxxR系列,除了导通电阻很低,还通过采用4引脚封装使开关损耗降低了35%,对此我们非常感兴趣。此次,想请您以4引脚封装为重点介绍一下该产品。首先,请您大致讲一下4引脚封装具体是怎样的封装,采用这种封装的背景和目的是什么。首先,采用4引脚封装是为了改善SiCMOSFET的开关损耗。包括SiCMOSFET在内的电源开关用MOSFET和IGBT,被作为开关元件广泛应用于各种电源应用和电源线路中。必须尽可能地降低这种开关元件产生的开关损耗和传导损耗,但不同的应用,其降低损耗的方法也不尽相同。作为其中的一种手法,近年来发布了一种4引脚的新型封装,即在MOSFET的源极、漏极、栅极三个引脚之外,另外设置了驱动器源极引脚。此次的SCT3xxxxR系列,旨在通过采用最新的沟槽栅极结构,实现更低的导通电阻和传导损耗;通过采用4引脚封装,进一步发挥出SiC本身具有的高速开关性能,并降低开关损耗。那么,我想详细了解一下刚刚您的概述中出现的几个要点。首先,什么是“驱动器源极引脚”?驱动器源极引脚是应用了开尔文连接原理的源极引脚。开尔文连接是通过电阻测量中的4个引脚或四线检测方式,在电流路径基础上加上两条测量电压的线路,以极力消除微小电阻测量或大电流条件下测量时不可忽略的线缆电阻和接触电阻的影响的方法,是一种广为人知的方法。这种4引脚封装仅限源极,通过使连接栅极驱动电路返回线的源极电压引脚与流过大电流的电源源极引脚独立,来消除ID对栅极驱动电路的影响。
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