1 CPU实现的基本框图

已于 2023-12-14 22:24:12 修改
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文章标签： RISC-V
于 2023-12-11 23:53:09 首次发布
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汇编语言 && 指令格式

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CPU设计的框架：三级流水线

ROM存放指令和数据，大端模式&小端模式，地址对齐

取指
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译码：
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执行：
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汇编语言 & 指令格式
流水线实现工作机制
模块功能划分&接口信号

参考资料：RISC-V设计

北枫凉
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