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RSS订阅原创 封装verilog代码成AXI_IP核，实现PYNQ调用
参考：https://blog.csdn.net/shushm/article/details/49536845 verilog封装IP核（sum）https://www.cnblogs.com/chengqi521/p/7987714.html verilog封装IP核（LED）(1)https://www.cnblogs.com/chengqi521/p/7988031.html verilog封装IP核（LED）(2) 约束文件添加https://blog.csdn.net/limoon121
2020-08-13 23:35:39
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原创 Ultra 96V2 PS/PL(BRAM交互共享数据） PYNQ
环境：PYNQ、Ultra96 V2、Vivado2018.3具体流程：结构简图（https://blog.csdn.net/rzjmpb/article/details/50365915# ）（1） 创建Vivado工程，选择Ultra 96板；（2） Create Block Design；（3） Add ZYNQ，Run Block Automation；（4） 添加AXI_BRAM_CTRL x2（一个write、一个read）, 并把number of BRAM interfa
2020-07-29 18:13:12
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原创 量化（博客整理）
Quantizing deep convolutional networks for efficient inference: A whitepaper 译文
2020-07-18 09:27:55
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原创 实验室服务器配置
目录前言服务器硬件服务器交付前服务器日常管理前言最近实验室新配了一台服务器，本文记录服务器配置相关流程和遇到的问题。服务器硬件图中LSI 9271-81应是 LSI 9271-8i。服务器交付前商家安装了UBUNTU18.04系统，磁盘阵列选择RAID5，RAID5兼顾安全性和空间利用率。在通常情况下，RAID有下几种分类：RAID0：由多个硬盘并发协同工作完成数据的读写，数据被均匀分布在各个硬盘上，一般情况下，使用的硬盘越多，读写的速度越快。RAID0的特点是读写速度快，并且价格便宜；缺
2020-07-16 23:14:22
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原创 USB/UART/I2C/SPI等接口传输速率
目录USB总线UARTI2C总线SPI总线GPIO(RK3399)FMCUSB总线USB1.1：——-低速模式(low speed)：1.5Mbps——-全速模式(full speed)： 12MbpsUSB2.0：向下兼容。增加了高速模式，最大速率480Mbps。——-高速模式(high speed)： 25~480MbpsUSB3.0：向下兼容。——-super speed ：理论上最高达4.8Gbps，实际中，也就是high speed 的10倍左右。UARTRS232：传输速率一
2020-07-14 10:14:48
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原创 目标检测自学记录之tensorflow实现YOLO-v1
本文记录我在学习YOLO-v1过程中参考的相关资料以及部分个人理解。tensorflow实现。
2019-08-18 12:47:01
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原创 目标检测自学记录之SSD
作为一名即将入学的硕士研究生，我觉得有必要将自己平时学习、做项目过程中遇到的问题等记录下来，以便于以后的整理与复习。因本人水平有限，博客中可能会有一些错误理解，欢迎大家指正，共同交流进步。本文为我的第一篇博客，格式、内容、表达等方面都有欠缺，以后会逐渐加强。本文记录我在学习SSD过程中参考的相关资料以及部分个人理解。
2019-08-11 17:46:23
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空空如也
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