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原创 USB协议概述
USB协议有很多博主讲的很详细了,我这里就是按照我个人的理解总结下,本文章倾向于总结结构,关于结构中的每个字节的具体含义推荐大家还是去找手册,我这里只是一笔带过。本文章借鉴了其他博主的一些内容,侵删!!!!
2024-03-18 20:45:00 1555
原创 CYusb3014 应用笔记2-FX3 固件结构
接上一个笔记目录 ,本笔记主要讲解FX3 固件代码的结构,有些内容需要读者先了解下USB的协议。本节内容主要参考官方手册:FX3_Programmers_Manual。也参考了一些其他博主的资料,侵删!
2024-03-17 15:31:32 1874
原创 在线调试(VIO) in system sources and probes editor
quartus在线调试(VIO) in system sources and probes editor
2023-07-05 13:13:27 852
原创 xilinx 12bit xadc调试
最重要的还是要看官方的数据手册开始正文1 找到IPIP 的配置很简单:第一页:本页配置说明:1 使用DRP端口读取数据2 使用连续模式采集数据,即不停的按照一定的频率去采集ADC数据3 数据采集通道数据 ,即xadc可以按照一定的顺序依次采集我们要求采集的参数,比如温度 电压1 ,电压3 ...4 DRP时钟为 100 m,去掉了复位信号第二页,ADC_SETup,默认就可以。第三页ALARMS ,设置一些警告,如果不需要,去掉...
2021-08-18 10:44:09 2018
原创 VIVADO Verilog 头文件添加方法
有3种方法1 :Set the include.v file as global included and set its file_type to "Verilog Header".If file_type is not set to Verilog Header, the include file will be treated as an ordinary Verilog filewhich can be referred by the other Verilog files an..
2021-08-18 10:31:56 9120
原创 xilinx mmcm输出时钟动态相位移动
xilinx的时钟动态相位移动需要使用MMCM,同时使能 ps ,设置如下:其输入端口为psclk ,psen ,psincdec ,输出psdondepsen每拉高一个psclk时钟,就相位就会变化1个tap,然后12个psclk时钟之后,psdone拉高,表示设置成功。1个tap为相位移动时钟的VCO周期的56分之1.举例:VCO时钟为1250Mhz ,那么1个tap的算法为: 1 000 000 000 000(ps)/1250 000 000 /56 = 14..
2021-08-18 10:26:07 3733 1
空空如也
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