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构建数字通信技术理论与实践之间的桥梁

孤云出岫去留一无所系 朗镜悬空静躁两不相干 菜根谭.明.洪应明

CRD500开发板

回复用户及读者关于“FPGA信号处理开发板CRD500”的相关问题。CRD500采用的是Altera的CycloneIV器件平台,开发环境为QuartusII 13.1,开发语言为Verilog HDL。
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作者: 杜勇老师

退伍军人、电子工程师、高校教师。四川省广安市人,现定居于成都。出版《数字滤波器的MATLAB与FPGA实现》、《数字通信同步技术的MATLAB与FPGA实现》、《数字调制解调技术的MATLAB与FPGA实现》、《锁相环技术原理及FPGA实现》等多部著作。邮箱:duyongcn@sina.cn
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