PCB布线规范

1.PCB元器件库的要求
(1)PCB板上所使用的元器件的封装必须正确,包括元器件引脚的大小尺寸、引脚的间距、引脚的编号、边框的大小和方向表示等。
(2)极性元器件(电解电容、二极管、三极管等)正负极或引脚编号应该在PCB元器件库中和PCB板上标出。
(3)PCB库中元器件的引脚编号和原理图元器件的引脚编号应当一致,例如在前面章节中介绍了二极管PCB库元器件中的引脚编号和原理图库中引脚编号不一致的问题。
(4)需要使用散热片的元器件在绘制元器件封装时应当将散热片尺寸考虑在内,可以将元器件和散热片一并绘制成为整体封装的形式。
(5)元器件的引脚和焊盘的内径要匹配,焊盘的内径要略大于元器件的引脚尺寸,以便安装

2.PCB元件布局的要求
(1)元器件布置均匀,同一功能模块的元器件应该尽量靠近布置。
(2)使用同一类型电源和地网络的元器件尽量布置在一起,有利于通过内电层完成相互之间的电气连接。
(3)接口元器件应该靠边放置,并用字符串注明接口类型,接线引出的方向通常应该离开电路板。
(4)电源变换元器件(如变压器、DC/DC变换器、三端稳压管等)应该留有足够的散热空间。
(5)元器件的引脚或参考点应放置在格点上,有利于布线和美观。
(6)滤波电容可以放置在芯片的背面,靠近芯片的电源和地引脚。
(而在电源和地之间放置一个0.1uF的去耦电容可以有效地滤除这些高频纹波和毛刺。如果电路板上使用的是贴片电容,应该将贴片电容紧靠元器件的电源引脚。对于电源转换芯片,或者电源输入端,最好是布置一个10uF或者更大的电容,以进一步改善电源质量。)
(7)元器件的第一引脚或者标识方向的标志应该在PCB上标明,不能被元器件覆盖。
(8)元器件的标号应该紧靠元器件边框,大小统一,方向整齐,不与焊盘和过孔重叠,不能放置在元器件安装后被覆盖的区域。

3.PCB布线要求
(1)不同电压等级电源应该隔离,电源走线不应交叉。
(2)走线采用45°拐角或圆弧拐角,不允许有尖角形式的拐角。
(3)PCB走线直接连接到焊盘的中心,与焊盘连接的导线宽度不允许超过焊盘外径的大小。
(4)高频信号线的线宽不小于20mil,外部用地线环绕,与其他地线隔离。
(5)干扰源(DC/DC变换器、晶振、变压器等)底部不要布线,以免干扰。
(6)印制走线宽度的确定方法。走线宽度是由导线流过的电流等级和抗干扰等因素决定的,流过电流越大,则走线应该越宽。一般电源线就应该比信号线宽。为了保证地电位的稳定(受地电流大小变化影响小),地线也应该较宽。
实验证明:当印制导线的铜膜厚度为0.05mm时,印制导线的载流量可以按照20A/mm2进行计算,即0.05mm厚,1mm宽的导线可以流过1A的电流。
1A=40MIL=1MM
所以对于一般的信号线来说10~30mil的宽度就可以满足要求了;高电压,大电流的信号线线宽大于等于40mil,线间间距大于30mil。为了保证导线的抗剥离强度和工作可靠性,在板面积和密度允许的范围内,应该采用尽可能宽的导线来降低线路阻抗,提高抗干扰性能。

(6)为了保证波形的稳定,尽可能加粗电源线和地线,在空间允许的情况下,电源线的宽度不小于50mil。
(7)低电压、低电流信号线宽9~30mil,空间允许的情况下尽可能加粗。
(8)元器件印制走线的间距的设置原则。
不同网络之间的间距约束是由电气绝缘、制作工艺和元件大小等因素决定的。例如一个芯片元件的引脚间距是8mil,则该芯片的【Clearance Constraint】就不能设置为10mil,设计人员需要给该芯片单独设置一个6mil的设计规则。同时,间距的设置还要考虑到生产厂家的生产能力。
影响元器件的一个重要因素是电气绝缘,如果两个元器件或网络的电位差较大,就需要考虑电气绝缘问题。一般环境中的间隙安全电压为200V/mm,也就是5.08V/mil。所以当同一块电路板上既有高压电路(>250)又有低压电路(<=250)时,就需要特别注意足够的安全间距。

(8)信号线之间的间距应该大于10mil,电源线之间间距应该大于20mil。
(9)大电流信号线线宽应该大于40mil,间距应该大于30mil。
(10)差分线 速率高 不能跨分割 (相邻平面)分割的平面不能包含两个区域。
(10)过孔最小尺寸优选外径40mil,内径28mil。在顶层和底层之间用导线连接时,优选焊盘。
(11)不允许在内电层上布置信号线。
(12)内电层不同区域之间的间隔宽度不小于40mil。
(13)在绘制边界时,尽量不要让边界线通过所要连接到的区域的焊盘。
(14)在顶层和底层铺设敷铜,建议设置线宽值大于网格宽度,完全覆盖空余空间,且不留有死铜,同时与其他线路保持30mil(0.762mm)以上间距(可以在敷铜前设置安全间距,敷铜完毕后改回原有安全间距值)。(用以有效减小地线阻抗,从而削弱地线中的高频信号,同时大面积的接地可以对电磁干扰起抑制作用。)
(15)在布线完毕后对焊盘作泪滴处理。
(16)金属壳器件和模块外部接地。
(17)放置安装用和焊接用焊盘。
(18)DRC检查无误。

4.PCB分层的要求
(1)电源平面应该靠近地平面,与地平面有紧密耦合,并且安排在地平面之下。
(2)信号层应该与内电层相邻,不应直接与其他信号层相邻。
(3)将数字电路和模拟电路隔离。如果条件允许,将模拟信号线和数字信号线分层布置,并采用屏蔽措施;如果需要在同一信号层布置,则需要采用隔离带、地线条的方式减小干扰;模拟电路和数字电路的电源和地应该相互隔离,不能混用。
(如果需要最后将模拟地和数字地统一为一个电位,则通常应该采用一点接地的方式,也就是只选取一点将模拟地和数字地连接起来,防止构成地线环路,造成地电位偏移。)
(4)高频电路对外干扰较大,最好单独安排,使用上下都有内电层直接相邻的中间信号层来传输,以便利用内电层的铜膜减少对外干扰。
5.多层PCB线路板设计原则小结
本文主要介绍了多层电路板的设计步骤,包括多层板层数的选择、层叠结构的选择;多层板布局布线与普通双层板布局布线的相同和不同;多层板特有的中间层的创建和设置,以及内电层设计。希望能对各位有所帮助。

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### 回答1: PCIe PC的布线规范是指PCIe(Peripheral Component Interconnect Express)接口的PCB(Printed Circuit Board,印刷电路板)布线标准。PCB布线规范是为了确保PCIe接口信号的传输质量和稳定性而制定的。 首先,PCIe PCB布线规范要求按照规定的布线层次来布置信号线。通常,PCIe接口的信号分为差分信号、时钟信号和电源信号。差分信号主要用于数据传输,时钟信号用于同步传输,电源信号则提供供电。根据信号的类型和特点,布线时需要分层布置,以减少信号间的干扰和串扰。 其次,PCIe PCB布线规范还要求信号线的长度和走线路径的规划。为了保证信号的正确传输和稳定性,信号线的长度应尽可能相等,以减少信号的时延差异。另外,走线路径应尽量避免与其他高频干扰源(如时钟信号和电源线)靠近,以减小信号的串扰。 此外,PCIe PCB布线规范还要求使用适当的布线宽度和间距。布线宽度的选择应根据信号的频率和驱动能力来确定,以保证良好的信号传输。同时,布线时应保留足够的间距,以防止信号之间的干扰和串扰。 最后,PCIe PCB布线规范还要求根据需要使用合适的终端和阻抗匹配措施。终端电阻可以帮助控制信号的反射和干扰,提高信号的品质。阻抗匹配则可以减少信号在布线中的损耗和失真。 总之,PCIe PCB布线规范的目标是提高PCIe接口的性能和可靠性。遵循这些规范,可以有效地减少信号的干扰和串扰,提高信号传输的质量和稳定性,确保PCIe设备的正常工作和数据传输的可靠性。 ### 回答2: PCIe PCB布线规范是指在设计PCIe总线电路板时,需要遵循的一系列规范和标准,旨在确保PCIe信号的稳定性和可靠性。 首先,在布线过程中需要遵循长度匹配原则,即保持各差分信号对的长度相等。这可以帮助消除信号传输中的相位差,提高信号完整性。同时,也需要控制信号线的长度与最短差分线对进行匹配,以避免信号延迟不均。 其次,布线时需要避免共模噪声的干扰。共模噪声指的是信号对之间的相同源的噪声。应该将信号层与电源和地层分开,并在布线中增加地线以降低共模噪声的影响。 此外,布线要避免电磁干扰(EMI)的影响。这可以通过使用恰当的屏蔽技术、差分布线和数据线之间的足够间距来实现。还可以通过采用地线填充和消除平面来降低EMI。 还应遵循良好的信号完整性设计原则。这包括控制信号线的走线路径,使其尽可能短,并尽量减少信号线弯曲和交叉。此外,还应该避免信号线与电源和地线的交叉敷设,以减少干扰。 最后,布线时还需要考虑PCIe接口的匹配阻抗。这可以通过正确选择合适的传输线宽度、间距和PCB材料来实现。 总之,遵循PCIe PCB布线规范可以确保PCIe信号的稳定传输和可靠性,以提高系统的性能和可靠性。 ### 回答3: PCIe PCB布线规范是指在设计和布线PCIe(Peripheral Component Interconnect Express)扩展卡时需要遵循的一系列规则和标准。以下是一些常见的PCIe PCB布线规范: 1. 信号完整性:为保证正确的信号传输,需要遵循阻抗匹配、信号层叠、地平面、信号层分隔等原则。 2. 信号耦合和串扰:在设计中要进行信号层分区,避免不同信号之间的耦合和串扰。 3. 时钟信号布线:PCIe中的时钟信号在布线时需要保持较短的路径,并采用均匀分布的方法来减小时钟抖动。 4. 数据差分对:PCIe使用差分信号传输,需要保持一对差分信号的长度、匹配和层间耦合等方面的一致性。 5. 地平面设计:要保持地平面的连续性和低阻抗,并避免信号与电源线和其他高速信号层的交叉。 6. 电源噪声:要保持电源线的稳定性,减小电源噪声对其他信号的干扰。 7. 端子和插槽设计:要在设计中考虑插拔力和接触电阻,确保可靠的连接。 8. 等长设计:为了保持信号的同步和减小时延差异,需要对PCIe差分信号对进行长度匹配。 9. 抗干扰和抗静电:要进行良好的地线和电源线布置,以提高抗干扰能力,并在布线中考虑静电保护措施。 10. 层间通孔的布置:要保持层间通孔与差分对之间的距离尽可能小,并有序地布置。 遵循这些布线规范可以确保PCIe扩展卡的稳定性和可靠性,避免信号传输错误和性能下降。实际布线时,还需要根据具体设计要求和布局来进行适当调整和优化。

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