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千兆以太网
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前尘往事,莫再提及。
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基于FPGA的数据采集、编码、通讯和存储系统设计(即FPGA+RTL8211千兆以太网+SD卡存储+RTC+Uart+AD7606数模转换+电流放大采集等硬件设计及程序验证)
包含硬件PCB设计和FPGA的Verilog代码的编写,下图为主要功能框图。FPGA作为并行处理单元,实现了电流和电压的采集、千兆以太网通讯、SD卡本地存储和串口通讯等。已经打PCB实际验证和Verilog代码在硬件上的实际测试,测试部分包含:千兆网通讯收发测试、AD采集的数据验证、SD卡存储验证、RTC实时时钟读取和RTC的RAM突发读取等。PCB设计采用的是AD软件,Verilog程序通过quartus II软件编写。现由硬件和软件两个方面简单介绍。一、硬件设计下图分别为硬件的正面和反面,纯手工焊原创 2021-02-06 13:32:56 · 7703 阅读 · 17 评论 -
基于RTL8211E的千兆以太网收发verilog程序(已经硬件验证,初学=语法注释较多)
软件平台quartus 13.1硬件芯片 Atera,Cyclone IV EP4CE30F23C8千兆PHY芯片:RTL8211E话不多数,直接附上部分源码,有需要的点击链接下载:原创 2020-11-08 20:44:04 · 3168 阅读 · 7 评论