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原创 coe文件数据后的逗号

一般我们从matlab中导出数据,存在FPGA的ROM中,需要转换成ROM的coe格式。当数据很多时,我们要在每个数据后面加上一个逗号。可以用excel解决。先打开excel,选中某一列,然后设置单元格格式->数字->自定义->类型->@","->确定然后将数据复制进来,就解决了。记得最后一个数据后面改成;...

2019-05-29 11:16:35 689

原创 I2C总线

1. I2C协议I2C(Inter-integrated Circuit)总线支持设备之间的短距离通信,用于处理器和一些外围设备之间的接口,它只需要两根信号线来完成信息交换。I2C最早是飞利浦在1982年开发设计并用于自己的芯片上,一开始只允许100kHz、7-bit标准地址。1992年,I2C的第一个公共规范发行,增加了400kHz的快速模式以及10-bit扩展地址。在I2C的基础上,19...

2019-03-30 23:08:29 1082

原创 SPI串行总线

原理介绍:SPI是同步串行通信接口。英文是serialperipheral interface的缩写,也就是串行外围设备接口。SPI是一种高速的、全双工、同步通信总线,标准的SPI也仅仅使用4个引脚,广泛用于EEPROM、Flash、RTC(实时时钟)、ADC(数模转换器)、DSP(数字信号处理器)以及数字信号解码器上。SPI通信的速度很容易达到好几兆bps,所以可以用SPI总线传输一些未压...

2019-03-30 22:57:46 1613

原创 串口通信协议(UART)及仿真

串口通信协议串口通信(UART)是一种用两线(Rx【发送端】、Tx【接收端】)实现的异步、全双工通信方式。由于串口通信没有时钟信号线,由此而出现波特率(BaundRate),即接收和发送双方规定好相同的波特率;以此来保证传送的数据的正确性;※波特率:一秒钟内传送的比特数目。如下图1是串口通信协议(UART Protocol),分为五个阶段分别为:起始位(Start)、有效数据位(Vaild...

2019-03-30 22:49:43 6438 1

原创 单片DDR3实现乒乓操作的方案

关于单片DDR3实现乒乓操作的方案设计最近在实验室探索这个问题,对于某些项目设计中,在数据处理部分需要存储数据,如果用Block RAM资源,则会占用极多的RAM资源或者全部的Block RAM资源也不足以存放一批数据,这时就需要外挂DDR3存储器。对于常见的DDR3乒乓处理,是用两组DDR3,两套指令控制线进行乒乓操作,这样的话程序部分也便于编写。但是多一组DDR3,布线将会增加难度,引脚的...

2019-03-05 22:31:25 4567 12

原创 DDR3的简述,IP核的建立和时序

1. DDR3的简述DDR(Double Date Rate SDRAM)是双倍速率同步动态随机存储器,双倍速率的含义是在时钟的上升沿和下降沿采样,这样就把采样时钟频率提高了一倍。介绍几个名词:1.逻辑Bank: 它是组成DDR3的存储单元,每个逻辑Bank结构都类似一个带有行列寻址能力的二维存储表格,在逻辑Bank中,先指定一个行(Row),再指定一个列,可以准确地定位到所找寻的存储位置,...

2019-03-04 22:34:02 5905

原创 7 series FPGAs Transceiver Wizard IP核使用和测试

学习FPGA一段时间了,前面一直没有系统的总结,这学期把在项目中用到的IP核和一些调试过程中遇到的问题总结一下发出来,坚持下去,一起进步!今天总结一下的GTH核的使用和测试。软件版本:Vivado 2017.4IP核版本:7 Series FPGAs Transceivers Wizard (3.6)FPGA:xc7vx690tfft1927实现功能:四路光纤数据接收,由于GTX IP...

2019-03-01 16:21:26 16639 19

DDR3时序和IP核的建立

本资料包含DDR3的发展概述,读写时序控制和IP核的建立

2019-03-04

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