ZYNQ：Hello World 实验-PS-串口打印“Hello World”

于 2024-10-01 02:13:48 发布
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分类专栏： FPAG 文章标签： fpga开发 学习
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版权

Hello World 实验目的

PS-串口打印“Hello World”

创建 Vivado 工程

设置工程名为“hello_world”
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使用 IP Integrator 创建 Processing System

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搜索栏中键入“zynq”，找到并双击“ZYNQ7 Processing System”
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串口配置
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配置完成后的 ZYNQ7 Processing System
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记得按快捷键 Ctrl+S 保存当前设计！！！
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生成顶层 HDL 模块

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生成 Bitstream 文件并导出硬件

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软件设计

在 Vitis 中创建应用工程

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点击 Build Project 对工程进行编译

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编译完成后显示“Finished building：hello_world.elf”

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菜单栏中选择 Window > Show View > Terminal，在 Show View 窗口中搜索添加Terminal
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打开下载界面
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打开设备开关 得到结果！！！
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完成比完美重要！！！
学习记录，侵权联系删除
来源：正点原子

li星野
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专栏目录
【ZYNQ】Zynq Hello World 应用
洋洋Young的博客
05-18 839
Xilinx 官方提供了一些 SDK 开发应用实例，方便用户学习与开发 SDK 应用程序。本文主要介绍如何在 Zynq 上运行Xilinx SDK Hello World 应用，通过 Zynq 串口打印 “Hello World”，并介绍 Xilinx SDK Terminal 工具的使用。
ZYNQ开发系列——PS开发之HelloWorld
gzy0506的博客
04-04 7676
提示：文章写完后，目录可以自动生成，如何生成可参考右边的帮助文档 ZYNQ开发系列——PS开发之HelloWorld前言外设接口SDK建立工程相关操作记录 前言 俗话说一日不见，如隔三秋。两年没搞PS的开发，居然连HelloWorld怎么出来都不记得了，可见知识记录的重要性，知识真的是有保鲜期的，当年那是多么熟练，信手拈来，不进行记录的话，现在就忘得有多彻底。这也是我半年前决心开始写博客的原因之一，希望自己学到的技能记录下来，永远保鲜。 不过毕竟之前还是搞过，尽管现在看来又是从头开始学习，但应该进度不.
ZYNQ之嵌入式学习----开篇实验Hello World
鲁棒最小二乘支持向量机
11-16 1231
ZYNQ嵌入式SDK开篇实验Hello World
ZYNQ嵌入式系统-Hello World 实验
特别的猫
11-10 2513
“Hello World!”是各种编程语言中最简单，同时也是最经典的入门实验。因此，我们将串口打印“Hello World”作为 ZYNQ 嵌入式系统的开篇实验，这也是我们步入 ZYNQ 的 PS 部分的始发点。通过本次实验我们将了解 ZYNQ 嵌入式系统的开发流程，熟悉 ZYNQ 嵌入式最小系统的搭建。本章包括以下几个部分： 1.1 简介 1.2 实验任务 1.3 硬件设计 1.4 软件...
Zynq-7000系列之linux开发学习笔记：HelloWorld（二）
Claudedy的博客
05-27 3658
开发板：Zynq7030数据采集板 PC平台：Ubuntu-18.04 + MobaXterm 开发平台：Xilinx Vivado + SDK -18.3 学习目标：Zynq7030数据采集板通过串口输出 “Hello World” 字符串 一、Vivado工程创建 上一篇文章中，介绍了整个开发环境的搭建过程，所需要的文件都已准备就绪。为了先熟悉Zynq7030在Llinux下开发流程，我们...
zynq无法打印hello world的调试方案
lcy_0110的博客
07-03 180
我遇到的问题是：画最小系统PS端，只引出DDR和IO，这个时候默认的DQS啥的都没问题，串口成功工作。主要发挥作用的是block design里的PS端配置，即DDR和UART口。其他现象：vitis无法进入debug，不会自动跳转程序第一行。但是放在ADI官方的例程里的时候只改了DDR型号就不行。推断可能是这个值还是要考虑实际的pcb，不能用默认值。2.最后是通过改DQS数据使串口正常工作的。1.检查硬件原理图UART口是否一致。
ZYNQ-Hello world
jack_lu_0321的博客
08-19 517
Hello world 友情提示：页面比较长，但是步骤十分详细。由于第一个工程所以比较细，后面的文章会省略掉前面的步骤，直接从创建子系统开始写作（暂且称为作品，其实挺差的） 一．创建项目 点击Create Project，创建一个项目 点击Next 项目名称尽量和所作的任务一致，方便一眼就能看出是什么 两处默认是勾选，若没有勾选就请勾选上 搜索相对应芯片例如使用是xc7z020clg400-1 点击Finish，项目创建完成 二．环境搭建 点击Create Block Design 创建一个子系
ZYNQ：PS－CAN总线功能应用
jpyjpy123的博客
02-04 2877
上篇解决了ZYNQ搭建PS和PL系统的问题，相当于完成最小系统板搭建。因此，本篇文章主要用于记录搭建CAN外设系统会出现的问题。由于ZYNQ系统包含PS和PL两个部分，PS部分往往问题较少，所以考虑先搭建PS系统的CAN外设系统。熟悉了基本流程和软件库函数使用后，再搭建PL的CAN外设应用。初期目标是能够用逻辑分析仪收发CAN帧。
FPGA的Zynq 7000学习--基于黑金AX7010开发板的Hello World 实验
weixin_43950612的博客
11-18 4882
FPGA的Zynq 7000学习–基于黑金AX7010开发板的Hello World 实验 /9月开学入手了黑金AX7010开发板，自己也没有学到很多，但是还是想一步一步记录自己的进步，所以开了博客，也想好好归纳归纳，让自己尽快成长起来，谢谢。/ 大家学习C语言或者51单片机，相信也是从最基本的“Hello World实验”开始的。不过ZYNQ 7000又有一点不同，就是它是分为PL和PS两个部分...
黑金ZYNQ7035-ps端打印一个helloworld
07-16
标题中的“黑金ZYNQ7035-ps端打印一个helloworld”指的是在基于Xilinx ZYNQ7035的嵌入式系统中，通过处理器系统（PS，Processing System）实现打印“Hello World”这个经典的程序示例。ZYNQ7035是Xilinx公司生产的...
PS部分HELLO_WORLD.rar_Xilinx_ZYNQ7000_ps_world
09-21
在ZYNQ7000上实现“Hello World”涉及到在PS部分的ARM处理器上运行一个简单的C程序，向标准输出（通常是串口）打印出“Hello World”字符串。这需要完成以下步骤： - **建立开发环境**：首先，你需要安装Xilinx的...
基于Zynq 7000实现最简单PS核工作的hello world工程
08-27
基于Zynq 7000实现最简单PS+PL串口工作的hello world工程，适合入门上手了解vivado整个操作过程
初识ZYNQ——FPGA学习笔记15
m0_69082048的博客
09-18 1292
与板上系统相比，SoC的解决方案成本更低，能在不同的系统单元之间实现更快更安全的数据传输，具有更高的整体系统速度、更低的功耗、更小的物理尺寸和更高的可靠性。ZYNQ的本质特征，是它组合了一个双核处理器和一个传统的现场可编程门阵列 （FPGA）逻辑部件。FPGA：（，现场可编程门阵列）， 一种可以通过编程来修改其逻辑功能的数字集成电路（芯片）FPGA架构AMBA（高级可扩展总线）
FPGA在汽车电子中应用-ADAS
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09-23 863
之前某鱼上出现大量汽车控制板，如下图所示：核心主控是ZYNQ UltraScale+系列FPGA。虽然目前新能源汽车主控已经转投英伟达+ARM了，但是FPGA还是有一定应用场景的。小米su7上主要芯片今天我们介绍一下FPGA在汽车上ADAS系统中的应用。ADAS（Advanced Driving Assistance System，高级驾驶辅助系统）在汽车上非常重要。该系统的主要功能是协助驾驶员避...
1. BOOT.BIN 2. 固化 3. 启动 4. SDK 5. 文件
lsh11111的博客
09-23 500
固化程序的方法并不需要深入理解FPGA的启动原理，只需正确生成BOOT.BIN文件并设置模式开关，掌握烧录流程即可。在进行FPGA的开发与固化过程中，生成BOOT.BIN文件是一个重要的步骤。BOOT.BIN文件通常包含了系统启动所需的不同文件，以下是如何创建和使用该文件的详细说明。使用上述任一方法生成的BOOT.BIN文件内容是相同的。以上步骤和注意事项为您提供了生成和使用BOOT.BIN文件的完整流程，帮助您在FPGA开发中顺利进行固化和启动。3. **连接与启动**2. **复制文件**
简易CPU设计入门：取指令（一），端口列表与变量声明
2401_82825368的博客
09-22 1056
讲解入门CPU
vivado中除法器ip核的使用
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09-26 346
看了很多博客，都没写清楚，害。选择经过几个周期出结果。
【Verilog学习日常】—牛客网刷题—Verilog企业真题—VL62
最新发布
qq_44629558的博客
09-26 547
要求使用Verilog HDL实现，并编写testbench验证模块的功能。将序列码001011按照移位规律每三位一组，可划分为六个状态。当设计最终的序列输出时，我们发现最后的输出序列为状态。由于M（序列信号的长度）= 6，所以n≥3；将Q0、Q1、Q2均使用带复位端的D触发器例化；注意：此处将IDLE注释掉，结果仍然正确。的值（因为每次从Q0端移出数据）；因此，我们给出了以下两种代码方式；rst_n：复位信号，低电平有效。(注意：该题的Q0Q1Q2有。我们再给出一种解法，使用。根据反馈激励函数表，画。
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