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RSS订阅原创 记录我对离散时间傅里叶变换DTFT、离散时间傅里叶级数DFS的理解和学习过程
本人水平有限，文章仅作为自己的学习记录，且多用不严谨的、通俗易懂的语言去介绍。如有错误，希望大佬们多多批评指正。
2023-06-01 14:57:45
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原创 记录我对复指数信号的理解和学习过程
本人水平有限，文章仅作为自己的学习记录，且多用不严谨的、通俗易懂的语言去介绍。如有错误，希望大佬们多多批评指正。本节是为了填之前的坑，在介绍傅里叶级数的时候引入了复指数形式的傅里叶级数，是由欧拉公式推过来的。可是为什么会有复指数？欧拉公式怎么理解？复指数还有什么用？这些问题都是我之前很好奇的问题，很遗憾，我仍然没有搞明白为什么会有复指数，但是我可以介绍一下复指数和欧拉公式怎么理解，以及在通信中的典型应用。
2023-05-18 23:54:03
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原创 记录我对傅里叶变换的理解和学习过程
总结：我们先对f(t)进行傅里叶级数展开看到一根一根线，并且将幅度谱换了个说法，引入了频谱的概念。紧接着增大f(t)的周期，我们发现频谱变密直到变成了一个连续的样子。学过信号与系统的朋友们应该知道一个结论：时域连续、周期，频域非周期、离散；时域连续、非周期，频域非周期、连续。所以把傅里叶级数所学的概念推广一下，如果要研究一个连续、非周期信号，我们可以采用傅里叶变换的方法去分析一个信号的频率成分！这篇文章普及基带和射频。常说的基带和射频是指什么？
2023-05-17 17:19:44
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原创 记录我对傅里叶级数的理解和学习过程
本人能力有限，只作为个人学习记录，如有错误之处劳烦大佬们批评指正。一、历史小故事傅里叶（1768-1830）是法国数学物理学家，1807年他在法国科学学会上发表了一篇论文，用正弦曲线来描述温度分布，并提出了一个论断：任何连续周期的信号，都可以表示为一组适当加权的正弦曲线之和。没错，就是现在我们学习的傅里叶级数！审查这篇论文的人包括了拉格朗日和拉普拉斯，拉普拉斯及其他审查者同意发表该论文，然而拉格朗日坚决反对。最终法国科学学会迫于拉格朗日的威望，拒绝了傅里叶的论文，直到拉格朗日死后15年，这篇论文才被发表。
2023-05-15 11:08:17
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原创 FPGA和USB3.0通信知识记录（9）—— 基于 FPGA-FX3 SlaveFIFO 接口的 StreamOUT 实例
本篇继续记录特权同学图书《Xilinx FPGA伴你玩转USB3.0与LVDS》中例程一、功能概述StreamOUT过程和lookback过程有相似之处，StreamOUT是PC——>FX3——>片内ram，lookback实例还需要返回数据给PC，StreamOUT实例只有单向的过程。二、RAM IP核简介时钟IP核（MMCM PLL）、RAM 和 FIFO 实验_哔哩哔哩_bilibilihttps://www.bilibili.com/video/BV15A411.
2022-04-05 15:30:35
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原创 FPGA和USB3.0通信知识记录（8）—— 基于 FPGA-FX3 SlaveFIFO 接口的 loopback 实例
一、功能概述PC 端发送数据到 FX3，FX3 通过指示信号 flaga 告知 FPGA 有数据待读取，FPGA 端便通过 SlaveFIFO 接口读取 PC 端发送过来的数据缓存到 FPGA 内部的 FIFO 中，FPGA 在完成读取操作后，发起一次 SlaveFIFO 的写入操作，将接收到的数 据通过 FX3 最终返回到 PC 端。二、FPGA代码解析2.1工程层次及模块基本功能介绍【模块1：sys_ctrl.v 】与系统时钟和复位信号产生相关【模块2：led_control
2022-04-04 21:54:05
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原创 FPGA和USB3.0通信知识记录（7）—— USB3.0 控制器 FX3 实例
终于记录到正题了，这个系列的学习笔记全部基于特权同学的图书，侵删。本人新手，希望和大家一起进步，多多关照呀！这个系列将记录USB3.0 控制器 FX3 相关的一些实例。一、基于 FX3 内部 DMA 的 USB 传输 Loopback 实例1.1什么是DMA嵌入式系统中DMA的作用_哔哩哔哩_bilibilihttps://www.bilibili.com/video/BV1yf4y187Fn?from=search&seid=18111565913901156852&spm_i
2022-03-31 16:05:50
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原创 FPGA和USB3.0通信知识记录（6）——基于特权同学图书《Xilinx FPGA伴你玩转USB3.0与LVDS》（基于UART的DDR3数据读写实验）
上一节实现了FPGA串口通信，这一节继续跟着特权同学的例程，记录一下基于FPGA的DDR3存储器控制实验。本文全部基于书本《Xilinx FPGA伴你玩转USB3.0与LVDS》，我是新人请多多关照，一起进步！一、DDR3 IP核配置与仿真1.1DDR3控制器 IP核基本结构如上图所示，DDR3 控制器包括用户接口（User Interface）模块、存储器控制器（Memory Controller）模块、 初始化和校准（Initialization/Calibration）...
2022-03-30 18:14:15
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原创 FPGA和USB3.0通信知识记录（5）——基于特权同学图书《Xilinx FPGA伴你玩转USB3.0与LVDS》（Uart-lookback实验）
上一篇（4）简单介绍了PLL IP核的用法，这一篇继续记录一个例程——FPGA串口通信。
2022-03-27 19:40:16
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原创 FPGA和USB3.0通信知识记录（4）——基于特权同学图书《Xilinx FPGA伴你玩转USB3.0与LVDS》
xilinx FPGA PLL IP核使用
2022-03-25 20:04:29
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原创 FPGA和USB3.0通信知识记录（3）——基于特权同学图书《Xilinx FPGA伴你玩转USB3.0与LVDS》
主要介绍Vivado创建工程、新建.v文件，约束，仿真文件、FPGA配置模式相关基本概念
2022-02-19 15:51:50
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原创 FPGA和USB3.0通信知识记录（2）——基于特权同学图书《Xilinx FPGA伴你玩转USB3.0与LVDS》
这篇文章演示FX3的SDK和驱动安装、Vivado安装、串口芯片驱动安装
2022-02-17 15:44:55
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原创 FPGA和USB3.0通信知识记录（1）——基于特权同学图书《Xilinx FPGA伴你玩转USB3.0与LVDS》
大家好，我是一个新人，请多多关照！我的毕业论文选题和特权同学《Xilinx FPGA伴你玩转USB3.0与LVDS》图书相关，所以在学习这本书的同时，做一下记录。第一章：FPGA、USB和LVDS概述1.1~1.4都在介绍FPGA的发展历史、应用领域和开发流程。1.5 USB接口概述（1）发展史：20世纪90年代末，计算机开始集成USB接口。USB1.1最高速度大12Mb/s；USB2.0最高480Mb/s；USB3.0将文件传输速度提升至5Gb/s。而USB取代的是图1“大家伙”.
2022-02-16 15:20:19
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空空如也
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