计算机组成原理实验:全加器实验

这篇博客介绍了计算机组成原理实验中的全加器操作。实验目标包括熟悉虚拟实验系统和掌握全加器的工作原理。实验内容涉及搭建全加器电路,根据真值表进行运算。文章讨论了串行进位并行加法器的运算速度问题以及超前进位的改进方法,并解释了如何使用全加器实现补码加法/减法。
摘要由CSDN通过智能技术生成

计算机组成原理实验:全加器实验

实验一:全加器实验

实验目的:

1.熟悉多思计算机组成原理网络虚拟实验系统的使用方法。
2.掌握全加器的逻辑结构和电路实现方法。

实验仪器设备及材料:
本实验使用的主要元器件有:与非门、异或门、开关、指示灯

实验原理及内容:

原理:
1 位二进制加法器有三个输入量:
两个二进制数字 Ai、Bi 和一个低位的进位信号 Ci, 这三个值相加产生一个和输出 Si 以及一个向高位的进位输出 Ci+1,这种加法单元称为全加器,其逻辑方程如下:
Si=Ai⊕Bi⊕Ci (1.1)
Ci+1=AiBi+BiCi+CiAi

内容:
1.运行虚拟实验系统,搭建实验电路
在这里插入图片描述
从左至右输入为Ai、Bi、Ci,输出为Ci+1,Si

2.打开电源开关,按表中的输入信号设置数据开关,根据显示在指示灯上的运算结果填写表中的输出值。
一位全加器真值表
在这里插入图片描述
3.关闭电源开关,增加元器件,实现一个 2 位串行进位并行加法器。

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