【Power Compiler手册】9.时钟门控（3时钟门控风格）

于 2024-06-20 09:55:15 发布
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分类专栏： 数字IC低功耗设计 文章标签： Power Compiler clock gating
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版权
时钟门控风格

Power Compiler 工具根据您指定的风格在设计中插入时钟门控单元。当没有指定时钟门控风格时，工具会使用一组预定义的风格用于时钟门控。set_clock_gating_style 命令的默认设置适用于大多数设计。

以下部分将详细讨论默认时钟门控风格和使用特定时钟门控风格：

• 默认时钟门控风格

• 选择时钟门控风格

compile_ultra -gate_clock 命令在目标库不包含定义的时钟门控风格和操作条件的单元时，会阻止时钟门控插入，并发出 PWR-763 信息消息。必须根据目标库中可用的时钟门控单元，重新定义时钟门控风格或操作条件。

默认时钟门控风格

当指定 set_clock_gating_style 命令时，工具使用的风格与不指定该命令时使用的风格不同。

当仅使用少数选项指定 set_clock_gatin

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QRBQ94
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【Power Compiler手册】9.时钟门控（1）
QRBQ
06-19 150
时钟门控技术适用于同步使能负载寄存器，这些是共享相同时钟和同步控制信号的触发器。同步控制信号包括同步使能、同步置位、同步复位和同步翻转。同步使能负载寄存器通过具有反馈回路的寄存器来表示，该寄存器在多个周期内保持相同的逻辑值。将时钟门控应用于同步使能负载寄存器可以减少重新加载寄存器组时所需的功耗。图 18 显示了使用具有反馈回路的多路复用器实现的简单寄存器组。当同步使能信号（EN）处于逻辑状态 0 时，寄存器组被禁用。在此状态下，电路使用多路复用器将寄存器组中每个存储元件的 Q 输出反馈到 D 输入。
【Power Compiler手册】9.时钟门控（2）
QRBQ
06-19 247
如果时钟树综合工具在时钟门控单元之后不插入缓冲器，那么时钟门控单元和寄存器之间的总延迟等于时钟门控单元的延迟（时钟引脚到时钟输出信号）加上时钟门控单元和寄存器之间的连线延迟。如果时钟树综合工具在时钟门控单元之后插入缓冲器，那么在时钟门控单元和寄存器之间的总延迟上加上时钟网络延迟的估计值。此命令会移除指定时钟上的时钟延迟值。如图 22 所示，lat_cgtoreg 是从时钟门控单元的时钟引脚到被门控寄存器的时钟引脚的估计延迟，而 lat_reg 是对没有时钟门控的寄存器的时钟引脚的估计时钟网络延迟。
【Power Compiler手册】2.Power Compiler设计流程
QRBQ
05-23 210
当创建设计时，它从高层次的抽象转移到门级最终实现。功耗编译器工具在整个设计周期中，从RTL到门级，提供分析和优化。有关设计流程的信息，请参见以下主题：• 设计周期中的功耗• 功耗优化和分析流程。
【Power Compiler手册】7.功耗分析
QRBQ
06-04 311
report_power` 命令分析并报告设计中各种元素的功耗。在执行此命令之前，必须捕获开关活动，将设计映射到门级，并标注设计。该工具为以下设计元素创建功耗报告：- 设计- 模块- 网络- 单元或特定类型的单元组- 多角多模式设计的场景`report_power` 命令使用 Power Compiler 许可证。命令完成后，许可证会被释放。如果许可证不可用，命令将以错误消息终止。
【Power Compiler手册】8.生成功耗报告
QRBQ
06-04 134
示例 14 显示了一个功耗报告的摘要。示例 14 report_power 命令的摘要报告-verbose...--------
【Power Compiler手册】6.反标翻转活动
QRBQ
06-03 338
Power Compiler工具使用`-toggle_rate`和`-period`（或`-clock`）选项来确定每个时间单位的实际切换率。默认的静态概率是 0.5。要显示与`read_saif -rtl_saif -hierarchy`命令生成的报告类似的RTL不变对象上的注释报告，可以使用`-rtl`选项。要强制将所有综合不变点包括在映射文件中，而不管对象是否经历了重大名称更改，请使用`saif_map -write_map -type ptpx`命令的`-essential`选项。
低功耗设计——门控时钟
weixin_50518899的博客
02-25 1428
芯片功耗组成中，有高达40%甚至更多是由时钟树消耗掉的。这个结果的原因也很直观，因为这些时钟树在系统中具有最高的切换频率，而且有很多时钟buffer，而且为了最小化时钟延时，它们通常具有很高的驱动强度。此外，即使输入和输出保持不变，接收时钟的触发器也会消耗一定的功耗。而且这些功耗主要是动态功耗。那么减少时钟网络的功耗消耗，最直接的办法就是如果不需要时钟的时候，就把时钟关掉。这种方法就是大家熟悉的门控时钟：clock gating。(电路图中看到的CG cell就是门控时钟了)。
【Power Compiler手册】4.saif文件
QRBQ
05-28 198
功耗计算的准确性取决于切换活动数据的准确性。这些数据是通过使用RTL仿真或门级仿真生成的，并存储在SAIF文件中。在执行功耗优化和分析之前，应该使用SAIF文件来反标设计对象上的切换活动信息。SAIF是由Synopsys支持的ASCII格式，用于促进不同Synopsys工具之间的信息交换（参见IEEE 1801标准，附录J）。使用`read_saif`命令读取SAIF文件，使用`write_saif`命令写出SAIF文件。有关更多信息，请参见`read_saif`和`write_saif`命令的手册页。
【Power Compiler手册】1.工具介绍
QRBQ
05-23 108
Power Compiler工具是Synopsys Design Compiler综合工具家族的一部分。该工具执行寄存器传输级（RTL）和门级电源优化以及门级电源分析。通过应用工具的电源降低技术，包括时钟门控、多电压优化和泄漏电源优化，可以在前端综合中实现功耗节省和面积以及时序优化。有关工具方法论的信息，请参阅以下主题：- Power Compiler方法论- 功耗库模型- 功耗分析- 功耗优化- 开始使用Power Compiler工具。
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