Wiley旗下期刊从投稿到出版全记录——更新ing

首先恭喜自己成功达到毕业条件,这一路也是探索啊,感觉找不到相关投稿细节全靠自己摸索,所以也会提交很多次,记录一下希望可以帮助其他研究路上小伙伴,嘿嘿嘿,如果有相关问题,大家可以一起交流讨论

2024.5.12第一次选了一个觉得和自己研究方向相关的期刊投稿

2024.5.21九天就被拒绝了,拒绝理由是觉得和期刊方向不太一致,但是Wiley推荐了他觉得可以转投的三本期刊

仔细查看三本期刊对其中一本很满意觉得可以试试看看,查到的是sci非oa三个月返稿,满怀期待开始尝试,wiley有个好处就是一键转稿件,上一个拒绝我的期刊推荐了这个期刊,只要在系统上确认转稿就完成了,非常省事不用再重新整理提交一遍了

但是不同期刊要求还是不同的,摘要引言字数什么的,图片格式的扒拉扒拉,拉扯了十多天终于提交成功了开始第二个期刊

2024.6.2 Under Reviewer,前几天是with editor,查了下说是大写就变外审了,期待了开始

2024.7.22 审稿意见回来了,大修,期限三个月返稿件,两个审稿人各十条意见开始加班加点改了,意见都还好,没有补充实验的类型,大多是表达和解释问题

2024.8.7改的差不多了,记得要按要求返稿,修稿好的和带标记的都要提交,还有对意见的逐条回复的信,检查好多遍。但是每次提交都会有新的问题:图片格式不对,文中缺少引用图片,等等问题,返回过三次

2024.8.13成功提交,开始等待了

2024.8.30accept ,接accept快乐

2024.9.3 发邮件给通讯确认作者,以及签订一系列license

2024.9.16校稿邮件来了,要求48h返回(虽然按时提交了,但是后续折腾了几天图片问题清晰度不够,强烈建议保存tif和jpg)

2024.9.24发表啦*★,°*:.☆( ̄▽ ̄)/$:*.°★* 。

### 关于Cadence 17.2版本中Pspice的教程 #### 安装指南 对于希望安装Cadence PSpice 17.2版本的用户来说,需注意几个关键步骤。当点击安装Cadence软件时,应指定添加安装包路径以及设定不含空格和汉字字符的安装路径[^1]。完成基础软件部署后,还需通过加入Hotfix文件的方式安装必要的更新补丁。最后,在一切设置妥当之后,务必记得重启计算机以使更改生效。 #### 绘制原理图 一旦上述准备工作就绪,则可以在重新启动后的环境中利用OrCAD Capture CIS工具着手绘制所需的电路原理图。此阶段涉及的具体操作包括但不限于元件的选择、放置及其间的连接构建等动作。 #### 创建自定义电路模块 针对那些想要进一步定制化工作流或者提高效率的技术人员而言,掌握如何基于个人需求创建专属的电路组件显得尤为重要。在Cadence PSpice环境下,这意呸着能够把一系列预设好的子电路打包成独立单元以便重复调用或分享给团队成员。具体实现过程涵盖了从草稿构思到最后成品导出的一系列环节[^2]。 #### 设计流程概览 在整个电子设计自动化领域里,由概念验证直至最终产品成型往往遵循一套既定的工作模式。对于采用Cadence平台开展工作的工程师们来讲,这套方法论通常始于案例研究进而过渡至详尽的设计实施;期间会经历诸如原理图表绘、错误检测修正、性能测试评估等多个重要节点直到所有目标达成为止[^3]。 #### 原理图设计概述 深入探讨一下项目结构的话就会发现,“Design Resources”部分主要负责存储整个项目的配置信息。“Outputs”则用于汇总各类中间产物或是终期报告文档。“Referenced Projects”允许设计师轻松关联其他辅助性的外部资料库从而促进跨部门协作交流活动顺利展开。值得注意的是如果当前任务涉及到仿真的话那么这里还会额外显示出专门用来支持此类作业的相关条目——即所谓的“PSpice Resources”。 ```python # Python代码示例仅作为装饰用途,并不实际参与解释说明逻辑 def example_function(): pass ```
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