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RSS订阅原创 XILINX-启动配置（引脚复用）
使用原语及iobuf实现配置引脚在用户态时复用。DTS控制输入或输出，即3态控制，受读写控制。FCSBTS受片选控制；
2025-05-13 13:27:37
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原创 sv激励生成方法
2.定义一个类，包含变量（范围和权重的约束）、变量转换为所需激励数据的方法、生成供参考模型使用的激励的copy。3.时序化，这里转换为带时钟的数据。1.创建一个.sv文件。
2025-04-12 21:10:24
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原创 MPLS（Multiprotocol Label Switching）
MPLS（Multiprotocol Label Switching）多协议标签转发，是一种路由方法。
2025-03-25 17:14:08
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原创 vlan入门
当报文穿过运营商网络，到达运营商网络另一侧 PE(Provider Edge，服务提供商网络边缘)设备后，报文被剥离公网 VLAN Tag，然后再传送给用户网络的 CE(Customer Edge，用户网络边缘)设备。来自不同用户网络的报文在运营商网络中传输时被隔离，即使这些用户网络各自的 VLAN 范围存在重叠，因为分配到的公网 VLAN 不同，在运营商网络中传输时也不会产生冲突。在公网的传输过程中，设备只根据外层 VLAN Tag 转发报文，而内层 VLAN Tag 将被当作报文的数据部分进行传输。
2025-03-20 14:00:55
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原创 arp及其应用
1）、在同一广播域内，所有主机处于同一网段，主机A要向主机C发送信息，主机A的ARP表中没有对应的MAC地址，主机先以广播方式发送一个ARP请求报文。如果网关没有主机D的ARP表项，网关会广播ARP请求，目标IP地址为主机D 的IP地址，当网关从收到的响应报文中获得主机D的 MAC 地址后，就可以将报文发给主机 D；3)、收到ARP的主机C通过比较接收的目的IP地址与自己的IP地址相同，查询自己的ARP表有没有主机A的MAC地址，没有就添加主机A的MAC地址和IP地址。三层设备路由器不转发ARP广播。
2025-03-18 11:13:59
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原创 xilinx-时序优化2【跨die设计】
跨die设计，超长线路 (SLL) 布线，超长线路 (SLL) 布线将器件内一个 SLR 与另一个 SLR 信号联通。传输限制： 对跨多 SLR 的高速传输而言，请务必寄存穿过 SLR 边界的信号。提示： 为确立 SLR 间的可用 SLL 数量，请使用 SLR 属性。SLL 信号是 SLR 组件之间的唯一数据连接。必要时可考虑pblock约束。
2025-02-25 10:30:36
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原创 网络-nc发送udp消息
使用netcat（nc）发送udp消息【16进制原始数据】：将十六进制字符串转换为二进制数据。：将数据发送到指定主机和端口。
2025-02-10 14:21:35
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原创 ALTERA-LUT-S5【无标题】
LEs~=1.3倍sum(luts)；[可用于选型，类比altera的logic elements和xilinx的system logic cells]详情：1slice=2个6输入lut+2个addr+4个mux+4个registers。
2024-01-31 14:08:05
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原创 linux时间戳和日期
若此时的时间为1970年01月02日00时00分00秒，则对应的linux时间戳为86400x1秒。Linux时间戳是相对1970年01月01日00时00分00秒UTC时间起至现在的总秒数。其中，一年的秒数为60x60x24=86400s。
2023-12-28 08:36:16
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原创 XILINX—vio
vivado的VIO的ip的输出可以控制测试模块的输入，VIO的输入可以显示模块的输出值。ip中，其变量的个数和位宽可以配置。可以利用其特性使用其输出作为控制信号的输入或使用其输入监控变量的状态，
2023-12-27 21:50:51
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原创 XILINX-system monitor
system management，内部包含一个温度传感器、一个电压传感器。转换结果存储在专用状态寄存器，寄存器宽度为16bits；支持DRP、JTAG、I2C访问，内部访问用DRP接口，需要例化实例，其他两种不需要例化实例。支持最大17路模拟输入通道；与先前代之间的差异比较。
2023-12-22 12:24:30
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原创 XILINX-SSI
SSI-stacked silicon interconnect 硅片堆叠互联，指将多个die（SLR-super logic regions）通过互联和制造技术至一个chip中。最直观的是，器件更大，器件容量更高、资源更多、低功耗封装，即我们看到的芯片各种可用资源增加，同时也带来了增加布局布线和时序收敛的难度。SLR之间通过SLL(super long line)互联，sll位于silicon interposer之中。3、获取slr间的互联网络名称。4、获取slr间可用sll数量。
2023-12-21 13:40:57
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systemverilog+读取csv文件+二维关联数组
2025-04-10
空空如也
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