嵌入式开发中Cache问题的解决方法

已于 2022-07-18 08:50:16 修改
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分类专栏： FPGA ZYNQ 嵌入式 文章标签： ZYNQ DDR fpga开发
于 2022-07-04 15:14:51 首次发布
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在Cortex-A7芯片的嵌入式开发中，CPU和FPGA通过DDR3交互数据时遇到Cache问题。文章探讨了CPU的存储器层次结构，解释了Cache对性能的影响以及在FPGA频繁写入DDR3时可能导致的数据不一致。通过禁用Cache或使用Cache Flush和Cache Invalidate操作来解决这个问题。了解这些机制对于优化裸机程序和确保数据同步至关重要。
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 作者 | 冰茶奥利奥

微信公众号 | 嵌入式电子创客街 

最近在使用一款Cortex-A7芯片时，出现了一个让人比较困惑的问题。ARM和FPGA通过DDR3进行数据通信，FPGA会把数据定时存放进DDR3里面，然后ARM通过读取DDR3获取数据。

我们知道，在ARM架构体系下，一切皆地址。一片512MB的DDR3对应的不过也是一串长度为512M字节的地址。比如我的板子上，DDR3分配的地址就是从0x00100000—>0x1FFFFFFF，大小为512M。

我们知道，CPU和外设之间有多级的缓存结构，其模型就如同金字塔一般，如下图所示，最顶层的就是CPU的寄存器了，越往下存储量越大同时读写更慢。我们的DDR在L4那一层，属于DRAM主存。

当然，在ARMv7架构里一般只有两级高速缓存，即L1和L2。

存储器层次结构<

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对于初学嵌入式的新手来说，不明白CaChe的工作原理，可能会很迷茫，本文将全面揭示嵌入式中CaChe的原理。
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嵌入式系统中的CACHE问题
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嵌入式系统中Cache一致性问题分析
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【嵌入式基础】内存（Cache，RAM，ROM，Flash）
大白嵌入式
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作为合格的嵌入式工程师，内存的概念及应用场景是必需了解的知识点。了解内存的概念，可以更方便得熟悉整个系统的架构。
嵌入式系统/ARM技术中的嵌入式系统中的CACHE问题
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嵌入式开发之ARM处理器的选择问题
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【嵌入式笔记】CPU的cache
最新发布
Codes
08-01 276
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嵌入式系统设计师学习笔记⑥：存储器的层次架构及Cache详解
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04-24 1254
嵌入式系统设计师学习笔记⑥：存储器的层次架构及Cache详解 存储器被组织成金字塔形的层次结构： 存储器自上而下，组成6个层次结构，依次变得更慢、访问效率更低、容量更大、每字节的造价更便宜。 如图所示： Cache： ①功能：提高CPU数据输入输出的速率，突破所谓的“冯·诺依曼瓶颈” ②速度：在计算机的存储系统体系中，Cache是访问速度较快的层次 ③原理：使用Cache改善系统性能的依据是程序的局部性原理 ④组成：Cache由两部分组成：控制部分和Cache存储器部分 局部性原理： 概念：利用程序的时间
Cache类型寄存器介绍 - 嵌入式
LrfScript的博客
09-20 64
通过设置寄存器的值，可以选择合适的缓存类型、大小和映射方式，以优化系统性能。在嵌入式系统中，Cache类型寄存器（Cache Type Register）是一个重要的寄存器，用于描述和配置处理器的缓存特性。Cache类型寄存器是一种特殊的寄存器，它包含有关缓存的配置信息，如缓存类型、大小和映射方式等。通过选择合适的缓存类型、大小和映射方式，可以提高数据访问速度和指令执行效率，从而加快系统的响应速度。通过修改Cache类型寄存器的值，可以配置处理器的缓存特性以满足不同的应用需求。
嵌入式中cache使用及数据操作一致性机制
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08-07 1112
在使用cache时，多master主设备使用总线要保证数据一致性，而且锁机制需要依赖硬件原子数据操作指令来实现。
Cache的基本概念和使用场景（嵌入式）
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缓存的工作原理类似于字典，通过设置一个索引，将主存中的块（block）映射到缓存中的某个位置。在每次访问数据前，会首先在缓存数组中查找是否存在对应数据，如果命中则直接从缓存中获取，否则从主存中获取数据并更新缓存。在嵌入式系统中，很多应用具有时间上的局部性，即CPU在执行某个任务时，会反复访问相同的数据。通过使用缓存，可以将这些频繁被访问的数据存储在高速缓存中，减少对主存的访问次数，从而提高系统的响应速度和整体性能。它的存在可以显著提高系统的性能，减少对主存储器的访问次数，从而降低了数据访问延迟。
Cache的基本概念及原理解析——嵌入式
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若不命中，则需要从主存中获取所需的数据，并将其存储到Cache中的合适位置。如果数据不在Cache中，处理器将需要从主存中加载数据，并将其存储到Cache中，这就是一次不命中（Miss）。如果不存在（不命中），则需要先从主存中获取数据（如果已经存在），然后再在Cache中更新数据。（1）Cache一致性：在多核处理器中，由于多个核心共享同一个Cache，可能会导致数据不一致的问题。了解Cache的基本概念和工作原理，并正确地在嵌入式系统中使用Cache，有助于优化系统的性能和资源利用率。
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S3C44B0X嵌入式系统开发：总线控制信号解析
"本文主要介绍了S3C44B0X嵌入式系统开发中的总线控制信号，特别是SCBX的引脚配置。S3C44B0X是一款由Samsung推出的微处理器，集成了ARM7TDMI核心，适用于低成本嵌入式应用系统设计。处理器的特点包括8KB Cache、外部...
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