扰码解扰器的实现
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关于扰码器设计的前期铺垫
学习更多相关知识,关注博主知乎账号,用户名Trustintruth https://www.zhihu.com/people/suo-yi-xin-90/activities最近在设计扰码解扰,比较麻烦。前期铺垫文就不在烘托背景与应用。首先扰码器的设计离不开移位寄存器,那么移位寄存器的设计,首先长度即移位寄存器的寄存器个数应该由输入位长决定,但是输入与输出之间的关系,例如第一位输入和第...原创 2019-05-06 17:21:19 · 514 阅读 · 1 评论 -
扰码器(一)扰码器综述及设计思路
学习更多相关知识,关注博主知乎账号,用户名Trustintruth https://www.zhihu.com/people/suo-yi-xin-90/activities首先,扰码:扰码的目的是抑制线路码中的长连“0” 和长连“1” ,便于从线路信号中提取时钟信号。由于线路信号仅通过扰码,所以SDH的线路信号速率与SDH电口标准信号速率相一致,这样就不会增加发端激光器的光功率代价。...原创 2019-05-07 17:55:58 · 5509 阅读 · 6 评论 -
扰码器(二)串行扰码器综述及设计思路
学习更多相关知识,关注博主知乎账号,用户名Trustintruth https://www.zhihu.com/people/suo-yi-xin-90/activities哈哈哈,经历了毕设与论文之后的博主终于回来更博了。今天我们的目标是解决串行扰码器首先扰码器的作用就是用来将有序数据流变成随机(无序)数据流。而且不是简单的无序,是要求扰码之后的数据流是类白噪声数据流。而且扰码...原创 2019-06-19 13:56:01 · 3037 阅读 · 1 评论 -
扰码器(三)并行扰码器综述及设计思路
学习更多相关知识,关注博主知乎账号,用户名Trustintruth https://www.zhihu.com/people/suo-yi-xin-90/activities经历了串行扰码器的设计后,我们今天来认真讨论一下扰码器的并行化。在许多工程项目中,在通信接口的设计中,通信协议对于扰码器的工作频率要求非常高,但是由于串行扰码器是1bit进行的,如果再要求频率过高的话,FPGA是无...原创 2019-07-03 14:24:57 · 2347 阅读 · 0 评论