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RSS订阅原创 LintCode_最小差
问题描述：给定两个整数数组（第一个是数组 A，第二个是数组 B），在数组 A 中取 A[i]，数组 B 中取 B[j]，A[i] 和 B[j]两者的差越小越好(|A[i] - B[j]|)。返回最小差。样例：给定数组 A = [3,4,6,7]， B = [2,3,8,9]，返回 0。算法设计：方法一：先将A与B从小到大排序，从A的第一个数开始到最后一个数求差值。在
2015-11-30 19:38:38
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原创 Android面试总结2
1、单例模式是什么？使用java语言实现：（1）、单例模式使得每一个类有且只有一个实例对象，而且该实例对象对外界而言易于使用；当系统只允许类有一个实例时，使用单例模式；（2）、java实现：a、懒汉模式：public class Singleton1 { private Singleton1 mSingleton; private Singleton1(){}
2015-11-03 21:09:34
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原创 无法使用真机调试Android程序&&应用程序意外停止
今天重新返回Android软件开发学习中来，各种菜鸟啦，从现在起，每天都总结下自己的学习，记录从中出现的问题啦：问题一、无法使用真机调试Android程序：1、最开始编写Helloworld程序时，可以使用模拟器调试，但是找不到真机，如下图（1）所示：看select a device with min API level 22，即设备安卓版本最低是API 22，但，我的安卓手机是4.3，
2015-05-20 21:28:52
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原创 安卓环境搭建
1、下载jdk，链接：http://www.oracle.com/technetwork/java/javase/downloads/index.html2、将“Java”和“javac”（应用程序）所在路径设置成环境变量path，java和javac在bin文件夹下。如果没有设置，在cmd下敲Java和javac会出现下面的错误：3、下载sdk，链接：http://dev
2015-05-20 09:28:57
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原创 使用任务设计四个并行输入数的排序组合逻辑
1、使用冒泡排序算法，编写一个任务，完成四个8位2进制输入数据的（1）、冒泡排序思想：（如下图）（2）、从上面的算法思想中可以看出，在排序过程中，我们需要设定一个计数器，以判断在第i轮排序中，要排序到多少位；（3）、建模`define data_length 8module sort3(a,b,c,d,ra,rb,rc,rd); input [
2015-04-23 11:32:46
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原创 使用always过程块实现一个选择运算器及八选一数据选择器
1、使用always过程块实现一个可加减与或非运算的运算器（1）、代码部分：`define plus 3'd0`define minus 3'd1`define band 3'd2`define bor 3'd3`define unegate 3'd4module alu(out,opcode,a,b); input [7:
2015-04-22 10:56:37
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原创 利用条件语句实现不同占空比的分频时钟电路
1，要实现的是如下的一个“产生占空比不同的分频时钟”：（1）、建模：module fdivision_module(clock,d_clock,reset,j); input clock,reset; output d_clock,j; reg d_clock; reg [2:0]j; always @(posedge clock)
2015-04-21 23:01:19
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原创 关于四位计数器的设计，阻塞式与非阻塞式赋值引发的问题
1、今天，从教材中学了两种可综合的四位计术器的设计方法，先附上代码吧。（1）、建模：方法一：module counter1(out,cout,data,load,cin,clk); input [3:0]data; input load,cin,clk; output cout; output [3:0]out; reg [3:0]out;
2015-04-20 16:11:33
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转载 关于 modelsim仿真时出现No objects found matching '/*'问题
这段时间，仿真时出现很多次关于 modelsim仿真时出现No objects found matching '/*'问题，今天百度了下，在EDN 电子技术设计网上找到了大侠们的答案，截图如下：
2015-04-19 10:58:16
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原创 教材上的例子--有限状态机，四种建模方式
下图是教材中的例子，教材采用四种方法建模，具体随后道来：方法一：（1）、建模module fsm1(Clock,Reset,A,K1,K2); input Clock,Reset,A; output K1,K2; reg K1,K2; reg [1:0]state; //Gray码 parameter Idle
2015-04-19 09:44:28
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原创 有限状态机--优化版
1、在前面《有限状态机--更正版》的建模模块中，我采取了左图方法建模，得出下图一正确结果module fsm5(clock,reset,coin,news_out); input clock,reset; input [1:0]coin; output news_out; reg [1:0]pres_state; reg rnews_out;
2015-04-18 10:07:18
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原创 有限状态机--自动售报机
设计一个有限状态机，不论什么功能，关键点在于：（1）、状态循环中，有哪些状态，即画出状态转换图；（2）、改变这些有限状态，有哪些条件；（3）、最终的输出，即在何种状态下会有输出。下面就是我的设计啦：1、设计模块：module finite_state_module(clock,reset,coin,news_out); input clock,reset;
2015-04-17 11:50:11
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空空如也
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