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FPGA——三速以太网协议讲解与实战
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三速自适应以太网
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FPGA——三速自适应以太网设计(1)基本模块
FPGA——以太网设计(1)基本模块1. 协议解析(1)MAC层(2)IP层 和 ARP层(3)UDP层 和 ICMP层2.1 MAC接收模块2.2 MAC发送模块3.1 IP接收模块3.2 IP发送模块4.1 UDP接收模块4.2 UDP发送模块5.1 ICMP接收模块5.2 ICMP发送模块6.1 ARP接收模块6.2 ARP发送模块6.3 ARP表模块7 CRC数据对比模块8 MAC下ARP和IP数据分流模块9 数据流仲裁模块模块收发组合1 MAC层收发2 ARP层收发2 IP层收发3 ICMP层收发原创 2024-03-06 00:28:53 · 1463 阅读 · 2 评论 -
FPGA——三速自适应以太网设计(2)GMII与RGMII接口
只在时钟的上升沿通过RGMII接口处理低四位,下个时钟上升沿再处理高四位。所以在上升沿和下降沿都输入输出同一个数据就行。输入和输出的时候,GMII的8位数据,先在时钟上升沿通过RGMII接口处理低四位,再在时钟的下降沿继续处理高四位。RGMII:ETH_RXCTL线同时表示有效和错误,有效和错误位相异或得到。GMII:发送端时钟由MAC端提供。下降沿变化数据,上升沿采集数据。原创 2024-03-06 00:29:15 · 1824 阅读 · 0 评论