基于FPGA的CAN总线控制器(支持CANFD)

最新推荐文章于 2024-06-18 21:27:46 发布
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分类专栏： FPGA 文章标签： fpga CAN
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本文链接：https://blog.csdn.net/u010942671/article/details/51416175
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前段时间在公司做了一个CAN控制器IP，支持CAN2.0B和CANFD协议，IP是通过Qsys封装成Avalon_MM接口和Avalon_ST接口，通过system console在stratixii板上与PEAK进行收发通信测试,通信测试成功。

CANFD与CAN相比：
1. 可变速率,CAN协议最高1Mbps,CANFD最高20Mbps以上(目前没关注了)
2. 数据段最高可以有64个字节
3. CRC段的校验根据数据段的字节数选择CRC17或CRC21

在CANFD协议中，需要注意其中的BRS位(变速标志位)，不是一位准确的位宽长度，它的位长度是正常位的同步段、相位段1+高速位的相位段2.当初在调试时就是一直卡在这,调了我好久，最后一位一位抓出来对比才发现就是那个BRS位的原因。

//  第一次用这个编辑器好不习惯。。。。
苍白的手漆黑的刀
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专栏目录
FPGA实现CAN总线控制器开源代码.zip
08-22
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Xilinx FPGA利用CAN IP实现CAN总线通信，Verilog源码，Vivado兼容7系列以上，代码注释清晰
ZOJeeTzTpbNl的博客
04-29 1038
本文将重点介绍如何利用Xilinx FPGA和CAN IP实现CAN总线通信，并提供了可直接使用的Verilog源码，同时注释清晰。本文重点介绍了利用Xilinx FPGA和CAN IP实现CAN总线通信的方法，通过Vivado进行设计和配置，并提供了可直接使用的Verilog源码。Xilinx FPGA提供了成熟稳定的CAN IP，可直接应用于设计中，使用CAN IP可以有效减少设计时间和资源消耗，提高系统性能和可靠性。在本文的附录中，给出了一份可直接使用的Verilog源码，用于实现CAN总线通信。
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我们知道CANFD比CAN拥有更长的数据长度（最长64字节），更高的波特率（8Mbps甚至更高）。那么波特率更高，数据更长的CANFD，一秒钟最高可以发送多少帧CANFD报文呢？我们知道CANFD比CAN拥有更长的数据长度（最长64字节），更高的波特率（8Mbps甚至更高）。那么波特率更高，数据更长的CANFD，一秒钟最高可以发送多少帧CANFD报文呢？要想知道问题的答案，那么我们就要知道一帧CANFD报文由多少个位组成，再由具体波特率算出报文时间，最后就可以得出每秒能发送的帧数了。
ds791_axi_can_CAN_AXI_xilinxcanip_axican_fpga
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Xilinx IP核 AXI CAN用户手册，介绍了IP的使用方法，寄存器定义等
CAN控制器——MCP2518FD的FPGA调式
黑怕不怕黑，这是红花会
05-10 4325
近期完成了CAN模块数据收发的调试，用到的芯片有CAN控制器：MCP2518FD和CAN收发器：ADM3057E。通过FPGA-XC7A35T开发板的SPI接口与分别与两个MCP2518FD相连，分别对其进行寄存器的读写以及RAM的读写，控制其中一个发送数据，另一个接收数据，从而实现了CAN协议数据发送与接收功能的调试。 一、SPI通信： 首先要实现FPGA与MPC2518FD的SPI通信，从而实现对其寄存器的读写配置。新建vivado工程，Creat block design，添加软核以及两个自己的S
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在Xilinx的XC7A35上测试了AXI-CANFD的使用, Vivado进行了连线, Vitis编写嵌入式代码, 配置了CANFD的波特率 采样点 滤波器 收发中断等, 连上CANFD分析仪, 进行了Classic CAN标准帧扩展帧远程帧, CANFD标准帧扩展帧, 开BRS的CANFD等的收发测试
xilinx FPGA利用can IP实现can总线通信verilog源码
2301_77436896的博客
04-04 891
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很好的资源哦，希望大家一起分享，有不对之处请多提提意见
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