记录在HDLBits练习verilog

最新推荐文章于 2024-01-17 17:23:03 发布
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文章标签： verilog
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题目让写一个上升边缘检测的问题，一开始完全不理解到底检测谁的边沿，看了半天的波形图也没看明白，代码也是没看懂，在CSDN上查找终于整明白了，记录一下第一个小困难。

题目索引：HDLBits-Circuits-Sequential Logic-Latches and FlipFlops-Detect an edge

主要是知道为啥要把信号存到寄存器里temp_1<=in;，然后在做pedge<=~temp_1&in运算，在我看来那不是和直接pedge<=~in&in是一样的运算结果吗，看了关于边缘检测的文章才弄懂，原来temp_1寄存的是前一个始时钟上升沿来时的输入信号，而in则是下一个时钟边沿到来时的输入信号，这样做运算就能检测输入信号是否发生了翻转，也就能检测边沿啦。

Hh,第一次写博客，虽是一个很小很小的一个知识点和代码，但却是一个很好的开始，加油！

ustczzx
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