2020年02月_摆渡沧桑

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原创 Verilog HDL 中的UDP

Verilog HDL语言提供了一种扩展基元的方法，允许用户自己定义元件（User Defined Primitives，UDP）。通过UDP，可以把一块组合逻辑电路或者时序逻辑电路封装在一个UDP内，并把这个UDP作为一个基本的元件来使用。需要注意的是，UDP不能综合，只能用于仿真。一、UDP的定义与调用UDP定义的语法和模块定义类似，但由于UDP和模块同属于同级设计，因此，UDP定义不能出...

2020-02-22 15:34:23 1411

原创 Verilog基本语法——原语篇（Gate门）

Verilog中已有一些建立好的逻辑门和开关的模型。在所涉及的模块中，可通过实例引用这些门与开关模型，从而对模块进行结构化的描述。逻辑门:and (output,input,…)nand (output,input,…)or (output,input,…)nor (output,input,…)xor (output,input,…)xnor (output,input,…)缓冲...

2020-02-20 14:31:22 16575 1

AXI4中文翻译详细资料.zip

AXI 4 版本介绍内有AXI 4, AXI-Lite,ACE扥等协议 i. AMBA AXI协议主要用于高性能，高频率系统设计，并且有很多特性支持AXI可以应用于高速的互连架构最新AMBA 接口（指AXI 3）主要目标：

2020-12-10

Tsuprem2004.09.zip

Tsuprem4特性： ◆ 可与MEDICI结合进行工艺器件二维联合仿真； ◆ 包含丰富的工艺模型； ◆ 采用了先进的数值计算技术； ◆ 提供了可视化平台。

2019-05-25

medici.zip

Medici 是先驱（AVANTI）公司的一个用来进行二维器件模拟的软件，它是最经典的半导体器件模拟软件，它对势能场和载流子的二维分布建模，通过解泊松方程和电子、空穴的电流连续性等方程来获取特定偏置下的电学特性。用该软件可以对双极型、MOS型等各种类型的晶体管进行模拟，可以获得一个器件内部的电势和载流子2-D分布，可以预测任意偏置下的器件特性。

2019-05-25

MOSFET Modeling & BSIM3 User's Guide,英文版，程玉华，胡正明著

集成电路数字和模拟设计行业采用的最精确的模型 BSIM3V3，用户指导手册，可用于HSPICE，模拟电路，的基于物理的深亚微米MOSFET 模型，适用于数字和模拟电路设计，由Berkeley 加州大学的器件组开发

2018-12-19

verilog硬件描述语言

Verilog是一种硬件描述语言，和C语言神似。不过它并不是一种纯粹的计算机编程语言。虽然经过二者编写的代码都会经过编译，但Verilog代码并不会生成机器指令。你可以使用Verilog代码生成所设计的硬件电路，也可以编写测试文件（testbench）来验证自己的设计。这好比使用语言来生成电路设计，这种方式比画图设计可是方便多了呢

2018-12-06

空空如也

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